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Xilinx PCIe 实现 ADC 数据采集到 PC：基于 XDMA 的奇妙之旅

news 2026/3/27 6:04:28

Xilinx PCIe采集ADC数据到PC FPGA基于XDMA实现PCIE X8采集ADC数据可提供工程源码和QT上位机软件及程序，程序带DDR3缓存，非常具有实用价值

在电子设计与数据处理的领域中，将 ADC 采集的数据高效传输到 PC 是许多项目的关键需求。今天就来聊聊利用 Xilinx FPGA 基于 XDMA 实现 PCIe X8 采集 ADC 数据这一超有趣的事儿，而且文末还会提到超实用的工程源码、QT 上位机软件及程序哦。

为何选择 XDMA 与 PCIe X8

PCIe（Peripheral Component Interconnect Express）作为高速串行计算机扩展总线标准，为数据的高速传输提供了可靠通道。而 XDMA 则是 Xilinx 推出的一款开源的 PCIe DMA 内核，它极大地简化了 FPGA 与主机之间通过 PCIe 进行数据传输的开发流程。选择 PCIe X8 模式，意味着我们拥有了 8 条数据传输通道，能够显著提升数据传输带宽，满足 ADC 高速采样数据的快速传输需求。

关键代码与解析

DDR3 缓存相关代码

DDR3 缓存对于数据的暂存和有序传输至关重要。以下是一段简化的 Verilog 代码示例，用于初始化 DDR3 控制器并实现简单的数据写入：

module ddr3_ctrl ( input wire clk, input wire rst, input wire [31:0] data_in, input wire write_en, output reg [31:0] data_out, output reg read_en ); // 这里假设使用 Xilinx 的 MIG（Memory Interface Generator）生成的 DDR3 控制器接口 wire [15:0] ddr3_addr; wire [127:0] ddr3_wdata; wire [15:0] ddr3_bank; wire ddr3_ras_n; wire ddr3_cas_n; wire ddr3_we_n; wire [15:0] ddr3_dm; wire ddr3_odt; wire ddr3_cke; wire ddr3_cs_n; wire [63:0] ddr3_rdata; wire ddr3_rdata_valid; // MIG 实例化 mig_7series_0 your_mig_instance ( .sys_clk_i(clk), .sys_rst_i(rst), // 其他众多接口连接，这里省略简化 .ddr3_addr(ddr3_addr), .ddr3_ba(ddr3_bank), .ddr3_cas_n(ddr3_cas_n), .ddr3_cke(ddr3_cke), .ddr3_cs_n(ddr3_cs_n), .ddr3_dm(ddr3_dm), .ddr3_odt(ddr3_odt), .ddr3_ras_n(ddr3_ras_n), .ddr3_we_n(ddr3_we_n), .ddr3_wdata(ddr3_wdata), .ddr3_rdata(ddr3_rdata), .ddr3_rdata_valid(ddr3_rdata_valid) ); reg [31:0] write_counter; always @(posedge clk or posedge rst) begin if (rst) begin write_counter <= 32'd0; end else if (write_en) begin // 将输入数据写入 DDR3 ddr3_wdata <= {data_in, data_in}; // 假设数据宽度适配 ddr3_addr <= write_counter[15:0]; ddr3_bank <= 16'd0; ddr3_ras_n <= 1'b0; ddr3_cas_n <= 1'b0; ddr3_we_n <= 1'b0; write_counter <= write_counter + 32'd1; end end // 简单的读操作示例，实际应用会更复杂 always @(posedge clk or posedge rst) begin if (rst) begin read_en <= 1'b0; end else if (write_counter > 32'd100) begin // 假设写了 100 个数据后开始读 read_en <= 1'b1; if (ddr3_rdata_valid) begin data_out <= ddr3_rdata[31:0]; end end end endmodule

这段代码主要实现了对 DDR3 的控制，首先通过 MIG 实例化一个 DDR3 控制器。在写操作部分，当writeen信号有效时，将输入数据datain写入 DDR3 中，同时更新写地址writecounter。读操作则是在写了一定数量的数据后，使能readen信号，并在数据有效时读取ddr3rdata到dataout。当然，实际工程中的 DDR3 操作会涉及更多复杂的状态机管理、突发传输等优化。

XDMA 数据传输代码（以 Linux 驱动为例，简化的 C 代码）

在主机端，通过 Linux 驱动与 XDMA 交互来传输数据。以下是一个简单的读写函数示例：

#include <linux/module.h> #include <linux/pci.h> #include <linux/mm.h> #include <linux/dma-mapping.h> #define XDMA_DEVICE_ID 0x1000 // 假设的 XDMA 设备 ID struct xdma_dev { struct pci_dev *pdev; dma_addr_t dma_handle; void *dma_buffer; }; static int xdma_probe(struct pci_dev *pdev, const struct pci_device_id *id) { struct xdma_dev *dev; int ret; dev = devm_kzalloc(&pdev->dev, sizeof(struct xdma_dev), GFP_KERNEL); if (!dev) { return -ENOMEM; } dev->pdev = pdev; pci_set_drvdata(pdev, dev); // 分配 DMA 缓冲区 dev->dma_buffer = devm_dma_alloc_coherent(&pdev->dev, 4096, &dev->dma_handle, GFP_KERNEL); if (!dev->dma_buffer) { return -ENOMEM; } // 这里省略更多初始化操作 return 0; } static void xdma_remove(struct pci_dev *pdev) { struct xdma_dev *dev = pci_get_drvdata(pdev); if (dev) { devm_dma_free_coherent(&pdev->dev, 4096, dev->dma_buffer, dev->dma_handle); } } static const struct pci_device_id xdma_pci_tbl[] = { { PCI_DEVICE(XILINX_VENDOR_ID, XDMA_DEVICE_ID) }, { 0, } }; MODULE_DEVICE_TABLE(pci, xdma_pci_tbl); static struct pci_driver xdma_driver = { .name = "xdma_driver", .id_table = xdma_pci_tbl, .probe = xdma_probe, .remove = xdma_remove, }; module_pci_driver(xdma_driver); MODULE_LICENSE("GPL");

这段代码是一个简单的 Linux 内核驱动框架，用于探测 XDMA 设备并分配 DMA 缓冲区。xdmaprobe函数负责设备探测成功后的初始化工作，包括分配内存和 DMA 缓冲区。xdmaremove函数则在设备移除时释放相关资源。实际的驱动还需要实现数据的读写操作，通过与 XDMA 的寄存器交互来触发数据传输。

QT 上位机软件

QT 上位机软件为用户提供了一个直观的界面来监控和管理 ADC 数据采集。它可以通过 PCIe 驱动接口与 FPGA 进行通信，实现数据的实时显示、存储等功能。例如，利用 QT 的图形绘制功能，可以将采集到的 ADC 数据绘制成波形图，方便用户直观地观察数据特征。

#include <QApplication> #include <QMainWindow> #include <QLabel> #include <QVBoxLayout> class MainWindow : public QMainWindow { Q_OBJECT public: MainWindow(QWidget *parent = nullptr); private slots: void updateDataDisplay(); private: QLabel *dataLabel; }; MainWindow::MainWindow(QWidget *parent) : QMainWindow(parent) { dataLabel = new QLabel("等待数据..."); QVBoxLayout *layout = new QVBoxLayout; layout->addWidget(dataLabel); QWidget *centralWidget = new QWidget(this); centralWidget->setLayout(layout); setCentralWidget(centralWidget); // 这里假设通过某种方式与 PCIe 驱动建立连接并定时获取数据 QTimer *timer = new QTimer(this); connect(timer, SIGNAL(timeout()), this, SLOT(updateDataDisplay())); timer->start(1000); // 每秒更新一次数据显示 } void MainWindow::updateDataDisplay() { // 这里添加从 PCIe 读取数据并更新显示的代码 // 例如假设读取到一个整数数据 int data = getAdcDataFromPcie(); dataLabel->setText(QString("当前 ADC 数据: %1").arg(data)); } int main(int argc, char *argv[]) { QApplication a(argc, argv); MainWindow w; w.show(); return a.exec(); }

这段 QT 代码创建了一个简单的主窗口，通过定时器每秒调用updateDataDisplay函数来更新 ADC 数据的显示。实际应用中，getAdcDataFromPcie函数需要通过与内核驱动交互来获取真实的 ADC 数据。

工程源码与总结

整个项目包括 FPGA 端的工程源码、Linux 驱动源码以及 QT 上位机软件源码，它们协同工作实现了从 ADC 采集数据，经过 FPGA 缓存与处理，通过 PCIe 高速传输到 PC，并在上位机软件中进行显示与管理的完整流程。这种方案在高速数据采集、信号处理等领域具有极高的实用价值，无论是科研项目还是工业应用都能派上大用场。希望大家能从这个分享中获得启发，在自己的项目中灵活运用这些技术。

感兴趣的朋友可以在评论区留言，后续有机会我可以分享更多关于工程源码的细节以及如何进行项目搭建与调试哦。

以上代码只是为了帮助理解核心功能而进行的简化示例，实际工程中需要根据具体需求和硬件平台进行更详细的设计与优化。

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http://www.jsqmd.com/news/114238/