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HNU-电路电子学-实战第16讲（2021级）-卡诺图化简与异或门应用实例

news 2026/3/27 3:58:25

1. 卡诺图化简：从真值表到最简逻辑表达式

第一次接触卡诺图时，我也觉得这个像棋盘一样的表格有点神秘。但用了几次后发现，它其实是化简逻辑函数的"神器"。想象你手里有一张真值表，上面密密麻麻写满了0和1，卡诺图就是帮你把这些混乱的逻辑关系整理成简洁表达式的工具。

具体怎么操作呢？我们用一个实际案例来说明。假设要设计一个3人投票电路，当多数人（≥2人）投赞成票时输出1。真值表会有8种输入组合（2³=8），传统代数化简可能要写满一页纸。但用卡诺图，只需要三步：

把真值表转换成4x2的格子图，每个格子对应一组输入组合
把输出为1的格子标记出来
用最少的矩形框覆盖所有标记的1，每个框对应一个乘积项

实际操作中我发现，画框时有几个技巧特别实用：

框要尽量大（覆盖更多1）
数量要尽量少
可以跨边界（想象卡诺图是环形展开的）
不要遗漏任何孤立的1

// 化简后的Verilog表达式示例 assign output = (A&B)|(A&C)|(B&C);

这个案例中，原本需要7个与门和3个或门的电路，化简后只需要3个与门和1个或门。我在实验室实测过，器件减少后电路稳定性明显提升，布线也简单多了。

2. 异或门的隐藏技能：不只是做加法器

教科书里总说异或门是加法器的核心，但它的本事可不止这些。我调试电路时发现，异或门至少有三大实用场景：

2.1 奇偶校验的利器

数据传输最怕出错，用异或门做奇偶校验既简单又可靠。具体做法是把所有数据位依次异或：

偶数个1输出0
奇数个1输出1

// 4位奇偶校验电路 assign parity = data[0] ^ data[1] ^ data[2] ^ data[3];

去年做课程设计时，我用这个方案实现了串口通信校验，实测误码率比软件校验低两个数量级。

2.2 密码锁的核心元件

设计电子密码锁时，异或门的特性特别好用。比如要实现"输入1101时开锁"的功能：

用拨码开关设置密钥（比如1010）
输入码与密钥异或
结果为0111时触发开锁

// 简易密码锁核心逻辑 assign unlock = (input_code ^ 4'b1010) == 4'b0111;

这个方案的妙处在于：不知道密钥的人，即使看到电路板也猜不出正确密码。

2.3 信号切换的电子开关

在示波器探头校准电路里，异或门可以当可控反相器用：

控制端为0时，输出与输入相同
控制端为1时，输出与输入相反

这个特性在信号路由设计中特别实用，我用它实现过双通道示波器的自动切换功能。

3. 实战案例：从问题到电路的完整设计流程

去年带学生做智能门禁系统时，我们完整走了一遍设计流程，这里分享关键步骤：

3.1 需求分析阶段

客户提出三个要求：

三人投票，多数决
管理员有一票否决权
有防拆报警功能

我们先用自然语言转化为逻辑条件：

输出= (普通用户投票≥2) & ~管理员否决
报警= 防拆传感器触发

3.2 卡诺图化简过程

以投票逻辑为例：

列出真值表（4输入：A,B,C,admin）
画出4变量卡诺图
找到最优覆盖方案

这里有个易错点：管理员否决时要忽略投票结果，所以对应区域全部填0。我见过有学生漏掉这个约束，导致化简错误。

3.3 电路实现方案

最终采用两级结构：

第一级用与或门实现投票逻辑
第二级用异或门做状态指示（绿灯/红灯）

module access_control( input A,B,C,admin, input tamper, output reg access, output alarm ); // 投票逻辑 wire vote_pass = (A&B)|(A&C)|(B&C); assign access = vote_pass & ~admin; // 报警逻辑 assign alarm = tamper; // 状态指示（扩展功能） wire status = access ^ alarm; endmodule

实测发现用异或门做状态指示有个好处：当报警触发时，无论门禁状态如何，指示灯都会变成特殊闪烁模式——这是利用异或门的非线性特性实现的。