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i.MX23嵌入式开发：时钟与中断系统深度解析与实战配置

news 2026/6/22 17:46:55

1. 项目概述与核心价值

如果你正在基于i.MX23这颗经典的ARM9处理器进行嵌入式开发，尤其是在设计需要精确时序控制或高实时性响应的系统时，那么深入理解其时钟与中断子系统，就不再是“锦上添花”，而是“雪中送炭”的硬核技能。我接触过不少项目，初期因为对这两个模块的配置一知半解，导致系统要么功耗居高不下，要么在关键时刻响应迟缓，甚至出现难以复现的随机性故障。今天，我就结合手册和实际踩过的坑，把i.MX23的时钟控制与中断管理这两块硬骨头拆开揉碎了讲清楚。

简单来说，时钟系统是芯片的“心跳”，它决定了CPU、内存、各个外设跑得多快，直接关联着性能与功耗的平衡。而中断系统则是芯片的“神经系统”，负责及时响应内外部的各种事件，是保证系统实时性的基石。在i.MX23上，这两者通过精密的硬件寄存器协同工作，提供了从基础的频率设定到复杂的中断嵌套等一系列可编程能力。掌握它们，意味着你能从“芯片能干什么”的层面，进阶到“让芯片按我设计的方式高效、可靠地工作”的层面。无论是想实现极致的低功耗休眠唤醒，还是构建一个毫秒级响应的实时控制核心，都离不开对这两个模块的精准操控。接下来，我们就从设计思路开始，一步步拆解。

2. 时钟系统整体设计与核心思路拆解

i.MX23的时钟生成单元（Clock Controller Module, CCM）其设计哲学非常清晰：以外部晶振（XTAL）为源头，通过锁相环（PLL）进行倍频，再经由一系列分频器、多路选择器和门控电路，为芯片内部数十个功能模块提供量身定制的时钟信号。这种架构的核心目的是在单一外部时钟源下，实现灵活、精细的时钟域划分与功耗管理。

2.1 时钟树概览与设计考量

虽然手册没有给出完整的时钟树图，但通过分析寄存器，我们可以勾勒出其主干。外部晶振（如24MHz）作为参考时钟ref_xtal输入。芯片内部至少包含一个核心PLL（从HW_CLKCTRL_FRAC1寄存器看，存在一个432 MHz的PLL，推测为视频PLLref_vid）和多个分频PLL（如ref_cpu,ref_emi,ref_io,ref_pix等），用于生成不同频率域的基础时钟。

为什么需要这么多时钟域？这是嵌入式系统低功耗设计的精髓。并非所有模块在任何时候都需要全速运行。例如，当CPU处于空闲状态执行WFI（Wait For Interrupt）时，其时钟可以被大幅降低甚至暂停；而负责刷新的LCD控制器（PIX域）或处理音频的SAIF模块则需要保持特定、稳定的频率。i.MX23通过HW_CLKCTRL_CLKSEQ等寄存器提供的“旁路（Bypass）”选择功能，允许每个主要的时钟域（如CPU、EMI、PIX等）独立选择其时钟源是来自经过PLL和分频器处理的ref_*路径，还是直接使用原始的ref_xtal。在系统初始化早期或低功耗模式下，让模块运行在低频的晶振时钟下，可以显著节省功耗。

2.2 分数分频器：精度与灵活性的关键

传统整数分频器只能产生输入时钟频率除以整数的时钟，灵活性受限。i.MX23引入了9相位分数分频器，这是其时钟系统的亮点之一，由HW_CLKCTRL_FRAC和HW_CLKCTRL_FRAC1等寄存器控制。

它的原理可以通俗地理解为：在一个时钟周期内，分频器有9个均匀间隔的相位输出点。通过编程CPUFRAC等字段（值1-35），可以控制每多少个“相位步进”输出一个时钟脉冲。计算公式为：输出频率 = 480 * (18 / CPUFRAC) MHz。例如，当CPUFRAC=18时，输出为480MHz；当CPUFRAC=36（虽然手册上限是35，此处为举例）时，理论输出为240MHz。但实际上，通过选择1-35之间的非18整数倍的数值，就可以产生非整数关系的分频，从而更精细地调节频率。

这里有一个非常重要的实操细节：手册中HW_CLKCTRL_FRAC和HW_CLKCTRL_FRAC1寄存器里都有一个*_STABLE位（如CPU_STABLE,VID_STABLE）。手册明确标注这是“仅用于诊断”，因为分数分频器稳定得非常快。但在实际编程中，强烈建议你在修改分数分频器的值后，加入一个等待稳定的循环或延迟。虽然可能99%的情况不需要，但那1%的不稳定若发生在产品中，就是难以调试的灾难。你可以读取该位，等待其翻转，但更简单可靠的做法是插入一个几十微秒的软件延时（例如执行一个空循环），这比依赖一个“理论上很快”的硬件状态要稳妥得多。

2.3 时钟控制寄存器的操作范式

i.MX23的寄存器编程通常遵循一套清晰的硬件抽象层（HAL）风格，这在手册的示例代码中也有体现。每个功能寄存器通常对应四个物理地址：

  • HW_XXX_WR: 直接写入寄存器值。
  • HW_XXX_SET: 将写入数据的对应bit置1（Set）。
  • HW_XXX_CLR: 将写入数据的对应bit清0（Clear）。
  • HW_XXX_TOG: 将写入数据的对应bit翻转（Toggle）。

这种设计极大方便了位操作。例如，你想在不影响其他位的情况下，开启CPU时钟域的PLL旁路（即设置HW_CLKCTRL_CLKSEQ[BYPASS_CPU] = 1），安全的做法是：

// 使用SET操作，仅将BYPASS_CPU位设为1 HW_CLKCTRL_CLKSEQ_SET(BM_CLKCTRL_CLKSEQ_BYPASS_CPU);

而不是直接写入整个寄存器，那样可能会意外修改其他位。在操作时钟和中断这类关键寄存器时，务必使用SET/CLR/TOG这类原子性位操作，或者采用“读-修改-写”（RMW）模式，这是避免系统运行时出现瞬时错误配置的黄金法则。

3. 中断收集器（ICOLL）架构与优先级管理

如果说时钟是心跳，那么i.MX23的中断收集器（Interrupt Collector, ICOLL）就是高度智能的中枢神经。它统一管理多达128个中断源，并将其仲裁后提交给ARM9内核的IRQ或FIQ线。其设计巧妙之处在于硬件支持的4级优先级嵌套，这对于复杂的实时系统至关重要。

3.1 中断处理流程与状态机

ICOLL内部有一个精细的状态机（FSM），其工作流程可以概括为：

  1. 采样与保持：所有中断源信号被持续采样到一个“保持寄存器”（Holding Register）中。
  2. 仲裁与向量计算：当有中断发生时，FSM会“关闭”保持寄存器（停止采样新中断），然后对当前捕捉到的中断进行仲裁。首先，找出所有已发生中断中优先级（PRIORITY，0-3级，3最高）最高的那个级别。然后，在该级别内，按照中断源编号（0-127）从低到高的线性优先级，选出最终获胜的中断源。
  3. 生成向量地址：根据获胜的中断源编号（Source Bit Number）和预先设置的向量基地址（HW_ICOLL_VBASE）、向量间距（HW_ICOLL_CTRL[VECTOR_PITCH]），计算出该中断的服务程序入口地址：VectorAddress = VectorBase + (Pitch * SourceBitNumber)。这个地址会被放入HW_ICOLL_VECTOR寄存器。
  4. 触发CPU中断：ICOLL向ARM9的IRQ线发出信号。
  5. CPU响应与反馈：CPU跳转到IRQ异常向量（通常是0x00000018或0xFFFF0018），执行那里的指令（通常是LDR PC, [PC, #-0xFF0]或类似，以读取HW_ICOLL_VECTOR中的地址并跳转）。关键一步：在中断服务程序（ISR）开始时，CPU必须通过写入HW_ICOLL_VECTOR寄存器（任何值均可）或读取该寄存器（如果使能了ARM_RSE_MODE），来通知ICOLL：“我已开始服务此中断”。这个操作会清除当前中断在ICOLL内部的请求状态，并让FSM重新“打开”保持寄存器，开始采样新的、更高优先级的中断，从而实现嵌套。

3.2 中断嵌套的机制与风险点

嵌套是实时系统的核心需求。假设一个低优先级（Level 1）的UART接收中断正在服务中，此时一个高优先级（Level 3）的定时器中断发生。由于Level 3 > Level 1，ICOLL会立即向CPU发出新的IRQ请求。

这里存在一个经典的“竞态条件”（Race Condition）陷阱，手册在5.2.1节用“WARNING”专门强调了。流程是这样的：低优先级ISR在完成关键操作后，会重新使能CPU的IRQ（通过CPSIE I指令），允许嵌套。紧接着，它需要写入HW_ICOLL_LEVELACK来告知ICOLL本级别中断服务完成。问题在于，从CPU执行“写LEVELACK”指令，到该写操作经过总线、桥接最终到达ICOLL硬件并生效，需要数个时钟周期。如果在这几个周期内，CPU的IRQ已经使能，而ICOLL还未及时撤销对CPU的IRQ信号（因为还没收到ACK），CPU就会错误地认为又来了一个IRQ，导致异常。

解决方案有两种，务必二选一：

  1. 推荐方法（利用ARM侧效应）：设置HW_ICOLL_CTRL[ARM_RSE_MODE] = 1。在此模式下，CPU在IRQ异常向量处读取HW_ICOLL_VECTOR寄存器以获取跳转地址的这个动作本身，就会被硬件视为“中断服务开始”的通知。这样，通知操作与取址操作合二为一，天然是原子的，完美规避了竞态条件。
  2. 传统方法（软件序列保障）：如果未使用RSE模式，则必须在ISR中遵循严格序列：先读取一次HW_ICOLL_CTRL（读到的值无关紧要），这个读操作会确保之前所有写操作（包括使能IRQ的指令）都已完成并传递到总线上，然后再执行其他操作。这相当于一个内存屏障（Memory Barrier）的软件实现。

3.3 FIQ（快速中断）的配置与使用建议

FIQ是ARM架构中比IRQ更快速、延迟更低的中断。i.MX23允许任何中断源被配置为FIQ（通过设置HW_ICOLL_INTERRUPTn[ENFIQ]位）。一旦配置为FIQ，该中断将不再产生IRQ。

FIQ的使用有重要限制和最佳实践：

  • 无硬件向量化：所有FIQ共享同一个异常向量（0x0000001C或0xFFFF001C）。这意味着如果你的系统配置了多个FIQ，必须在唯一的FIQ服务程序中，通过查询HW_ICOLL_RAW0-3等原始中断状态寄存器来区分是哪个中断源触发的。
  • 建议用途：手册明确建议将时间要求极端苛刻或关乎系统安全的事件配置为FIQ，例如：
    • 电源模块的欠压检测（BATT_BRNOUT,VDDD_BRNOUT等）。
    • 系统定时器（TIMER0-TIMER3）。
    • 5V电源跌落检测（VDD5V_DROOP）。
  • 优先级：FIQ本身在ICOLL内没有优先级分级。如果使能了多个FIQ，需要软件自行判断和处理优先级。

4. 关键寄存器配置详解与实操步骤

理解了原理，我们进入实战环节。下面我会选取几个最具代表性的寄存器，详细说明其配置方法和注意事项。

4.1 时钟配置实战：以CPU频率动态切换为例

假设我们的系统需要在高性能模式和低功耗模式间动态切换CPU频率。基础外部晶振为24MHz，通过PLL倍频后得到ref_cpu时钟，再经分数分频得到CPU时钟。

步骤1：配置PLL与分数分频器首先，需要确保PLL已经锁定并输出稳定的频率。这部分涉及PLL控制寄存器（手册其他章节），此处假设ref_cpuPLL已配置为输出480MHz。 然后，配置分数分频器。假设我们需要将CPU频率设为360MHz。 根据公式：CPU频率 = 480 * (18 / CPUFRAC) MHz。 计算CPUFRAC：CPUFRAC = (480 * 18) / 360 = 24。 检查CPUFRAC范围（1-35），24在有效范围内。

// 1. 可选：等待当前分频器稳定（诊断位，实际可简化） // while (HW_CLKCTRL_FRAC_RD() & BM_CLKCTRL_FRAC_CPU_STABLE) {} // 等待为0或1，取决于初始状态 // 2. 写入新的分频值 HW_CLKCTRL_FRAC_WR(BF_CLKCTRL_FRAC_CPUFRAC(24)); // 3. 强烈建议：插入稳定延时。可以是一个简单的循环，或者调用微秒级延时函数。 // 例如，执行一定数量的NOP指令或忙等待循环。 for (volatile int i = 0; i < 1000; i++); // 粗略延时，实际时间需校准 // 4. 可选：再次检查稳定位（用于调试） // while (!(HW_CLKCTRL_FRAC_RD() & BM_CLKCTRL_FRAC_CPU_STABLE)) {} // 等待翻转

步骤2：切换时钟源（如果需要旁路PLL）在系统深度休眠前，我们可能想让CPU直接跑在低速的晶振时钟上。

// 将CPU时钟域切换到旁路模式（直接使用ref_xtal） HW_CLKCTRL_CLKSEQ_SET(BM_CLKCTRL_CLKSEQ_BYPASS_CPU); // 注意：手册提到，当清除BYPASS位（即切回PLL路径）时，必须确保PLL和分数分频器已配置好。

步骤3：软件复位与时钟门控HW_CLKCTRL_RESET寄存器用于触发芯片的软复位。这里有一个至关重要的警告：手册在5.3节和HW_CLKCTRL_RESET描述中明确指出，绝对不要同时设置SFTRST（软复位）和CLKGATE（时钟门控）位。因为设置SFTRST后，硬件会自动在几个周期后设置CLKGATE。如果软件同时设置，可能导致复位逻辑失效。正确的操作顺序是：

// 正确的软复位操作 HW_CLKCTRL_RESET_SET(BM_CLKCTRL_RESET_CHIP); // 仅设置复位位 // 硬件会自动处理后续的时钟门控和复位释放 // 软件只需等待复位完成即可

4.2 中断系统初始化与一个中断源的配置

我们以配置GPIO0中断（中断源16）为例，展示完整的流程。

步骤1：ICOLL控制器全局初始化

// 1. 解除ICOLL模块的软复位和时钟门控 HW_ICOLL_CTRL_CLR(BM_ICOLL_CTRL_SFTRST | BM_ICOLL_CTRL_CLKGATE); // 2. 配置全局参数：使能IRQ/FIQ输出，设置向量表基地址和间距 // 假设我们的中断向量表在内存地址0x80000000 HW_ICOLL_VBASE_WR(0x80000000); // 向量间距设为4字节（一个字），这是最常见配置，每个中断入口是一条跳转指令 HW_ICOLL_CTRL_WR(BF_ICOLL_CTRL_VECTOR_PITCH(0) | // 0表示4字节间距 BM_ICOLL_CTRL_IRQ_FINAL_ENABLE | BM_ICOLL_CTRL_FIQ_FINAL_ENABLE); // 3. 选择中断通知模式。推荐使用ARM RSE模式以避免竞态条件。 HW_ICOLL_CTRL_SET(BM_ICOLL_CTRL_ARM_RSE_MODE);

步骤2：配置特定中断源（GPIO0）

// 中断源16对应HW_ICOLL_INTERRUPT16寄存器 // 假设其基地址为ICOLL_BASE，偏移量INTERRUPTn = 0x100 + (n * 0x10) #define ICOLL_INTERRUPT16_ADDR (ICOLL_BASE + 0x100 + 16*0x10) // 实际开发中，应使用芯片厂商提供的SDK中的定义，如HW_ICOLL_INTERRUPT16 // 配置步骤（使用RMW或SET/CLR操作）： // 1. 设置优先级，例如设为2（共0-3级，3最高） // 2. 使能中断（ENABLE = 1） // 3. 不使能FIQ（ENFIQ = 0，使用IRQ） // 4. 清除可能的软件中断标志（SOFTIRQ = 0） uint32_t reg_value = 0; reg_value |= BF_ICOLL_INTERRUPT16_PRIORITY(2); // 优先级字段位置需查手册 reg_value |= BM_ICOLL_INTERRUPT16_ENABLE; reg_value &= ~BM_ICOLL_INTERRUPT16_ENFIQ; reg_value &= ~BM_ICOLL_INTERRUPT16_SOFTIRQ; HW_ICOLL_INTERRUPT16_WR(reg_value);

步骤3：编写中断服务程序（ISR）与向量表在向量表地址（VBASE + 16 * 4）处放置跳转指令，指向你的GPIO0_ISR函数。 在GPIO0_ISR函数中：

void GPIO0_ISR(void) __attribute__((interrupt("IRQ"))); void GPIO0_ISR(void) { // 1. 现场保护（编译器属性可能已处理部分，但通常需手动保存R0-R3, R12, LR） // 2. 清除GPIO中断挂起标志（在GPIO模块中操作） // 3. 处理中断任务... // 4. 中断结束处理： // 如果使用ARM_RSE_MODE，则无需额外操作（因为读VECTOR时已通知ICOLL）。 // 否则，需要先写VECTOR寄存器（通知开始），在ISR末尾写LEVELACK。 // 5. 现场恢复 }

注意：如果使能了ARM_RSE_MODE，在IRQ异常向量处的指令必须是LDR PC, [PC, #offset]这种直接读取HW_ICOLL_VECTOR内存地址的指令，这样才能触发读侧效应通知ICOLL。

4.3 低功耗模式：CPU Wait-for-Interrupt (WFI) 配置

WFI模式是让CPU核心睡眠等待中断唤醒的有效节能手段。i.MX23的实现需要软硬件协同。

步骤1：使能WFI功能

// 这是一个读-修改-写（RMW）操作，确保不干扰其他位 uint32_t ctrl = HW_CLKCTRL_CPUCLKCTRL_RD(); ctrl |= BM_CLKCTRL_CPUCLKCTRL_INTERRUPT_WAIT; HW_CLKCTRL_CPUCLKCTRL_WR(ctrl); // 建议在系统初始化时设置一次，之后保持开启。

步骤2：执行WFI指令序列在需要进入低功耗的代码位置：

__asm volatile ( "mov r0, #0\n\t" // 将0写入R0（或任何通用寄存器） "mcr p15, 0, r0, c7, c0, 4\n\t" // 执行MCR指令，使CPU进入等待中断状态 "nop" // 中断返回后，将从这里继续执行 );

关键点：

  • 执行mcr p15, 0, Rd, c7, c0, 4指令后，CPU时钟会停止，处理器暂停于此指令。
  • 当任何一个已使能的中断（无论是IRQ还是FIQ）发生时，CPU被唤醒，完成该MCR指令的执行，然后跳转到对应的中断处理程序。
  • 中断返回后，程序会从MCR指令后的下一条指令（即nop）继续执行，因为硬件自动调整了返回地址（LR）。
  • 唤醒条件：是“所有已使能中断的或（OR）”，由ICOLL的ICOLL_BUSY信号直接通知时钟控制器，不经过复杂的ICOLL状态机，因此唤醒延迟极低。

5. 常见问题排查与调试技巧实录

在实际开发中，时钟和中断问题往往最令人头疼。下面是我总结的一些典型问题及其排查思路。

5.1 时钟问题排查表

问题现象可能原因排查步骤与解决方法
系统无法启动，或启动后卡死1. 核心PLL未锁定或配置错误。
2. 时钟切换（BYPASS）时序错误。
3. 分数分频器处于不稳定状态。		1.检查PLL状态：读取PLL的LOCK状态位，确保PLL已锁定。确认输入参考时钟频率和环路滤波参数配置正确。
2.检查切换顺序：从旁路模式（BYPASS=1）切换回PLL路径（BYPASS=0）前，必须确保目标PLL和分频器已配置完成且稳定。建议流程：配置PLL -> 等待锁定 -> 配置分频器 -> 短暂延时 -> 清除BYPASS位。
3.增加稳定延时：在修改HW_CLKCTRL_FRAC后，增加一个保守的软件延时（如100us），再执行后续依赖新时钟的操作。
外设工作频率不正确1. 该外设所属时钟域的分频比计算错误。
2. 时钟门控未打开。
3. 错误地使用了旁路模式。		1.验算分频比：根据ref_*源频率、分数分频值、可能存在的后续整数分频器，重新计算最终频率。使用示波器或频率计数器测量实际时钟引脚（如果可用）。
2.检查CLKGATE：确保对应模块的时钟门控位已被清除（CLKGATE=0）。很多外设模块都有自己的CLKGATE控制位。
3.确认BYPASS设置：检查HW_CLKCTRL_CLKSEQ中对应外设（如SSP、GPMI）的BYPASS_*位，确认时钟源是否符合预期。
系统功耗高于预期1. 未使用的时钟域未关闭。
2. CPU未进入WFI/睡眠模式。
3. 外设时钟在空闲时未门控。		1.关闭闲置时钟：遍历所有时钟控制寄存器，将不使用的PLL、分数分频器的CLKGATE置位。关闭不用的外设时钟。
2.验证WFI：确保INTERRUPT_WAIT位已设置，并且CPU执行了WFI指令。可以通过测量CPU电源电流或观察核心时钟活动信号来验证。
3.动态门控：在驱动程序中，实现外设“打开-使用-关闭”的范式，及时门控时钟。

5.2 中断问题排查表

问题现象可能原因排查步骤与解决方法
中断完全不触发1. ICOLL全局使能未打开。
2. 特定中断源未使能（ENABLE=0）。
3. 中断源本身未产生请求。
4. CPU的CPSR中I位未清除（中断未使能）。		1.检查ICOLL全局控制：确认HW_ICOLL_CTRL中的IRQ_FINAL_ENABLE或FIQ_FINAL_ENABLE已置1。
2.检查中断源配置：读取对应的HW_ICOLL_INTERRUPTn寄存器，确认ENABLE=1，且ENFIQ配置符合预期（IRQ/FIQ）。
3.检查外设中断：确认外设模块自身的中断使能位已设置，并且中断条件已发生（如GPIO电平变化、UART收到数据）。可以读取HW_ICOLL_RAW0-3寄存器查看原始中断状态。
4.检查ARM核心：在启动代码或主循环中，确保使用CPSIE I指令清除了CPSR的I位（使能IRQ）。对于FIQ，还需要清除F位。
中断触发一次后不再触发1. 中断服务程序（ISR）未清除外设的中断挂起标志。
2. ICOLL的“中断服务中”状态未正确通知/退出。
3. 中断优先级和嵌套导致低优先级中断被屏蔽。		1.清除外设标志：这是最常见原因。ISR内必须在处理完事务后，清除触发该中断的外设状态位（如GPIO的PINn位，UART的RXIF位）。
2.检查ICOLL通知：如果未使用ARM_RSE_MODE，确保ISR开头写入了HW_ICOLL_VECTOR寄存器。在ISR末尾，需要写入HW_ICOLL_LEVELACK寄存器，并传入正确的优先级级别值（如0x1、0x2、0x4、0x8）。
3.检查嵌套配置：如果高优先级ISR长时间运行且未退出，低优先级中断将无法被响应。检查HW_ICOLL_CTRL[NO_NESTING]位，以及各中断的优先级设置。
中断响应速度慢，或偶尔丢失中断1. ISR执行时间过长，期间中断被全局关闭。
2. 多个中断同时发生，线性优先级导致低编号中断饿死。
3. 竞态条件导致ICOLL状态机异常。		1.优化ISR：遵循“快进快出”原则，ISR只做最紧急的处理（如读取数据、清除标志），将非实时任务推送到主循环或任务队列中。
2.合理分配优先级：对实时性要求最高的中断，赋予最高的优先级（3）。对于可能频繁发生的中断，确保其ISR足够短。注意，同一优先级内，中断号小的优先，要避免低编号的慢ISR阻塞高编号的紧急中断。
3.消除竞态：如前所述，务必使用ARM_RSE_MODE或在ISR中正确使用读写序列屏障。
FIQ无法正常工作1.FIQ_FINAL_ENABLE未开启。
2. 多个FIQ源在服务程序中未正确区分。
3. ARM核心的F位未清除。		1.检查全局使能：确认HW_ICOLL_CTRL[FIQ_FINAL_ENABLE]=1。
2.实现FIQ分发：在FIQ服务程序中，必须读取HW_ICOLL_RAW0-3或HW_ICOLL_INTERRUPTn[ENFIQ]结合状态寄存器，来确定是哪个中断源触发的FIQ，并跳转到对应的处理例程。
3.检查CPSR：使用CPSIE F指令确保CPU的FIQ是使能状态。

5.3 调试技巧与心得

  1. 利用SOFTIRQ进行软件触发：每个中断源都有一个SOFTIRQ位。在调试初期，你可以不依赖真实的外设事件，直接在代码中设置HW_ICOLL_INTERRUPTn[SOFTIRQ]=1来模拟中断触发。这是验证你的中断配置、向量表、ISR流程是否正确的绝佳方法。
  2. 善用状态寄存器：HW_CLKCTRL_STATUS可以告诉你CPU频率是否被硬件限速（例如由于温升）。HW_ICOLL_VECTOR的当前值反映了正在服务或等待服务的中断源编号。在调试复杂的中断嵌套问题时，打印或记录这些寄存器值非常有帮助。
  3. “BYPASS_FSM”测试模式：HW_ICOLL_CTRL[BYPASS_FSM]位用于绕过状态机。在这个模式下，向量地址寄存器会实时反映所有已使能的中断请求，而不需要CPU的握手。仅在实验室调试时使用此模式，可以帮助你直观地看到中断信号的产生与消失，理解ICOLL的原始行为。在产品代码中务必关闭此模式。
  4. 版本寄存器：HW_CLKCTRL_VERSION和芯片的其他版本寄存器能告诉你硅片版本。某些时钟或中断相关的勘误（Errata）可能只存在于特定版本的芯片中，查阅芯片勘误表是解决疑难杂症的必要步骤。
http://www.jsqmd.com/news/1062623/

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