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RFSoC xcku5p 中的 CMAC 及 GTY

news 2026/7/19 3:07:36

关于 AMD XCKU5P FPGA 中 CMAC 硬核与 GTY 的关系及内部结构，核心信息如下：

简而言之：CMAC 是一个实现 100G 以太网协议栈的“硬核”IP，而 GTY 是物理层的高速串行收发器。CMAC 必须通过 GTY 才能与外部世界通信。

CMAC 是“大脑”：它负责处理复杂的 100G 以太网协议（如 PCS/PMA 子层），将并行数据打包成特定格式，并管理链路训练、自动协商等。
GTY 是“手脚”：它们是物理层的 SerDes（串行器/解串器），负责将 CMAC 处理好的并行数据，以高达32.75Gb/s的超高速率串行化后通过差分引脚发送出去，或进行逆向接收。

在 XCKU5P 上的具体细节：

资源数量：XCKU5P 器件内部集成了1 个 CMAC 硬核和16 个 GTY 收发器（以 4 个为一组，称为 Quad）。
物理约束：CMAC 硬核在芯片内部有固定的物理位置，它只能驱动与其位置相邻的特定 GTY Quad。在进行 FPGA 设计时，必须确保将 PCB 上对应的高速接口（如 QSFP 光模块）连接到这个特定的 GTY Quad 上，否则 CMAC 将无法使用。

CMAC 硬核：
- 协议处理层：内置了完整的 100G 以太网 MAC 和 PCS 子层，支持 CAUI-4、CAUI-10 等多种接口模式。
- 用户接口：对外提供标准的AXI4-Stream数据总线接口，方便与用户逻辑（如网络协议栈、DMA 模块）连接。
GTY 收发器（Quad 架构）：
- Quad 结构：每 4 个 GTY 组成一个 Quad，共享一个高性能的Quad PLL (QPLL)作为时钟源。
- 收发器内部：每个 GTY 包含独立的发送器（并转串，带预加重/均衡）和接收器（串转并，带自适应均衡），以应对高速信号在 PCB 或光缆上的传输损耗。

资源有限：XCKU5P 只有一个 CMAC 硬核，若需要多个 100G 接口，只能使用付费的“软核”IP，这会消耗大量 FPGA 逻辑资源。
工具配置：在 Vivado 中使用 “UltraScale+ 100G Ethernet Subsystem” IP 核时，必须在“CMAC/GT Selections and Configuration”选项卡中，正确指定 CMAC 核和 GTY Quad 的物理位置。

是的，你提到的 AMD RFSoC 4x2 芯片（属于 Zynq UltraScale+ RFSoC 系列）中同时包含 CMAC 硬核和 GTY 收发器。

它们各自的情况和关系如下：

CMAC 硬核：存在。Zynq UltraScale+ RFSoC 系列集成了 CMAC 硬核，用于实现 100G 以太网等高速协议的处理。比如，XCZU29DR 这个型号就包含一个名为CMAC_X0Y0的硬核。
GTY 收发器：存在且数量充足。该系列芯片集成了16个GTY 收发器。这些收发器最高能支持 28.21Gb/s 的线速率，是处理高速串行数据流的物理层基础。

在 RFSoC 芯片中，CMAC 与 GTY 的关系与你之前了解的 XCKU5P 是一致的：CMAC 是处理协议的“硬核大脑”，而 GTY 是实现物理连接的“高速手脚”。它们需要协同工作，共同构成一个完整的高速接口。

设计时请注意：

物理连接固定：CMAC 硬核在芯片内部有固定的物理位置，必须连接到它附近特定的 GTY Quad（通常是一组4个）上才能工作。例如，CMAC_X0Y0旁边就是GTY Quad 127。
参考资料：AMD 官方的数据手册和用户指南（如 DS926, UG1075）是查询具体器件型号、封装和 CMAC/GTY 映射关系最可靠的来源。