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深入解析MibSPI核心寄存器：SPIFMT与TGINTVECT配置与实战

news 2026/7/19 9:12:19

1. MibSPI核心配置寄存器深度解析

在嵌入式系统开发，尤其是汽车电子和工业控制领域，德州仪器（TI）的Hercules系列或C2000系列微控制器中的多缓冲串行外设接口（MibSPI）模块是一个功能强大的通信外设。它远不止于基础的SPI通信，其核心魅力在于能够预配置多种数据格式和缓冲区，实现高效、确定性的数据传输，这对于需要与多个不同配置的从设备通信或处理高实时性任务的系统至关重要。今天，我们就来深入拆解MibSPI模块中两个最核心的配置寄存器：SPIFMTx（数据格式寄存器）和TGINTVECTx（传输组中断向量寄存器）。理解它们，你才能真正玩转MibSPI，而不是仅仅停留在“配通时钟”的层面。

很多工程师在初次接触MibSPI时，面对手册里几十个寄存器往往会感到无从下手。SPIFMT寄存器定义了“数据怎么传”，而TGINTVECT寄存器则回答了“传完后怎么高效地通知CPU”。这两者配合，构成了MibSPI高效、灵活通信的基石。我将结合多年的实际项目调试经验，不仅告诉你每个比特位是什么意思，更会重点分享在什么场景下需要配置它们，配置时有哪些“坑”，以及如何通过它们优化系统性能。无论你是正在评估MibSPI用于新项目，还是在调试中遇到了棘手的通信问题，相信这篇深入解析都能给你带来实实在在的帮助。

2. SPIFMT寄存器：定义通信的“语法规则”

SPIFMT寄存器（SPI Format Register）是MibSPI的灵魂所在。你可以把它理解为通信协议的“语法生成器”。一个MibSPI模块通常有多个SPIFMT寄存器（例如SPIFMT0, SPIFMT1, SPIFMT2, SPIFMT3），每个都可以独立定义一套完整的通信参数。这意味着主设备可以用不同的“方言”与不同的从设备对话，而无需在每次通信前都重新配置SPI模块，这是实现高效多从机通信的关键。

2.1 寄存器位域全景与功能分类

首先，我们俯瞰一下SPIFMT寄存器的整体结构。以SPIFMT2为例（偏移地址58h），它是一个32位寄存器，其位域可以清晰地分为几个功能组：

比特位范围字段名功能简述配置影响
31-24WDELAY传输间延迟控制连续传输之间的空闲时间，用于满足从设备的时序恢复要求。
23PARPOL奇偶校验极性选择偶校验（0）或奇校验（1）。
22PARITYENA奇偶校验使能开启或关闭硬件奇偶校验生成与检查。
21WAITENA等待ENA信号使能主设备在开始传输前是否等待从设备的“就绪”信号。
20SHIFTDIR移位方向决定数据位传输顺序：MSB先出（0）或LSB先出（1）。
19HDUPLEX_ENA半双工模式使能将SIMO/SOMI引脚切换为半双工模式，用于单线双向通信。
18DISCSTIMERS禁用片选定时器是否绕过C2TDELAY和T2CDELAY这两个片选信号定时器。
17POLARITY时钟极性定义SPICLK在空闲时的电平状态。
16PHASE时钟相位定义数据采样相对于时钟边沿的关系。
15-8PRESCALE时钟预分频器作为主设备时，根据VBUSPCLK生成SPI通信比特率。
7-5NU保留读为0，写无效。
4-0CHARLEN字符长度定义一次传输的数据位长度，有效值为2到16位。

这个表格为我们后续的深入分析提供了一个清晰的路线图。接下来，我们将分组深入，并穿插实际配置示例和注意事项。

2.2 通信时序基石：POLARITY与PHASE详解

POLARITY和PHASE这两个位共同定义了SPI的四种标准工作模式（Mode 0, 1, 2, 3）。这是SPI通信的基石，必须与从设备严格匹配，否则数据会完全错乱。

  • POLARITY (CPOL): 时钟极性。
    • 0 (CPOL=0): 时钟空闲时为低电平。这是最常见的选择。
    • 1 (CPOL=1): 时钟空闲时为高电平。
  • PHASE (CPHA): 时钟相位。
    • 0 (CPHA=0): 数据在第一个时钟边沿采样。对于CPOL=0，即在上升沿采样；对于CPOL=1，即在下降沿采样。
    • 1 (CPHA=1): 数据在第二个时钟边沿采样。对于CPOL=0，即在下降沿采样；对于CPOL=1，即在上升沿采样。

组合起来就是：

  • Mode 0: CPOL=0, CPHA=0。空闲低电平，在上升沿采样数据。
  • Mode 1: CPOL=0, CPHA=1。空闲低电平，在下降沿采样数据。
  • Mode 2: CPOL=1, CPHA=0。空闲高电平，在下降沿采样数据。
  • Mode 3: CPOL=1, CPHA=1。空闲高电平，在上升沿采样数据。

实操心得一：模式匹配是第一步在调试任何SPI设备时，第一件事就是查阅其数据手册，确认它支持哪种SPI模式。大多数EEPROM、Flash、传感器常用Mode 0或Mode 3。如果模式配错，你用逻辑分析仪看到的波形可能“有来有回”，但读到的数据全是0xFF或0x00。一个快速验证的方法是：先尝试Mode 0和Mode 3，因为这两种模式的数据采样边沿都发生在时钟极性变化的第二个边沿，相对更通用。

重要警告：从机模式下的配置禁忌手册中特别强调了一个关键点：当MibSPI配置为从机模式时，如果需要更改PHASE或POLARITY，必须遵循特定序列。你不能在模块使能（SPIEN=1）时直接修改SPIFMTx中的这些位。正确做法是：

  1. 先将全局控制寄存器1中的SPIEN位清零（GCR1.SPIEN = 0），禁用SPI模块。
  2. 在SPIFMTx寄存器中设置新的PHASE和POLARITY值。
  3. 等待外部主设备提供的SPICLK信号的极性确实发生变化后（如果你修改了POLARITY），再将GCR1.SPIEN置1重新使能模块。 不遵守这个序列可能导致从机无法正确识别时钟边沿，通信彻底失败。在主模式下则无此限制。

2.3 数据格式核心：CHARLEN, SHIFTDIR, PRESCALE

这三位定义了数据包的基本形态和速率。

  • CHARLEN (字符长度): 这个字段定义了单次传输的比特数。合法值为0x02（2位）到0x10（16位）。注意，它存储的是实际长度值，而不是长度减1。例如，要传输8位数据，应写入0x08。写入非法值（如0x00, 0x01, 0x1F等）会产生不可预测的行为。

    • 场景举例：与一个12位ADC通信时，设置CHARLEN=0x0C；与一个16位DAC通信时，设置CHARLEN=0x10。

  • SHIFTDIR (移位方向): 决定数据移出和移入的顺序。

    • 0: 最高有效位先出/先入（MSB First）。这是绝大多数SPI设备的默认标准。
    • 1: 最低有效位先出/先入（LSB First）。某些特定器件（如某些型号的音频编解码器）可能使用此模式。
    • 避坑指南：这个配置需要与从设备匹配。如果方向配反，你发送0xAA (10101010b)，对方可能将其解释为0x55 (01010101b)。调试时，结合逻辑分析仪观察数据线上的实际比特流顺序是排查此类问题的利器。

  • PRESCALE (预分频器): 这是决定通信速率的关键。比特率计算公式为： [ BR_{Format} = \frac{VBUSPCLK}{(PRESCALE + 1)} ] 其中，VBUSPCLK是MibSPI模块的输入时钟频率。PRESCALE的有效值为0-255。

    • 特殊规则：当PRESCALE = 0时，比特率默认为 VBUSPCLK / 2。这是一个需要牢记的例外情况。
    • 计算示例：假设VBUSPCLK = 100 MHz，目标比特率 = 5 Mbps。 [ PRESCALE = \frac{VBUSPCLK}{BR_{Format}} - 1 = \frac{100 \times 10^6}{5 \times 10^6} - 1 = 20 - 1 = 19 ] 向PRESCALE字段写入19即可。
    • 重要提示：此配置仅当MibSPI作为主设备时有效。在从设备模式下，通信速率由外部主设备时钟决定，无需配置此字段。此外，对PRESCALE的写操作会联动更新扩展预分频寄存器（EXTENDED_PRESCALE）的相关字段，在需要极高精度或更低速率时需要注意。

2.4 高级功能与可靠性配置

这部分配置体现了MibSPI面向工业应用的可靠性设计。

  • PARITYENA 与 PARPOL (奇偶校验): 为SPI通信增加了一层简单的数据校验。

    • PARITYENA=1使能校验。发送端会在每个数据帧末尾自动添加一个奇偶校验位，接收端会进行验证。如果校验失败，会在状态寄存器（SPIFLG）中置位RXERR标志。
    • PARPOL决定校验类型：0为偶校验，1为奇校验。
    • 使用场景：在对数据完整性有要求，但又不想在应用层增加复杂CRC计算的场合。注意，它只能检测奇数个比特的错误。
    • 一个隐蔽的细节：手册提到，当从设备（Slave Mode MibSPI）中设置了不可纠正错误标志（Uncorrectable Error Flag）时，它会故意发送错误的奇偶校验位（违反PARPOL规则）来向主设备告警。这是一个硬件辅助的错误上报机制。

  • WAITENA (等待ENA使能): 用于支持带有“就绪”（ENA）信号线的从设备。

    • WAITENA=1时，主设备在发起传输前，会先检查SPIENA引脚是否为低电平。如果从设备未拉低ENA（或在超时计数器C2EDELAY溢出前未拉低），主设备会中止传输并置位超时错误标志。
    • 典型应用：一些慢速器件（如高精度ADC）在转换完成后，会通过一个单独的引脚通知主设备“数据已就绪，可以来读了”。WAITENA功能使得MibSPI可以优雅地处理这类异步准备好的从设备，构建混合网络（部分有ENA，部分无ENA）。

  • DISCSTIMERS (禁用片选定时器): 控制C2TDELAY（片选有效到第一个时钟沿的延迟）和T2CDELAY（最后一个时钟沿到片选无效的延迟）这两个定时器是否生效。

    • DISCSTIMERS=0：插入延迟。这是默认情况，用于满足从设备对片选建立和保持时间的要求。
    • DISCSTIMERS=1：不插入延迟。片选信号会紧挨着数据时钟。
    • 配置决策：如果你的从设备对片选时序非常宽松，或者你使用GPIO软件模拟片选以追求极限速度，可以禁用这些定时器。但在大多数情况下，特别是与高速或时序严格的器件通信时，建议保持启用，并根据从设备手册调整C2TDELAY和T2CDELAY寄存器的值。

  • WDELAY (帧间延迟): 定义连续两次传输之间的最小空闲时间。其实际延迟时间为：WDELAY * PVBUSPCLK + 2 * PVBUSPCLK。其中PVBUSPCLK是VBUSPCLK的周期。

    • 工作机制：该延迟仅在当前缓冲区的控制字段中WDEL位被置位时才会生效。
    • 应用价值：对于某些需要时间处理数据或切换状态的从设备（例如，一个串行DAC在接收完数据后需要一定时间更新输出），在主设备连续发送时插入WDELAY可以避免从设备过载，提高通信可靠性。

  • HDUPLEX_ENA (半双工使能): 这是一个特殊模式，用于将SIMO（主出从入）和SOMI（主入从出）两条线合并为一条半双工数据线。

    • HDUPLEX_ENA=1时：
      • 主模式下，SIMO引脚变为接收引脚（RX），无法发送。
      • 从模式下，SIMO引脚变为发送引脚（TX），无法接收。
    • 设计用途：用于引脚复用的特殊场景，例如某个引脚需要在不同时间扮演TX或RX的角色。对于常规的全双工SPI通信，此位必须保持为0。

3. 中断向量寄存器TGINTVECT：高效的事件处理器

如果说SPIFMT定义了“如何通信”，那么TGINTVECT（Transfer Group Interrupt Vector Register）则定义了“通信事件如何高效通知CPU”。MibSPI支持多个中断向量，这里以TGINTVECT0（偏移60h）和TGINTVECT1（偏移64h）为例，它们结构相同，服务于不同的中断线（INT0和INT1）。

3.1 寄存器结构解析与中断向量读取

TGINTVECTx寄存器是只读寄存器，核心字段只有两个：

比特位范围字段名功能
5-1INTVECTx中断向量值。指示当前在中断线x上挂起的、优先级最高的中断源。
0SUSPENDx传输挂起标志。仅用于MibSPI多缓冲模式，指示中断是由“传输完成”还是“传输挂起”触发的。

其精髓在于INTVECTx这个5位向量值。它不是一个随便的编号，而是硬件对SPIFLG（SPI标志寄存器）状态的一种“编码映射”。当有多个中断同时发生时，硬件会按照固定的优先级顺序，将最高优先级的中断向量呈现给CPU。

中断处理的基本流程是：

  1. SPI/MibSPI模块发生事件（如发送缓冲区空、接收缓冲区满等），在SPIFLG中置位相应的标志位。
  2. 如果该事件的中断使能位已打开，则会向CPU产生中断请求。
  3. CPU进入中断服务程序（ISR）后，第一件事就是读取TGINTVECTx寄存器。
  4. 根据读到的INTVECT值，跳转到对应的处理子程序。
  5. 对于某些中断（如接收完成），读取向量寄存器本身就会自动清除SPIFLG中的对应标志位，简化了软件操作。

3.2 中断向量编码与优先级详解

INTVECT字段的编码在SPI/兼容模式和MibSPI多缓冲模式下有所不同。我们主要看通用的SPI/兼容模式，其优先级从高到低及向量值如下：

向量值 (INTVECT[4:0])中断源描述清除方式
10001b(0x11)传输错误中断包括奇偶校验错、位错误、写冲突等。需要软件写1清除SPIFLG中的对应错误标志位。
10011b(0x13)接收缓冲区溢出中断接收缓冲区已满，但新数据又来了，导致数据丢失。读取TGINTVECT寄存器即可自动清除RXOVRNINTFLG标志。
10010b(0x12)接收缓冲区满中断接收缓冲区有数据可读。通常读取TGINTVECT寄存器即可自动清除RXINTFLG标志。
10100b(0x14)发送缓冲区空中断发送缓冲区已空，可以写入新的待发送数据。读取TGINTVECT寄存器不会清除TXINTFLG。向SPIDATx寄存器写入新数据会自动清除该中断。
00000b(0x00)无中断挂起

实操心得二：中断服务程序（ISR）的经典写法基于向量中断，你的SPI ISR可以写得非常高效。下面是一个伪代码示例：

void SPI_ISR(void) { uint32_t vector = HWREG(SPI_BASE + TGINTVECT0) & 0x1F; // 读取向量值 switch (vector) { case 0x11: // 错误处理 // 1. 读取SPIFLG确定具体错误类型 // 2. 进行错误恢复（如重置缓冲区） // 3. **必须**写SPIFLG清除错误标志 HWREG(SPI_BASE + SPIFLG) = ERROR_FLAG_MASK; break; case 0x13: // 接收溢出 // 1. 溢出是严重错误，通常意味着CPU处理太慢 // 2. 读取TGINTVECT已自动清除标志，但需处理数据丢失 // 3. 可能需要清空接收缓冲区，重置通信 handleOverrunError(); break; case 0x12: // 接收完成 // 1. 读取SPIBUF获取数据 rxData = HWREG(SPI_BASE + SPIBUF); // 2. 读取TGINTVECT通常已自动清除RXINTFLG processReceivedData(rxData); break; case 0x14: // 发送缓冲区空 // 1. 准备下一个要发送的数据 nextTxData = getNextDataToSend(); // 2. 写入SPIDATx寄存器，这会自动清除TXINTFLG并启动发送 HWREG(SPI_BASE + SPIDAT1) = nextTxData; break; case 0x00: // 无中断（理论上不应进入） default: break; } }

这种结构清晰，且能根据不同的中断源快速分支处理。

3.3 SUSPEND标志与多缓冲模式下的特殊考量

SUSPENDx位是MibSPI多缓冲模式特有的标志。在多缓冲模式下，数据不是单个收发，而是组织成“传输组”（Transfer Groups）进行块传输。

  • SUSPENDx = 0: 表示当前中断是由一个传输组全部完成触发的（TG Completed）。
  • SUSPENDx = 1: 表示当前中断是由传输组被挂起触发的（TG Suspended）。这通常是因为下一个待传输的缓冲区被配置为“挂起等待”模式（例如，等待特定条件满足才能继续）。

关键陷阱：SUSPEND中断的清除手册用加粗的“Note”警告我们：当发生SUSPEND中断（SUSPENDx=1）时，仅仅读取TGINTVECT寄存器是无法清除这个中断的！你必须先解决导致挂起的条件。例如，如果是因为发送缓冲区空而挂起，你需要向对应的TXRAM位置写入新数据；如果是因为接收缓冲区满而挂起，你需要从对应的RXRAM位置读取数据。只有在挂起条件解除后，中断才会被清除。如果忽略这一点，会导致中断持续触发，系统卡死。

另一个优先级细节：如果一个传输组先完成了（触发TG Completed中断），随后又被挂起（触发TG Suspended），那么TGINTVECT寄存器会优先显示TG Completed的中断向量。这意味着“完成”事件的优先级高于“挂起”事件。在设计状态机时需要考虑这一点。

3.4 关于清除中断标志的深度解析

这是中断处理中最容易出错的地方，务必理解透彻：

  1. 自动清除：对于“接收缓冲区满”（0x12）和“接收缓冲区溢出”（0x13）中断，读取TGINTVECT寄存器本身就会自动清除SPIFLG中对应的RXINTFLG和RXOVRNINTFLG标志位。这是硬件提供的便利。
  2. 写操作清除：对于“发送缓冲区空”中断（0x14），清除标志的不是读向量，而是向SPIDATx寄存器写入新的数据。
  3. 必须手动清除：对于所有错误中断（向量0x11），读取TGINTVECT寄存器不会清除SPIFLG中的任何错误标志（如PARITYERR, BITERR等）。你必须在ISR中显式地写1到SPIFLG寄存器的对应位来清除它们。忘记这一步是导致错误中断只触发一次的常见原因。
  4. 特例中的特例：手册还提到了一个极端情况：当SPIBUF和内部RXBUF都满的时候，即使读取TGINTVECT寄存器（显示0x12），也可能无法清除RXINTFLG。此时，唯一的清除方法是继续读取SPIBUF，直到没有未读的接收数据为止。这强调了在ISR中彻底处理完接收数据的重要性。

4. 关联寄存器与高级功能概览

为了更全面地运用MibSPI，我们简要提一下输入材料中涉及的其他两个关键寄存器，它们与SPIFMT和中断配置协同工作。

4.1 SPIPC9：引脚压摆率控制寄存器

这个寄存器（偏移68h）控制SPI相关引脚的输出缓冲器压摆率（Slew Rate）。

  • 功能：每个位控制一个特定引脚（SOMIx, SIMOx, SPICLK, SPIENA, SPISCSx）是使用“正常缓冲器”（快）还是“慢缓冲器”（慢）。
  • 用途：降低电磁干扰（EMI）。在高速通信时，信号边沿过陡会产生高频噪声，干扰系统自身或其他设备。通过选择慢缓冲器，可以柔化信号边沿，减少EMI，代价是略微增加信号上升/下降时间，可能限制最高通信速率。在汽车电子等对EMI要求苛刻的场合非常有用。
  • 注意：对于SOMI0和SIMO0引脚，有两个控制位（位11/24和位10/16）。手册明确，如果执行32位写操作，低位（位11和位10）的优先级高于高位。

4.2 SPIPMCTRL：并行/模数模式控制寄存器

这个寄存器（偏移6Ch）开启了MibSPI的“性能狂暴”模式——并行和模数（Modulo）传输。

  • PMODEx[1:0] (并行模式)：将数据线从1条扩展到2条、4条或8条。例如，设置PMODE=10（4线模式），则一次可以传输4位数据，在相同时钟频率下，理论数据吞吐量提升至4倍。这需要硬件引脚支持（多个SIMO/SOMI）。
  • MMODEx[2:0] (模数模式)：这是更灵活的并行模式，支持1、2、3、4、5、6条数据线。需要与PMODE配合设置。
  • HSM_MODEx (高速模数模式)和MODCLKPOLx (模数模式时钟极性)：用于优化模数模式下的时序和性能。
  • 应用场景：用于驱动并行显示屏、与高速ADC/DAC通信等需要极高数据带宽的场合。配置此模式时，需要仔细阅读手册第3.26节，并严格设计PCB布线，确保多根数据线的长度匹配，避免时序问题。

5. 实战配置流程与常见问题排查

理解了原理，我们来看如何将这些知识付诸实践，并解决可能遇到的问题。

5.1 一个完整的MibSPI主设备初始化配置示例

假设我们需要配置MibSPI1作为主设备，通过SPIFMT0与一个Mode 0、8位数据、MSB先出、波特率5Mbps的传感器通信，并启用接收中断。

// 假设寄存器基地址定义 #define MIBSPI1_BASE (0xFFF7F800UL) #define MIBSPI1_GCR1 (*(volatile uint32_t *)(MIBSPI1_BASE + 0x00)) #define MIBSPI1_SPIFMT0 (*(volatile uint32_t *)(MIBSPI1_BASE + 0x50)) #define MIBSPI1_INT0 (*(volatile uint32_t *)(MIBSPI1_BASE + 0x20)) // 中断使能寄存器示例 #define MIBSPI1_PC9 (*(volatile uint32_t *)(MIBSPI1_BASE + 0x68)) void MibSPI1_Master_Init(void) { // 步骤1：禁用模块，确保安全配置 MIBSPI1_GCR1 &= ~(1UL << 24); // 清除SPIEN位 // 步骤2：配置引脚功能（需查阅具体芯片手册，将相关GPIO引脚复用为SPI功能） // ... (此处省略具体GPIO复用代码) // 步骤3：配置SPIFMT0寄存器 uint32_t fmt0_value = 0; // CHARLEN: 8位数据 -> 0x08 fmt0_value |= (0x08UL << 0); // PRESCALE: 假设VBUSPCLK=100MHz, 目标5Mbps -> 100/5 -1 = 19 fmt0_value |= (19UL << 8); // PHASE=0, POLARITY=0 -> Mode 0 // SHIFTDIR=0 -> MSB first // 其他位默认0（无奇偶校验，全双工，使能片选定时器等） MIBSPI1_SPIFMT0 = fmt0_value; // 步骤4：（可选）配置引脚压摆率为慢速，降低EMI MIBSPI1_PC9 |= (1UL << 9); // 设置SPICLK为慢缓冲器 // 可根据需要设置SIMO, SOMI, CS的压摆率 // 步骤5：使能所需中断 MIBSPI1_INT0 |= (1UL << 2); // 假设位2对应接收缓冲区满中断使能RXINTENA // 步骤6：最后使能SPI模块 MIBSPI1_GCR1 |= (1UL << 24); // 置位SPIEN }

5.2 典型问题排查清单

当你发现SPI通信不正常时，可以按照以下清单逐项检查：

现象可能原因排查步骤
完全无通信，时钟线无波形1. 模块未使能（SPIEN=0）。
2. 引脚复用错误。
3. 主设备未启动传输（未写SPIDAT或未拉低片选）。		1. 检查GCR1.SPIEN位。
2. 用万用表或示波器检查引脚电平，确认复用功能已开启。
3. 检查程序是否执行了启动传输的操作。
有时钟，但数据线无波形或波形不对1. 主从设备模式配反。
2. 数据线（SIMO/SOMI）接反。
3. 半双工模式被意外使能（HDUPLEX_ENA=1）。		1. 确认MASTER位配置正确。
2. 交换SIMO和SOMI线试试。
3. 检查SPIFMTx中HDUPLEX_ENA位是否为0。
能发送，但接收数据全为0或0xFF1. 时钟极性/相��（POLARITY/PHASE）不匹配。
2. 移位方向（SHIFTDIR）不匹配。
3. 从设备未正确响应或损坏。		1.这是最常见原因！用逻辑分析仪同时抓取CLK、MOSI、MISO波形，对照从设备手册检查时序模式。
2. 检查SHIFTDIR配置。
3. 检查从设备供电、复位和片选信号。
通信速率远低于预期1. PRESCALE计算错误或配置错误。
2. VBUSPCLK时钟源频率不对。
3. 引脚压摆率设置为“慢”限制了速度。		1. 重新计算PRESCALE值，注意PRESCALE=0时速率是VBUSPCLK/2。
2. 检查系统时钟配置。
3. 检查SPIPC9寄存器，如果不需要低EMI，可尝试改为“正常”缓冲器。
中断无法进入或只进入一次1. 中断未使能（INTx寄存器）。
2. 中断向量表或ISR函数未正确链接。
3.错误中断标志未手动清除。
4. 全局中断未开启。		1. 检查对应中断使能位。
2. 确认编译器/链接器设置正确。
3.重点检查错误中断ISR，是否写了SPIFLG清除标志。
4. 确认CPU的全局中断标志已开启。
多缓冲模式下传输意外停止1. 传输组配置错误（起始地址、数量）。
2. 触发了SUSPEND条件，但未处理。
3. 缓冲区控制字（BUFMODE）配置有误。		1. 检查TGRx寄存器的START_ADDR和COUNT字段。
2. 检查TGINTVECT的SUSPEND位，并按照手册解决挂起条件。
3. 仔细检查TXRAM中每个缓冲区的控制字段，特别是SUSPEND和WDEL位。

5.3 使用逻辑分析仪进行深度调试

对于复杂的SPI问题，逻辑分析仪是不可或缺的工具。建议捕获并观察以下信息：

  1. 完整帧：包括片选有效、时钟、数据（MOSI和MISO）。
  2. 对照手册：将捕获的波形与从设备数据手册中的时序图进行严格比对，关注建立时间、保持时间、时钟空闲电平、数据采样边沿。
  3. 检查细节：注意数据位的顺序（MSB/LSB）、帧间间隔（是否需WDELAY）、片选信号的行为（是否需C2TDELAY/T2CDELAY）。

通过将理论配置、代码实现和实际信号波形三者结合，你就能精准定位并解决绝大多数MibSPI通信问题。掌握SPIFMT和TGINTVECT这些核心寄存器的细节，是迈向嵌入式通信高手的关键一步。

http://www.jsqmd.com/news/1218785/

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