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CC2538 SSI/SPI通信实战：从原理到配置与调试指南

news 2026/7/19 20:34:38

1. 项目概述：深入CC2538的同步串行接口核心

在嵌入式系统开发中，微控制器与外围设备（如传感器、存储器、无线模块、显示屏）之间的通信是构建功能的基础。当你需要高速、可靠地交换数据时，I2C的速度可能成为瓶颈，而UART的异步特性又难以保证严格的时序。这时，同步串行接口（Synchronous Serial Interface, SSI）就成为了工程师工具箱里的利器。它不是某一家公司的专属协议，而是一类基于时钟同步的串行通信方式的统称，其最广为人知的代表就是SPI（Serial Peripheral Interface）。

我手头这个项目，聚焦于德州仪器（TI）CC2538这款集成了ARM Cortex-M3内核和强大射频前端的无线微控制器。CC2538内部集成了两个独立的SSI模块，这为连接多种外设提供了极大的灵活性。但官方数据手册往往篇幅浩繁，重点分散，实际开发时，我们更需要的是直击要害的原理剖析和“开箱即用”的配置指南。本文将结合我多年在Zigbee、Thread网络设备开发中使用CC2538的经验，为你拆解SSI模块的运作机理、不同模式下的波形玄机，并提供一个从零搭建通信链路、避开常见陷阱的实战指南。无论你是正在评估CC2538用于新产品，还是正在调试一块通信不稳定的板子，相信这里的细节都能给你带来启发。

2. SSI核心原理与CC2538实现特色

要玩转SSI，绝不能停留在“四根线（SCLK, MOSI, MISO, CS）搞定”的层面。CC2538的SSI模块是一个高度可配置的硬件引擎，理解其内部结构和工作流程，是写出稳定驱动和解决棘手问题的前提。

2.1 模块架构与数据流

CC2538的每个SSI模块都是一个完整的通信子系统。我们可以将其核心简化为几个关键部分：时钟生成器、发送/接收逻辑、双缓冲FIFO（先进先出存储器）、控制寄存器组以及到DMA和中断控制器的接口。

数据流是这样的：当你想发送数据时，CPU或DMA将数据写入发送FIFO。这个FIFO有8个位置，每个位置能存放一个最大16位的数据帧。发送逻辑会按顺序从FIFO中取出数据，根据你配置的帧格式（比如SPI模式、数据位宽），配合生成的时钟信号（SSIClk）和帧信号（SSIFss），将数据一位一位地从SSITx引脚移出。与此同时，从设备的数据通过SSIRx引脚移入，经过接收逻辑后，被存入接收FIFO，同样也是8x16位的深度，等待CPU或DMA来读取。

这个双FIFO结构是高效通信的关键。它允许CPU在一次性写入多个数据后就去处理其他任务，SSI硬件会在后台自动完成发送；同样，CPU可以间隔一段时间再去批量读取接收到的数据，避免了频繁中断带来的开销。CC2538的SSI支持4到16位可编程的数据帧长度，这比许多固定为8位或16位的SPI控制器要灵活得多，可以更好地适配不同外设的协议要求。

2.2 灵活的协议支持：SPI, MICROWIRE与TI SSI

CC2538的SSI模块之所以强大，在于它通过硬件逻辑直接支持三种主流的同步串行协议，只需配置寄存器即可切换，无需用GPIO模拟时序。

  1. Freescale SPI模式：这是最常见、最通用的模式，支持全双工通信（同时收发）。其精髓在于时钟极性（CPOL或SPO）和时钟相位（CPHA或SPH）的可配置性，这产生了四种可能的时序组合（模式0-3），用以匹配不同外设的采样要求。我们会在后面详细分析这四种模式的波形差异。
  2. Texas Instruments SSI模式：这是TI自家定义的一种格式。它与SPI的主要区别在于帧信号（SSIFss）的行为。在TI SSI模式下，SSIFss不是一个持续有效的片选信号，而是在每个数据帧开始前产生一个时钟周期宽度的脉冲。这种模式在某些TI专属的外设通信中会用到。
  3. MICROWIRE模式：这是一种半双工的主从消息传递协议。每次传输以一个8位的控制字开始，主设备发送完这个控制字后，从设备才会在接下来的时钟周期里返回数据。这种“先命令，后响应”的格式常用于一些较老的串行存储器或专用芯片。

注意：选择模式时，首要且唯一的标准是从设备（Slave）的数据手册。务必严格按照其要求的时序模式进行配置，任何主从设备间的模式不匹配都会导致通信彻底失败。

2.3 时钟生成：精准控制通信速率

通信速率（比特率）是同步接口的重要参数。CC2538的SSI时钟由系统时钟（SysClk）或内部精密振荡器（PIOSC）分频而来，分频过程分为两级，提供了非常精细的速率控制。

计算公式是：SSIClk = 输入时钟源 / (CPSDVSR × (1 + SCR))

  • 输入时钟源：通过SSI_CC寄存器选择，可以是系统主时钟或PIOSC。
  • CPSDVSR：预分频除数，通过SSI_CPSR寄存器设置，取值范围是2到254之间的偶数。这是一个硬性规定，写奇数会导致不可预测的行为。
  • SCR：串行时钟速率除数，通过SSI_CR0寄存器的SCR字段设置，取值范围0-255，实际分频系数是(1+SCR)。

例如，系统时钟为32MHz，目标SSIClk为1MHz。我们可以先设定CPSDVSR = 4，那么第一级分频后得到8MHz。接着计算1MHz = 8MHz / (1+SCR)，得出SCR = 7。将CPSDVSR=4和SCR=7写入对应寄存器即可。

实操心得：在满足从设备最高速率的前提下，通信时钟并非越快越好。过高的速率会带来信号完整性问题，尤其是PCB走线较长时。我通常会先以一个较低的保守速率（如1Mbps）让通信先跑起来，验证逻辑正确后，再逐步提高速率并进行稳定性测试。另外，在从设备模式下，务必确保输入时钟（SysClk或PIOSC）频率至少是SSIClk的6倍，否则可能无法正确采样数据。

3. 帧格式深度解析与波形实战

理解了架构，我们进入最核心的部分——时序。数据手册里的波形图是“圣旨”，但往往不够直观。我将结合示波器实测经验，为你解读不同模式下的信号细节。

3.1 Freescale SPI的四种模式详解

SPI的四种模式由时钟极性（SPO）和时钟相位（SPH）两个位决定。SPO决定时钟空闲时的电平，SPH决定数据在哪个时钟边沿被采样（捕获）。记住这个核心，再看波形就清晰了。

  • 模式0 (SPO=0, SPH=0)：

    • 空闲时：SCLK为低电平，片选SS为高电平（无效）。
    • 数据传输：片选SS拉低后，在第一个SCLK边沿（即上升沿）捕获数据，在随后的下降沿更新数据（输出下一比特）。这是最常见的一种模式。
    • 关键点：对于连续传输（背靠背发送多个数据帧），主机必须在每个数据帧之间将SS线拉高至少一个短暂的时间，以便从机内部更新其移位寄存器。如果SS一直保持低电平，从机将不会在后续时钟沿采样新数据。

  • 模式1 (SPO=0, SPH=1)：

    • 空闲时：SCLK为低电平，SS为高。
    • 数据传输：片选SS拉低后，在第二个SCLK边沿（即第一个下降沿）捕获数据，在上升沿更新数据。
    • 关键点：在此模式下，SS可以在连续传输期间一直保持低电平，因为数据捕获边沿已经发生了变化。

  • 模式2 (SPO=1, SPH=0)：

    • 空闲时：SCLK为高电平，SS为高。
    • 数据传输：片选SS拉低后，在第一个SCLK边沿（即下降沿）捕获数据，在随后的上升沿更新数据。可以看作是模式0的“镜像”。

  • 模式3 (SPO=1, SPH=1)：

    • 空闲时：SCLK为高电平，SS为高。
    • 数据传输：片选SS���低后，在第二个SCLK边沿（即第一个上升沿）捕获数据，在下降沿更新数据。可以看作是模式1的“镜像”。

避坑指南：最常遇到的通信失败，十有八九是模式不匹配。务必用示波器同时抓取SCLK、MOSI、MISO和CS四路信号。首先检查空闲电平和第一个数据捕获边沿是否符合预期。一个快速判断方法是：观察在片选有效（CS拉低）后，第一个SCLK边沿到来时，MOSI线上的数据是否已经稳定？如果已经稳定，则SPH=0（在第一个边沿捕获）；如果还未稳定，则在第二个边沿才变化，则SPH=1。

3.2 MICROWIRE模式的操作要点

MICROWIRE模式容易让人困惑，因为它本质上是“半双工+命令响应”。其操作流程是固定的：

  1. 主机将一个8位的控制字节写入发送FIFO。
  2. SSI硬件拉低SSIFss，并开始逐位发送这8位控制字。在此期间，SSIRx引脚处于高阻态，主机不接收任何数据。
  3. 8位控制字发送完毕后，硬件会插入一个时钟周期的等待状态。
  4. 从机在这个等待状态中解析控制字，然后从下一个时钟周期开始，将数据（4-16位）通过SSIRx线发送回主机。
  5. 主机在时钟上升沿采样这些数据位。

因此，在MICROWIRE模式下，一次完整的“读写”操作，主机需要先写一个命令（8位），再读取响应数据（N位）。在软件驱动设计上，你需要将这次操作视为一个整体，先写入命令触发传输，然后等待并读取返回的数据长度。

3.3 中断与DMA：解放CPU的利器

当通信数据量较大或频率较高时，轮询FIFO状态会大量消耗CPU资源。CC2538的SSI提供了完善的中断和DMA机制来提升效率。

中断主要处理以下几种事件：

  • 发送FIFO服务中断：当发送FIFO中的数据量少于或等于一半（可配置阈值）时触发，提示CPU可以填充更多数据。
  • 接收FIFO服务中断：当接收FIFO中的数据量达到或超过一半时触发，提示CPU可以读取数据。
  • 接收超时中断：当接收FIFO非空，但超过32个SSIClk周期没有新数据进入时触发。这常用于检测一帧数据传输的结束。
  • 接收溢出中断：当接收FIFO已满，但又有新数据到来时触发，意味着数据丢失。
  • 传输结束中断：当一帧数据完全移出移位寄存器时触发。这个中断非常有用，它可以精确指示“当前字节已发送完毕”，对于需要严格控制时序的操作（如驱动WS2812B这类LED灯带）是关键。

DMA（直接存储器访问）则是为大批量数据传输而生的。CC2538的μDMA控制器可以与SSI无缝协作。你可以分别配置发送和接收DMA通道。当发送FIFO有空位时，SSI会向DMA发出请求，DMA控制器自动从内存中搬运数据到SSI_DR寄存器；当接收FIFO有数据时，DMA自动将数据搬运到指定内存。你只需要设置好源地址、目标地址和数据量，就可以启动传输，然后CPU几乎不用干预。

注意事项：启用DMA时，中断向量仍然是SSI的中断。这意味着你的SSI中断服务程序（ISR）需要检查中断状态寄存器，区分是FIFO服务中断还是DMA传输完成中断，并分别处理。此外，DMA的突发请求（Burst Request）阈值是4个FIFO条目，在配置DMA传输大小时，考虑对齐到这个值可以获得更高的效率。

4. CC2538 SSI从零到一的配置实战

理论说得再多，不如一行代码。下面我将以一个具体的场景为例，展示如何一步步配置CC2538的SSI0模块，并与一个SPI Flash存储器（假设其工作在SPI模式0）进行通信。

4.1 硬件连接与引脚复用

CC2538的引脚功能是复用的，使用SSI前必须先配置GPIO模块。假设我们使用以下引脚连接：

  • SSI0Clk->PA2
  • SSI0Fss->PA3
  • SSI0Tx(MOSI) ->PA5
  • SSI0Rx(MISO) ->PA4

首先，需要使能SSI0模块的时钟，并配置GPIO引脚为外设功能：

// 1. 使能SSI0模块时钟 (通过系统控制寄存器) HWREG(SYS_CTRL_RCGCSSI) |= 0x01; // 置位第0位，使能SSI0 // 2. 使能GPIO端口A时钟 HWREG(SYS_CTRL_RCGCGPIO) |= 0x01; // 置位第0位，使能GPIOA // 3. 等待外设时钟稳定（建议插入少量延时，或读取某个寄存器） __asm(" NOP"); __asm(" NOP"); // 4. 配置PA2, PA3, PA4, PA5为外设功能 // 查找数据手册中IOC_PXX_SEL寄存器的值，将对应引脚映射到SSI0功能 // 例如，PA2映射为SSI0Clk，可能需要设置IOC_PA2_SEL的特定值（如0x02） HWREG(IOC_PA2_SEL) = 0x02; // 假设0x02对应SSI0Clk功能 HWREG(IOC_PA3_SEL) = 0x02; // SSI0Fss HWREG(IOC_PA4_SEL) = 0x02; // SSI0Rx HWREG(IOC_PA5_SEL) = 0x02; // SSI0Tx // 5. 配置GPIO为输出（对于Tx, Clk, Fss）或输入（对于Rx），并启用数字功能 // 设置PA2, PA3, PA5方向为输出，PA4为输入 HWREG(GPIO_A_BASE + GPIO_O_DIR) |= (1<<2) | (1<<3) | (1<<5); HWREG(GPIO_A_BASE + GPIO_O_DIR) &= ~(1<<4); // 启用数字功能 HWREG(GPIO_A_BASE + GPIO_O_AFSEL) |= (1<<2) | (1<<3) | (1<<4) | (1<<5);

4.2 寄存器配置详解与示例代码

引脚配置好后，开始配置SSI模块本身。一个重要的原则是：在修改关键配置（如SSI_CR0）前，必须先禁用SSI（清除SSE位）。

假设系统时钟为32MHz，我们需要配置SSI0为主机，SPI模式0，数据位宽8位，比特率4MHz。

步骤1：禁用SSI，准备配置

// 获取SSI0基地址，通常为0x40008000 #define SSI0_BASE 0x40008000 // 清除SSI控制寄存器1（SSI_CR1）的SSE位，禁用SSI模块 HWREG(SSI0_BASE + SSI_O_CR1) = 0x00000000;

步骤2：配置为主模式

// SSI_CR1寄存器：设置为主模式（MSTR=1），SSE位保持为0（稍后启用） // 实际上，在SSE=0时，向CR1写0x0即表示主模式。从模式会有其他设置。 HWREG(SSI0_BASE + SSI_O_CR1) = 0x00000000; // 主模式，SSE=0

步骤3：配置时钟源

// SSI_CC寄存器：选择系统时钟作为SSI时钟源。假设0x0代表系统时钟。 HWREG(SSI0_BASE + SSI_O_CC) = 0x00000000;

步骤4：计算并设置时钟分频器目标频率SSIClk = 4 MHz，系统时钟SysClk = 32 MHz。 根据公式：4MHz = 32MHz / (CPSDVSR * (1+SCR))我们需要选择一对合适的CPSDVSR（偶数，2-254）和SCR（0-255）值。 先尝试固定CPSDVSR为一个较小的偶数，比如2或4，以使SCR的值不至于过大或过小。 若取CPSDVSR = 4，则32MHz / 4 = 8MHz。 那么4MHz = 8MHz / (1+SCR)=>1+SCR = 2=>SCR = 1。 校验：32 / (4 * (1+1)) = 32 / 8 = 4 MHz，符合。

// 设置预分频寄存器 SSI_CPSR HWREG(SSI0_BASE + SSI_O_CPSR) = 4; // CPSDVSR = 4

步骤5：配置控制寄存器0（SSI_CR0）这是最关键的一步，需要设置数据位宽、帧格式、时钟极性和相位。

  • DSS（数据位宽）：8位数据，对应值0x07（因为DSS字段值 = 数据位数 - 1）。
  • FRF（帧格式）：Freescale SPI，对应值0x00。
  • SPO（时钟极性）：模式0，空闲低电平，对应0x0。
  • SPH（时钟相位）：模式0，在第一个边沿捕获，对应0x0。
  • SCR：前面计算出的0x01。 将这些值组合起来：SCR在8-15位，需要左移8位：0x01 << 8 = 0x0100。FRF在4-5位，0x00 << 4 = 0x0000。DSS在0-3位，0x07。 所以SSI_CR0 = 0x0100 | 0x0000 | 0x07 = 0x0107。
HWREG(SSI0_BASE + SSI_O_CR0) = 0x0107;

步骤6：（可选）配置DMA如果需要使用DMA，在此步骤配置μDMA控制器，并启用SSI的DMA控制寄存器。

// 启用SSI0的发送和接收DMA请求 HWREG(SSI0_BASE + SSI_O_DMACTL) = (1 << 1) | (1 << 0); // 设置TXDMAE和RXDMAE位 // 注意：还需要详细配置μDMA通道的控制结构体，此处略过。

步骤7：启用SSI模块

// 设置SSI_CR1寄存器的SSE位为1，启用SSI模块 HWREG(SSI0_BASE + SSI_O_CR1) |= 0x00000002; // 或直接写0x2

4.3 基础数据收发函数

配置完成后，就可以进行数据收发了。最基本的方式是通过读写数据寄存器（SSI_DR）进行轮询操作。

// 发送一个字节（阻塞式，等待发送FIFO非满） void SSI_SendByte(uint8_t data) { // 等待发送FIFO有空间（检查SSI_SR寄存器的TNF位） while((HWREG(SSI0_BASE + SSI_O_SR) & 0x00000002) == 0) { // TNF=0表示发送FIFO已满，等待 } // 写入数据到数据寄存器（只写低8位） HWREG(SSI0_BASE + SSI_O_DR) = data; } // 接收一个字节（阻塞式，通常需要先发送一个哑元数据来产生时钟） uint8_t SSI_ReceiveByte(void) { // 先等待接收FIFO非空（检查SSI_SR寄存器的RNE位） while((HWREG(SSI0_BASE + SSI_O_SR) & 0x00000004) == 0) { // RNE=0表示接收FIFO为空 } // 读取数据寄存器（只取低8位） return (uint8_t)(HWREG(SSI0_BASE + SSI_O_DR) & 0xFF); } // 全双工交换一个字节（最常用的SPI操作） uint8_t SSI_TransferByte(uint8_t txData) { SSI_SendByte(txData); // 发送数据，同时也会产生时钟接收数据 return SSI_ReceiveByte(); // 读取接收到的数据 }

重要提示：在SPI全双工模式下，发送和接收是同时进行的。每当你向SSI_DR写入一个数据启动发送，硬件也会同时接收一个数据到接收FIFO。因此，典型的SPI读操作，往往是先写入一个命令或哑元数据（如0xFF）来产生时钟，然后读取返回的数据。对于只写不读的外设，你可以忽略接收到的数据；对于只读不写的外设，你需要发送哑元数据来“换取”读回的数据。

5. 高级应用、调试与故障排查

掌握了基础配置和收发，我们来看看更复杂的应用场景和那些让人头疼的调试问题。

5.1 使用FIFO与中断进行高效数据传输

轮询方式效率低。更优的方法是使用FIFO中断进行批量处理。我们可以设置当发送FIFO半空或接收FIFO半满时产生中断。

// 初始化并启用SSI中断 void SSI_InitWithInterrupt(void) { // ... 前面的引脚和基本配置与4.2节相同 ... // 配置中断：启用接收FIFO半满中断和接收超时中断 // SSI_IM寄存器：RORIM (溢出) | RTIM (超时) | RXIM (接收) | TXIM (发送) // 我们启用接收中断(RXIM)和超时中断(RTIM) HWREG(SSI0_BASE + SSI_O_IM) = (1 << 3) | (1 << 2); // 设置RXIM和RTIM位 // 配置NVIC（嵌套向量中断控制器），启用SSI0中断 // 假设SSI0的中断号为7（需查阅CC2538数据手册确认） HWREG(NVIC_EN0) |= (1 << 7); // 使能SSI0中断 // 最后启用SSI模块 HWREG(SSI0_BASE + SSI_O_CR1) |= 0x02; } // SSI0中断服务程序 void SSI0_IRQHandler(void) { uint32_t mis_status = HWREG(SSI0_BASE + SSI_O_MIS); // 读取屏蔽后的中断状态 if(mis_status & 0x04) { // 检查接收中断(RXIM)是否触发 // 接收FIFO至少有一半数据了，批量读取 while(HWREG(SSI0_BASE + SSI_O_SR) & 0x04) { // 当RNE=1时 uint16_t receivedData = HWREG(SSI0_BASE + SSI_O_DR) & 0xFFFF; // 处理receivedData，例如存入环形缓冲区 // userBuffer[userIndex++] = receivedData; } } if(mis_status & 0x08) { // 检查接收超时中断(RTIM)是否触发 // 超时发生，可能一帧数据已接收完毕 // 清除超时中断标志 HWREG(SSI0_BASE + SSI_O_ICR) = 0x08; // 写1清除RTIC位 // 可以进行后续处理，如通知任务数据包已就绪 } // ... 还可以处理其他中断，如发送中断(TXIM)等 ... }

5.2 常见问题排查速查表

遇到SSI通信失败，可以按照以下步骤排查：

问题现象可能原因排查方法与解决思路
完全无通信，SCLK无波形1. SSI模块时钟未使能。
2. GPIO引脚功能未正确配置为外设模式。
3. SSI未启用（SSE位为0）。
4. 主模式下，发送FIFO为空，不会启动传输。		1. 检查SYS_CTRL_RCGCSSI和SYS_CTRL_RCGCGPIO寄存器。
2. 用逻辑分析仪或示波器检查IOC_Pxx_SEL和GPIO_AFSEL配置。
3. 确认SSI_CR1的SSE位已置1。
4. 确保在启动传输前，至少向SSI_DR写入了一个数据。
有SCLK波形，但MOSI无数据或数据错误1. SPI模式（SPO/SPH）不匹配。
2. 数据位宽（DSS）设置错误。
3. 字节序（MSB/LSB）问题。		1.用示波器同时抓取SCLK和MOSI，对照从设备手册，检查第一个数据位在哪个时钟边沿稳定。调整SPO/SPH。
2. 确认SSI_CR0的DSS字段与从设备要求一致（例如，12位ADC可能要求16位帧，其中高4位无效）。
3. CC2538 SSI固定从MSB开始发送，检查从设备是否要求LSB先行。
能发送，但接收不到数据（MISO一直为高或低）1. 从设备未正确选中或未上电。
2. MISO引脚配置错误（应为输入）。
3. 从设备通信协议理解错误（如需要先发特定命令）。
4. 在只读操作时，未发送足够的时钟（哑元数据）。		1. 检查从设备的片选（CS）信号是否在通信期间有效（通常低电平有效）。测量从设备电源和地。
2. 确认MISO对应的GPIO方向设置为输入，且已启用外设功能。
3. 仔细阅读从设备数据手册的“通信协议”章节，确保命令序列正确。
4. 读取操作时，调用SSI_TransferByte(0xFF)来产生时钟并读取数据。
通信不稳定，偶尔出错1. 通信速率过高，信号质量差。
2. 电源噪声或地线干扰。
3. FIFO溢出或下溢。
4. 中断服务程序处理太慢，导致FIFO溢出。		1.降低SSIClk频率测试。检查PCB走线，确保时钟和数据线尽量短，并行走线间做好隔离。
2. 增加电源滤波电容，检查地平面是否完整。
3. 在中断服务程序中或主循环里，检查SSI_SR寄存器的RFF（接收FIFO满）和TFE（发送FIFO空）标志，及时处理数据。
4. 优化ISR，只做最必要的操作（如搬运数据到缓冲区），标志处理放在主循环。
使用DMA时数据错乱1. DMA源/目标地址或传输大小配置错误。
2. DMA与CPU访问内存冲突（未使用一致性内存）。
3. SSI的DMA使能位未正确设置。		1. 仔细检查DMA控制结构体中的地址和数量字段。确保传输大小是FIFO触发深度的整数倍（如4）以获得最佳性能。
2. 确保DMA操作的内存区域是非缓存（Non-cacheable）的，或者正确执行了缓存维护操作（Clean/Invalidate）。
3. 确认SSI_DMACTL寄存器的TXDMAE和RXDMAE位已置1。

5.3 针对特定外设的配置考量

不同的外设对SPI通信有特殊要求，配置时需要额外注意：

  • SPI Flash（如W25Q128）：通常支持模式0和模式3。除了基本的读写，还需要注意其支持“快速读”命令，该命令后需要一个或多个哑元时钟周期（Dummy Cycles）才能输出数据。这需要在发送读命令后，额外多发送几个0xFF再开始读取。
  • SPI ADC（如ADS131M04）：这类高精度ADC对时序要求极其严格。其数据帧可能超过16位（如24位），需要配置CC2538的DSS为最大16位，然后通过多次传输组合成一个完整样本。同时，要注意其数据就绪信号（DRDY）与SPI片选（CS）��配合时序，有时需要在DRDY变低后延迟一段时间再拉低CS。
  • SPI显示屏（如ILI9341）：通常包含命令和数据两种写入模式，通过DC（数据/命令）引脚区分。在驱动时，需要先将DC拉低（命令模式），发送命令码；再将DC拉高（数据模式），发送参数。这需要将DC引脚作为普通GPIO来控制，并与SPI的片选（Fss）协调好时序。

最后一点个人体会：调试复杂的SPI通信，一个支持多通道解码的逻辑分析仪是无可替代的。它能直观地显示四路信号的时序关系，并自动解析SPI数据包，让你迅速定位是配置问题、时序问题还是数据内容问题。在项目初期，花时间搭建一个可靠的、带错误检测和重试机制的SPI驱动层，会在后续集成多个外设时节省大量的调试时间。CC2538的SSI模块本身很强大，但把它用稳、用好的关键，在于对协议细节的深刻理解和对硬件信号的细致观察。

http://www.jsqmd.com/news/1221866/

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