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TMS320F280013x SPI模块配置、FIFO中断与3-Wire模式实战指南

news 2026/7/20 13:19:08

1. SPI接口核心原理与TMS320F280013x模块概览

SPI，全称Serial Peripheral Interface，几乎是我在嵌入式项目里打交道最多的通信协议之一。它不像I2C那样需要复杂的地址管理，也不像UART那样依赖精确的波特率匹配，其核心魅力在于“简单粗暴”的全双工同步通信。在TMS320F280013x这类C2000系列DSP上，SPI模块更是被设计得相当灵活和强大，从基础的传感器数据采集到复杂的数字音频流传输，它都能胜任。

简单来说，你可以把SPI想象成一个高效的“流水线装配车间”。主设备（Master）就是这个车间的总控，它产生时钟信号（SPICLK）来决定流水线的节拍。从设备（Slave）则是各个工位，它们只在被主设备“点名”（通过片选信号SPISTE拉低）时才工作。数据就在两条流水线上同时传输：一条是主设备发给从设备的（SPISIMO），另一条是从设备返回给主设备的（SPISOMI）。这种全双工模式意味着主设备在发送命令的同时，就能收到从设备的响应数据，效率非常高。

TMS320F280013x的SPI模块在硬件上做了很多优化。首先，它支持高达16位的字符长度（通过SPICHAR配置），这意味着你一次可以传输一个完整的16位整数，而无需像8位MCU那样拆分成两次操作。其次，其波特率由SPIBRR寄存器控制，计算公式为：当SPIBRR=3~127时，SPICLK = LSPCLK / (SPIBRR + 1)；当SPIBRR=0,1,2时，SPICLK = LSPCLK / 4。这里的LSPCLK是低速外设时钟，通常由系统时钟SYSCLK分频得到。理解这个公式对精确控制通信速率至关重要。

模块还内置了128级深度的FIFO（先入先出缓冲区），这对于需要连续、高速传输数据的场景（如驱动TFT显示屏、读取高速ADC）是巨大的福音。FIFO可以显著减少CPU被频繁中断的次数，让CPU有更多时间处理核心算法。此外，模块支持四种时钟模式（由CLKPOLARITY和CLK_PHASE位组合决定），可以兼容市面上绝大多数SPI外设的时序要求。最让我觉得贴心的是其软件复位（SPISWRESET）机制，它允许你在不重启整个外设模块的情况下，安全地重新配置SPI，这在动态切换通信模式时非常有用。

2. SPI配置流程深度解析与避坑指南

配置TMS320F280013x的SPI，远不止是简单填几个寄存器值。一个稳定可靠的SPI驱动，其初始化流程必须严谨，任何顺序错乱或遗漏都可能导致通信失败这种玄学问题。根据手册和我的实战经验，一个健壮的配置流程必须遵循以下黄金步骤，尤其是第一步和最后一步，绝对不能颠倒。

2.1 初始化流程的“铁律”

手册里强调的流程是绝对的金科玉律，其核心思想是：在修改任何配置寄存器之前，必须先将模块置于一个确定的、安全的“复位”状态。

  1. 拉入复位状态（SPISWRESET = 0）：这是整个配置过程的“安全开关”。当你将SPICCR寄存器中的SPISWRESET位写0时，SPI模块的内部状态机、状态标志（如中断标志、溢出标志）会被清零，但关键配置（如之前设置的波特率、时钟模式）会保持不变。更重要的是，此时SPICLK引脚会被强制拉低（或拉高，取决于极性），SPISTE引脚变为无效状态。这样做的好处是，在你重新配置参数时，总线是静止的，不会因为某个中间状态产生毛刺或意外通信。我见过太多新手跳过这一步直接改配置，结果在使能模块的瞬间，总线上蹦出一个乱码脉冲，把从设备打懵。

  2. 按需配置核心参数：在复位状态下，你可以安全地配置所有寄存器。这里有一个逻辑上的最佳顺序，但并非硬件强制要求，因为你可以用一条32位写指令同时写入多个寄存器。不过，按这个顺序思考会更清晰：

    • 模式选择（MASTER_SLAVE）：首先确定主从身份。作为主设备，你需要负责产生时钟和片选；作为从设备，你只需等待。
    • 时钟极性与相位（CLKPOLARITY， CLK_PHASE）：这是SPI通信的“方言”，必须和从设备严格匹配。我习惯画一个时序图来确认。例如，CLKPOLARITY=0表示时钟空闲时为低电平；CLK_PHASE=0表示数据在时钟的第一个边沿（对于极性0就是上升沿）采样。常见的Mode 0就是(0,0)，Mode 3就是(1,1)。
    • 波特率（SPIBRR）：根据你的LSPCLK和期望的SPICLK频率计算。切记：对于从设备，这个寄存器无效，但主设备发出的时钟频率不能超过从设备LSPCLK的1/4，否则从设备可能无法正确采样。
    • 字符长度（SPICHAR）：设置一次传输的比特数，范围1-16。记住公式：写入SPICHAR的值 = 期望位数 - 1。要传8位数据，就写7。
    • FIFO与中断：如果需要使用FIFO增强功能，在此使能SPIFFENA，并设置TXFFIL和RXFFIL来定义中断触发的水位线。例如，设置RXFFIL=8，表示当接收FIFO中的数据达到或超过8个字时，才产生接收中断，这能有效降低中断频率。

  3. 释放复位（SPISWRESET = 1）：所有配置完成后，最后再将SPISWRESET置1。这个操作就像按下“启动按钮”，SPI模块会以你刚刚配置好的全新状态开始工作。此时，SPICLK会恢复到由CLKPOLARITY定义的空闲状态。

重要提示：手册中明确警告“Do not change the SPI configuration when communication is in progress.” 绝对不要在通信过程中修改配置！想象一下，在流水线全速运转时你去改传送带的转速，结果必然是数据混乱。任何配置变更都必须在SPISWRESET的保护下进行。

2.2 时钟模式选择的实战经验

CLKPOLARITY和CLK_PHASE这两个位的四种组合，是SPI调试中最常见的坑点。很多传感器、Flash芯片的datasheet会直接写明它支持SPI Mode 0, 1, 2, 3。你需要将其翻译成寄存器位：

  • Mode 0: CPOL=0, CPHA=0。时钟空闲低，数据在上升沿采样，下降沿变化。
  • Mode 1: CPOL=0, CPHA=1。时钟空闲低，数据在下降沿采样，上升沿变化。
  • Mode 2: CPOL=1, CPHA=0。时钟空闲高，数据在下降沿采样，上升沿变化。
  • Mode 3: CPOL=1, CPHA=1。时钟空闲高，数据在上升沿采样，下降沿变化。

一个快速判断的窍门：用示波器抓取一次通信。看时钟线在空闲时的电平，那就是CLKPOLARITY。再看数据线在时钟的哪个边沿稳定下来（即采样边沿），如果是在时钟的第一个边沿稳定，则CLK_PHASE=0；如果在第二个边沿稳定，则CLK_PHASE=1。我自己的项目里，大部分SPI Flash用的是Mode 0，而一些陀螺仪传感器则常用Mode 3。

2.3 高带宽模式（HS_MODE）配置要点

当你的系统时钟很高（比如100MHz），并且需要SPI跑在极限速度时，就需要启用HS_MODE。这不仅仅是设置一个位那么简单。手册中的例子很典型：

  1. 首先，需要将LSPCLK配置为与SYSCLK同频（即不分频）：ClkCfgRegs.LOSPCP.bit.LSPCLKDIV = 0;。这是前提，否则高速时钟无从谈起。
  2. 其次，必须在GPIO复用控制寄存器（GPxGMUX/GPxMUX）中选择高速SPI引脚模式。这是非常关键的一步！普通的GPIO复用路径可能无法支持这么高的翻转速率，必须切换到专用的高速通道。如果忽略这一步，即使软件配置正确，信号在引脚上也会出现畸变，导致通信失败。
  3. 然后，在SPI配置流程中，设置HS_MODE = 1。
  4. 最后，设置SPIBRR。例如，在100MHz SYSCLK下，设SPIBRR=3，则SPICLK = 100MHz / (3+1) = 25MHz。这就是该模式下能达到的最高时钟之一。

启用HS_MODE后，SPI模块的内部时序会进行优化��以支持更高的时钟频率。但请注意，此时对PCB布线和信号完整性的要求也更高，需要避免过长的走线和严重的反射。

3. 数据传输编程实践与3-Wire模式详解

理解了配置，下一步就是让数据动起来。TMS320F280013x的SPI数据传输围绕几个核心寄存器展开：SPIDAT（移位寄存器）、SPITXBUF（发送缓冲）、SPIRXBUF（接收缓冲）。数据流是这样的：当你把要发送的数据写入SPITXBUF，如果移位寄存器SPIDAT空闲，数据会立刻加载到SPIDAT中，并开始移位发送；如果SPIDAT正忙，数据会暂存在SPITXBUF中，等待当前传输结束自动载入。接收到的数据则从SPIDAT自动转存到SPIRXBUF，并置位中断标志INT_FLAG。

3.1 基础数据收发代码框架

一个典型的主设备发送-接收流程（非FIFO模式，查询方式）如下所示：

// 假设SPI已正确初始化为主模式 uint16_t SPI_MasterTransmitReceive(uint16_t txData) { // 等待发送缓冲区为空（确保上次数据已移入SPIDAT） while(SpiaRegs.SPISTS.bit.BUFFULL_FLAG == 1) { ; // 等待 } // 将数据写入发送缓冲区，启动传输 SpiaRegs.SPITXBUF = txData; // 等待接收完成（INT_FLAG置位） while(SpiaRegs.SPISTS.bit.INT_FLAG == 0) { ; // 等待 } // 读取接收到的数据，此操作会清除INT_FLAG uint16_t rxData = SpiaRegs.SPIRXBUF; return rxData; }

这段代码有几个细节需要注意：

  • 数据对齐：SPI总是先发送最高位（MSB）。当你配置的字符长度小于16位时（比如8位），你需要将发送数据左对齐写入SPITXBUF，而从SPIRXBUF读取的数据是右对齐的。例如，发送8位数据0xAB，应写入SPITXBUF = 0xAB00（左移8位）；接收时，读回的SPIRXBUF低8位才是有效数据。
  • 标志位检查：检查BUFFULL_FLAG可以避免覆盖尚未加载的数据。但在某些简单应用中，如果确保前后两次发送有足够间隔，也可以省略这一步，直接写入。
  • 中断标志清除：读取SPIRXBUF会自动清除INT_FLAG。绝对不要手动向INT_FLAG位写1来清除它，这是无效的。

3.2 3-Wire模式实战与内部回环

标准SPI需要4根线：SCLK, MOSI, MISO, CS。但在一些简单的半双工器件或为了节省引脚时，会用到3线模式（TRIWIRE=1）。此时，SPISIMO和SPISOMI在内部短接，数据收发共用一根数据线。

3线主模式发送：这时，主设备发送的数据也会被自己接收回来。所以，每次发送后，必须读取一次SPIRXBUF来清除这些“垃圾数据”，否则它会一直占用缓冲区。

SpiaRegs.SPICTL.bit.TALK = 1; // 开启发送路径 SpiaRegs.SPITXBUF = data_to_send; // 发送数据 while(SpiaRegs.SPISTS.bit.INT_FLAG != 1) {} // 等待 dummy = SpiaRegs.SPIRXBUF; // 关键！读回并丢弃自收数据

3线主模式接收：要接收从设备数据，主设备需要先关闭自己的发送输出（TALK=0），然后发送一个“哑元”数据来产生时钟，从而触发从设备发送。由于TALK=0，主设备的这个哑元数据不会出现在引脚上，从设备发送的数据则会被主设备接收。

SpiaRegs.SPICTL.bit.TALK = 0; // 关闭发送路径（高阻态） SpiaRegs.SPITXBUF = 0xFFFF; // 发送哑元数据，产生时钟 while(SpiaRegs.SPISTS.bit.INT_FLAG != 1) {} // 等待 real_data = SpiaRegs.SPIRXBUF; // 读取从设备发来的真实数据

内部回环测试（SPILBK）：这是一个极其有用的调试功能。将SPILBK位置1，SPI模块会在内部将发送端（SIMO）连接到接收端（SOMI），无需任何外部连线。你可以用它来验证SPI模块本身的软硬件配置是否正确。在编写驱动后，首先使能回环模式，发送一组已知数据并接收，如果回读数据一致，说明CPU侧的SPI配置、代码逻辑基本正确，可以排除软件问题，将焦点转向外部硬件连接。

4. FIFO与中断机制的高效应用

对于需要处理大量连续数据的应用，查询方式（Polling）会大量占用CPU资源。此时，必须祭出FIFO和中断这两大利器。TMS320F280013x的SPI FIFO深度为16级，可以显著平滑数据流。

4.1 FIFO模式配置步骤

  1. 使能FIFO增强功能：在SPIFFTX寄存器中，设置SPIFFENA = 1。
  2. 释放FIFO复位：将TXFIFO和RXFIFORESET（在SPIFFRX中）位从0改为1，使FIFO进入可操作状态。
  3. 设置中断水位线：这是平衡性能和实时性的关键。
    • TXFFIL（发送FIFO中断水平）：当发送FIFO中的剩余数据量小于或等于此值时，触发发送中断。通常设置为一个较小值（如2），这样当FIFO快空时，中断服务程序（ISR）能及时补充数据，避免发送断流。
    • RXFFIL（接收FIFO中断水平）：当接收FIFO中的数据量大于或等于此值时，触发接收中断。通常设置为一个较大值（如8或12），这样可以攒够一批数据再处理，减少中断次数。
  4. 使能中断：设置TXFFIENA和RXFFIENA为1，使能FIFO中断。同时，在非FIFO模式下使用的SPIINTENA和OVERRUNINTENA在FIFO模式下通常不再需要，因为状态由FIFO中断标志管理。

4.2 中断服务程序（ISR）编写要点

在FIFO中断ISR中，你的任务不再是处理单个数据，而是批量处理FIFO中的数据。

// 假设使用SPI-A，其FIFO接收中断服务例程 __interrupt void spiARxFifoIsr(void) { uint16_t i; // 1. 检查中断源，这里是接收FIFO中断 if(SpiaRegs.SPIFFRX.bit.RXFFINT == 1) { // 2. 获取当前接收FIFO中数据的数量 uint16_t rxFifoCount = SpiaRegs.SPIFFRX.bit.RXFFST; // 3. 批量读取数据 for(i = 0; i < rxFifoCount; i++) { g_spiARxBuffer[g_rxIndex++] = SpiaRegs.SPIRXBUF; // 注意：每读取一次SPIRXBUF，RXFFST会自动减1 } // 4. 清除接收FIFO中断标志（写1清零） SpiaRegs.SPIFFRX.bit.RXFFINTCLR = 1; } // 5. 清除PIE组中断应答，必不可少！ PieCtrlRegs.PIEACK.all = PIEACK_GROUP6; // SPI-A通常属于PIE组6 }

关键注意事项：

  • 中断标志清除顺序：必须先处理数据，再清除硬件中断标志（RXFFINTCLR/TXFFINTCLR）。如果先清标志，可能在清标志和处理数据的极短间隙内，又有新数据到达并立即触发了新的中断，导致你漏掉数据。
  • 防止溢出：始终监控RXFFOVF标志。如果因为处理不及时导致接收FIFO溢出（超过16个数据），最早的数据会丢失。一个健壮的程序应该在ISR中或主循环里检查此标志。
  • 发送FIFO中断的使用：在需要持续发送大量数据的场景（如刷新屏幕），可以在TX FIFO中断ISR中补充数据。但更常见的做法是使用DMA（如果支持）来搬运数据到SPI，或者在主循环中根据TXFFST（发送FIFO状态）来提前填充数据，避免发送中断过于频繁。

4.3 发送延迟（TXDLY）的应用

SPIFFCT寄存器中的TXDLY位用于控制FIFO中的数据转移到发送移位寄存器SPIDAT之间的延迟周期数。这个功能在某些特定时序要求的从设备上非常有用。例如，有些SPI Flash芯片在两次传输之间需要一段最小的时间间隔（tCSH）。通过设置TXDLY，你可以自动插入这段空闲时间，而无需CPU干预。延迟时间 =TXDLY* SPI串行时钟周期。通常，除非从设备数据手册有明确要求，否则保持TXDLY为0即可。

5. 典型问题排查与寄存器调试心得

即使按照手册一步步来，SPI调试也难免遇到问题。以下是我总结的几个常见故障场景和排查思路，这往往是数据手册不会告诉你的“战场经验”。

5.1 常见问题速查表

现象可能原因排查步骤与解决方案
完全无通信，时钟线无波形1. SPI模块未使能（SPISWRESET=0）
2. GPIO引脚复用未配置为SPI功能
3. 主模式下TALK位未置1
4. 从模式下主设备未拉低片选(SPISTE)		1. 检查SPICCR.7是否为1。
2. 核对GPxMUX/GPxGMUX寄存器，确保引脚已映射到SPI。
3. 主设备检查SPICTL.1 (TALK) 是否为1。
4. 用示波器测量片选信号，确认从设备被选中。
有时钟波形，但数据线无输出或全高/全低1. 发送数据未正确写入SPITXBUF或SPIDAT
2. 在3线模式下，TALK位状态错误
3. 字符长度(SPICHAR)配置错误，导致数据未移位		1. 单步调试，确认写SPITXBUF的指令已执行，且数据值正确。
2. 检查TALK位：发送时应为1，接收时应为0（3线主模式）。
3. 确认SPICHAR设置与预期发送位数匹配（值=位数-1）。
能发送，但接收数据全为0或固定值1. 从设备未正确响应或硬件连接错误（MISO断线）
2. 时钟极性/相位(CPOL/CPHA)与从设备不匹配
3. 接收中断标志未清除，导致新数据无法存入		1. 先使用内部回环模式(SPILBK=1)自检，排除软件问题。
2. 用示波器同时抓取CLK和MISO，比对从设备数据手册时序图。
3. 确保在读取SPIRXBUF后，INT_FLAG已被自动清除。
通信速度远低于预期1. 波特率寄存器SPIBRR计算或设置错误
2. LSPCLK时钟源配置错误，分频过大
3. 未启用高速模式(HS_MODE)，但使用了高波特率		1. 根据公式SPICLK = LSPCLK/(SPIBRR+1)重新计算。
2. 检查系统时钟配置寄存器，确认LSPCLK的分频系数。
3. 若需高波特率（如>10MHz），检查并启用HS_MODE及对应高速引脚复用。
使用FIFO中断时，数据丢失或混乱1. FIFO中断水位线(RXFFIL/TXFFIL)设置不合理
2. 中断服务程序(ISR)未及时读取或清除数据
3. 接收FIFO溢出(RXFFOVF被置位)		1. 调整RXFFIL，避免中断过于频繁或数据堆积溢出。
2. 在ISR中，应一次性读取RXFFST指示的所有数据。
3. 在ISR或主循环中检查RXFFOVF标志，并做错误处理。
多字节传输时，字节间出现额外时钟1. 在非FIFO模式下，CPU写入下一个SPITXBUF的速度慢于SPI移位速度
2. 在FIFO模式下，TXDLY参数被误设置		1. 确保在INT_FLAG置位（上次传输完成）后，立即写入下一个数据。
2. 检查SPIFFCT.TXDLY，若无需字节间隔，应设为0。

5.2 寄存器级调试技巧

当逻辑分析仪或示波器显示波形异常时，最直接的排查方法就是“冻结”现场，查看SPI相关寄存器的状态。

  1. 检查状态寄存器（SPISTS）：这是第一落脚点。

    • INT_FLAG为1了吗？如果一直为0，说明一次完整的移位都未完成，检查时钟和片选。
    • BUFFULL_FLAG为1？说明你写的数据还在缓冲区，没加载到移位寄存器，可能上次传输还没结束或SPI未正确启动。
    • OVERRUN_FLAG为1？这是个大问题，说明接收到的数据还没被读取，就被新数据覆盖了。你的接收程序太慢了，或者中断被意外关闭。

  2. 确认配置寄存器（SPICCR， SPICTL）：在怀疑配置问题时，可以在调试器中直接查看这些寄存器的值。重点核对：

    • SPISWRESET：必须为1。
    • MASTER_SLAVE：主从模式是否正确。
    • CLKPOLARITY和CLK_PHASE：是否与从设备匹配。
    • SPICHAR：字符长度设置。一个低级错误是想要传8位却写了8（正确应写7）。

  3. 利用仿真缓冲寄存器（SPIRXEMU）：这个寄存器是个“神器”。在调试时，如果你单步执行，每读一次SPIRXBUF就会清除一次INT_FLAG，这可能会打断你的观察。而读取SPIRXEMU可以得到同样的数据，但不会清除INT_FLAG。这样你就可以反复查看接收到的数据值，而不会影响状态机的运行，对于分析复杂通信序列非常有用。

5.3 关于数字音频与STEINV位的特别说明

在需要接收I2S格式数字音频（如左右声道交替）的应用中，TMS320F280013x的双SPI模块配合STEINV位提供了一个巧妙的解决方案。如图19-11所示，可以将两个SPI模块的时钟、数据线并联，主设备（音频接收器）的左右声道时钟（L/R CLK）分别连接到两个SPI的片选（SPISTE），其中一个SPI的STEINV位置1，使其片选高有效。

这样，当左声道数据到来时（L/R CLK为高），STEINV=1的SPI-B被选中，接收左声道数据；当右声道数据到来时（L/R CLK为低），STEINV=0的SPI-A被选中，接收右声道数据。两个SPI模块可以独立产生中断，CPU只需分别读取它们的接收缓冲区，就能自然地将左右声道数据分离。这种方法节省了一个外部解复用逻辑，但要注意，它要求SPI的时钟相位（CLK_PHASE）等配置必须与音频数据格式严格匹配，如图19-12所示的右对齐格式。

最后，关于代码资源，TI提供的C2000Ware库是绝佳的起点。spi_ex1_loopback.c用于基础验证，spi_ex2_loopback_fifo_interrupts.c展示了FIFO中断的完整用法，而spi_ex6_eeprom.c则是一个连接外部SPI EEPROM的实战范例，包含了具体的命令序列和等待忙状态的处理，极具参考价值。我的习惯是，在一个新项目上电后，先跑通loopback例程，确保硬件最小系统和基础软件配置无误，然后再逐步叠加自己的应用逻辑，这样能最大程度地降低调试的复杂度。

http://www.jsqmd.com/news/1228252/

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