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AM62Px DCC时钟监控：从原理到配置，构建嵌入式系统时钟安全防线

news 2026/7/21 6:33:20

1. 项目概述

在嵌入式系统，尤其是汽车电子和工业控制这类对可靠性要求极高的领域，系统时钟的稳定性是生命线。一个微小的时钟漂移或失效，轻则导致通信丢包、数据错误，重则可能引发整个控制系统的连锁故障。因此，如何实时、准确地监控关键时钟信号，成为系统设计中的核心挑战。硬件层面的双时钟比较器（Dual Clock Comparator, DCC）正是为此而生的“哨兵”。

DCC本质上是一个硬件计时器，它通过比较两个独立时钟源的计数，来判断其中一个时钟是否发生了超出预设范围的偏差。与软件轮询相比，DCC是纯硬件实现，响应速度快，不占用CPU资源，且能在CPU异常时仍能工作，这对于满足功能安全标准（如ISO 26262 ASIL等级）至关重要。

德州仪器的AM62Px Sitara处理器系列，作为面向边缘计算和工业应用的强大平台，其内部集成了多达11个独立的DCC模块实例（DCC0-DCC8， MCU_DCC0， MCU_DCC1）。这些模块分布在不同的电源域（MAIN, MCU, WKUP），为系统各个部分的时钟提供了全方位的监控能力。然而，技术手册中庞杂的时钟源映射表和中断路由信息，常常让开发者望而生畏。如何从这些表格中快速理清脉络，为特定的监控需求配置正确的时钟源和中断，是实际开发中的第一个拦路虎。

本文将深入解析AM62Px处理器中DCC模块的时钟源映射与中断配置逻辑。我不会仅仅复述手册中的表格，而是结合我多年在功能安全系统开发中的经验，带你理解这些配置背后的设计意图，手把手教你如何根据实际应用场景选择时钟源、计算参数、配置中断，并分享那些手册上不会写的调试技巧和避坑指南。无论你是正在评估AM62Px用于新项目，还是正在为现有设计添加时钟健康监控，这篇文章都将为你提供一份清晰的“作战地图”。

2. DCC模块核心原理与AM62Px架构解析

2.1 双时钟比较器（DCC）工作原理精讲

要玩转DCC，首先得吃透它的工作原理。你可以把DCC想象成两个并行的“秒表”。一个秒表（我们称之为计数器1，Counter1）由你需要监控的“被测时钟”（CLK_SRC1）驱动；另一个秒表（计数器0，Counter0）则由一个理论上更稳定、作为参考的“基准时钟”（CLK_SRC0）驱动。

DCC的工作流程是周期性的：

  1. 初始化与装载：软件向两个计数器分别写入一个初始值（通常是一个很大的数，比如0xFFFFFFFF）。
  2. 同步启动：使能DCC后，两个计数器开始同时向下计数。
  3. 监控与比较：DCC内部逻辑会持续比较两个计数器的值。由于两个时钟频率不同，它们的计数速度自然不同。DCC的“比较窗口”就是关键所在。我们通过配置一个“有效计数”范围（例如，设定Counter0在计数到A和B之间时，Counter1的值必须在X和Y之间）。
  4. 错误判定：如果在Counter0计数到预设的窗口内，Counter1的计数值落在了窗口之外，DCC就会立即触发一个错误（Error）信号。如果Counter1在Counter0计数到某个特定值之前就减到0，则会触发一个完成（Done）信号。Done信号可用于周期性触发，而Error信号则用于故障报警。

这里的关键在于，我们并不要求两个时钟频率绝对相等，而是预期它们在一个确定的、可计算的比值范围内运行。这个比值由两个时钟的频率和预设的计数值共同决定。这给了我们巨大的灵活性，可以用一个低频但稳定的时钟（如32K RC振荡器）去监控一个高频的系统时钟（如来自PLL的几百MHz时钟）。

2.2 AM62Px DCC模块布局与设计意图

AM62Px的DCC模块布局体现了其复杂的电源域和可靠性设计：

  • MAIN域DCC (DCC0-DCC8)：这9个实例位于主电源域，用于监控MAIN域内丰富的时钟资源，包括各个PLL的输出（MAIN_PLL0/1/2/5/15/16/17/18）、外部参考时钟、内部RC振荡器，甚至是一些外设的时钟引脚（如MCASP音频串口时钟、RMII以太网时钟）。这确保了核心应用处理器（如A53核）、高速外设和总线时钟的可靠性。
  • MCU域DCC (MCU_DCC0, MCU_DCC1)：这两个实例位于微控制器单元（MCU）域，通常用于监控MCU相关的时钟，如MCU_PLL0的输出、MCU域的系统时钟（MCU_SYSCLK0）以及始终开启的32K/12M RC时钟。MCU域通常在系统深度睡眠时保持运行，因此这里的DCC对于监控低功耗状态下的时钟至关重要。
  • “Always-On”电源域：从手册的“Integration Attributes”表可以看到，所有DCC模块的“Module Domain”都被分配在LPSC_main_alwayson或LPSC_mcu_alwayson，且“Default Controllable”为“NO”。这意味着DCC模块在默认状态下是常开的，且软件无法关闭其电源。这是一个非常重要的安全设计：即使系统其他部分进入低功耗状态，时钟监控依然在工作，确保唤醒和关键安全功能的时钟基础是可靠的。

> 注意：理解DCC所在的电源域和其“Always-On”属性，是进行系统级电源管理和功能安全分析的基础。你不能为了省电而关闭DCC，它的存在就是为了在低功耗模式下充当守夜人。

2.3 时钟源分类与选择策略

面对每个DCC实例多达十余种的时钟源选项，盲目选择是不可取的。我们需要将其分类，根据监控目标做出决策：

  1. 基准时钟源（CLK_SRC0）选择：

    • 高稳定性优先：基准时钟的稳定性直接决定了监控的准确性。应优先选择抖动小、温漂低的时钟源。
    • 内部RC振荡器：如CLK_32K_RC和CLK_12M_RC。它们通常精度一般（±1% ~ ±5%），但独立于外部元件，可靠性高。适合作为监控其他内部时钟的基准，或者在外部晶振失效时作为备份基准。
    • 外部晶振：如EXT_REFCLK1。这是精度和稳定性最高的选择，通常用于监控系统中最重要的时钟（如主PLL输出）。
    • 低频分频时钟：如MAIN_SYSCLK0/4或MCU_SYSCLK0/4。将系统时钟分频后作为基准，可以用于监控同源但不同分支的时钟，但需注意共因失效风险。

  2. 被测时钟源（CLK_SRC1）选择：

    • 关键路径时钟：这是你需要重点监控的对象。例如：
      • 供给CPU核心的PLL输出时钟（MAIN_PLL0_HSDIV1_CLKOUT）。
      • 供给DDR内存控制器的时钟（DDR32SS0）。
      • 用于关键通信的外设时钟（如以太网的RMIIx_REF_CLK）。
    • 灵活性利用：DCC1的时钟源列表里出现了A53SS0 (INSTANCE)/4，这意味着你可以直接用CPU子系统的时钟作为被测源，直接监控CPU核心时钟是否运行在预期频率。

  3. 功能与接口时钟（FICLK）：

    • 每个DCC模块自身还需要一个工作时钟FICLK，用于寄存器访问和内部逻辑。它通常被固定连接到某个低速的、稳定的时钟分频上（如MAIN_SYSCLK0/4）。这个时钟不需要你选择，但需要知道它的存在，因为它决定了你对DCC模块进行配置（读写寄存器）的时钟频率。

实操心得：在设计初期，就应列出系统的“关键时钟清单”。为每个关键时钟分配一个DCC实例，并为其选择一个更稳定的基准时钟。例如，用外部24MHz晶振（EXT_REFCLK1）作为基准，去监控为CPU提供的800MHz PLL时钟（MAIN_PLL0_HSDIV1_CLKOUT）。对于MCU域，则可以用内部的CLK_32K_RC去监控MCU_PLL0_HSDIV0_CLKOUT。

3. 时钟源映射表深度解读与配置实战

技术手册中的Table 4-326到Table 4-336是配置的核心，但直接看容易眼花。我们来将其转化为可操作的逻辑。

3.1 映射表结构解密

以Table 4-326. DCC0 Input Source Clock Mapping为例，其逻辑关系如下：

Domain Input (模块输入)Input/ MUXDCCCLKSRC0/ DCCCLKSRC1 ValueClock Source (时钟源)
DCC_INPUT00_CLK00CLK_12M_RC
DCC_INPUT00_CLK00HFOSC0 (INSTANCE)
DCC_INPUT01_CLK01EXT_REFCLK1
............
DCC_CLKSRC0_CLK11MAIN_PLL0_HSDIV1_CLKOUT
DCC_CLKSRC1_CLK12MAIN_PLL0_HSDIV2_CLKOUT
............
FICLK19MAIN_SYSCLK0/4
  • Domain Input：表示DCC模块的硬件输入引脚/信号名。
  • Input/MUX：这是一个关键的选择位。它对应DCC控制寄存器中的某个配置字段（例如CLKSRC1_SEL或CLKSRC0_SEL）。0通常代表选择“Primary”或“Secondary”振荡器输入（即DCC_INPUTxx_CLK），而1代表选择“Counter1 clock source”输入（即DCC_CLKSRCx_CLK）。
  • DCCCLKSRC0/1 Value：当Input/MUX位选定后，这个值用于进一步选择该组内的具体时钟源。它对应寄存器中更细粒度的选择字段。
  • Clock Source：最终连接到该输入的具体芯片内部时钟信号。

核心配置流程：

  1. 确定你想用哪个时钟作为基准（CLKSRC0），哪个作为被测（CLKSRC1）。
  2. 在对应DCC实例的映射表中，分别找到这两个时钟源所在的行。
  3. 记录下它们对应的Input/MUX和DCCCLKSRCx Value。
  4. 在软件初始化时，将这两个值写入DCC模块的配置寄存器（通常是CLKSRC0_SEL,CLKSRC0,CLKSRC1_SEL,CLKSRC1等字段）。

3.2 配置实例：用DCC0监控主PLL时钟

场景：我们需要用DCC0来监控MAIN_PLL0_HSDIV1_CLKOUT（假设为系统核心时钟，1000MHz）是否正常。选择一个稳定的外部24MHz晶振（EXT_REFCLK1）作为基准。

步骤拆解：

  1. 确定时钟角色：
    • 基准时钟 CLKSRC0：EXT_REFCLK1(24MHz)
    • 被测时钟 CLKSRC1：MAIN_PLL0_HSDIV1_CLKOUT(1000MHz)
  2. 查表（Table 4-326）：
    • 对于EXT_REFCLK1：找到DCC_INPUT01_CLK行，Input/MUX=0,Value=1。
    • 对于MAIN_PLL0_HSDIV1_CLKOUT：找到DCC_CLKSRC0_CLK行，Input/MUX=1,Value=1。
  3. 计算预期计数值： DCC的误差检测基于计数。我们需要设定一个“有效窗口”。假设我们允许被测时钟有±1%的误差。
    • 基准时钟频率F_ref = 24 MHz
    • 被测时钟标称频率F_test_nom = 1000 MHz
    • 预期频率比R_nom = F_test_nom / F_ref ≈ 41.6667
    • 允许的频率比范围：R_low = R_nom * 0.99 ≈ 41.25,R_high = R_nom * 1.01 ≈ 42.0833
    • 我们需要设定一个基准时钟的计数种子SEED0。假设设为0xFFFF（65535）。那么，在被测时钟频率正常时，当基准计数器从SEED0向下计数到0时，被测计数器的值VAL1应在SEED0 * R_low到SEED0 * R_high之间。
    • 计算：VAL1_expected = SEED0 * R_nom ≈ 65535 * 41.6667 ≈ 2,730,729
    • 窗口下限：65535 * 41.25 ≈ 2,703,669
    • 窗口上限：65535 * 42.0833 ≈ 2,757,789
    • 因此，我们可以将DCC的错误窗口设置为：当基准计数器CNT0在某个范围内（例如，从SEED0到SEED0 - N）时，检查CNT1是否在[2,703,669, 2,757,789]之间，超出则报错。实际上，DCC寄存器通常允许你直接设置一个有效计数上限和下限。
  4. 软件配置伪代码：
    // 假设 DCC0 寄存器基地址为 DCC0_BASE // 1. 禁用 DCC (在配置前必须禁用) HW_WR_REG32(DCC0_BASE + DCC_CTRL_REG, 0x0); // 2. 配置时钟源选择寄存器 (CLKSRC0/1) // 寄存器位域假设：CLKSRC0_SEL[8], CLKSRC0[7:4], CLKSRC1_SEL[3], CLKSRC1[2:0] uint32_t clksrc_cfg = 0; clksrc_cfg |= (0 << 8); // CLKSRC0_SEL = 0 (选择 INPUT 组) clksrc_cfg |= (1 << 4); // CLKSRC0 = 1 (对应 Value=1， 选择 DCC_INPUT01_CLK -> EXT_REFCLK1) clksrc_cfg |= (1 << 3); // CLKSRC1_SEL = 1 (选择 CLKSRC 组) clksrc_cfg |= (1 << 0); // CLKSRC1 = 1 (对应 Value=1， 选择 DCC_CLKSRC0_CLK -> MAIN_PLL0_HSDIV1_CLKOUT) HW_WR_REG32(DCC0_BASE + DCC_CLKSRC_REG, clksrc_cfg); // 3. 配置计数器种子和有效窗口 HW_WR_REG32(DCC0_BASE + DCC_CNT0_SEED_REG, 0xFFFF); // 基准计数器种子 // 设置有效窗口。假设寄存器 WINDOW_HIGH_REG 和 WINDOW_LOW_REG 定义窗口边界。 // 这里填入计算出的值，注意寄存器可能要求的是相对于种子的偏移或绝对值，需查阅具体寄存器描述。 HW_WR_REG32(DCC0_BASE + DCC_VALID_LOW_REG, 2703669); // 窗口下限 HW_WR_REG32(DCC0_BASE + DCC_VALID_HIGH_REG, 2757789); // 窗口上限 // 4. 配置中断（可选，见下一章） // 5. 使能 DCC HW_WR_REG32(DCC0_BASE + DCC_CTRL_REG, DCC_CTRL_ENABLE_MASK);

> 注意：上述代码中的寄存器偏移和位域是假设的，用于说明逻辑。实际开发中，你必须严格参考AM62Px的技术参考手册（TRM）中DCC章节的具体寄存器定义。不同系列的处理器，甚至同一系列不同型号，寄存器细节都可能不同。

4. 中断配置与系统集成

DCC检测到事件（完成或错误）后，需要通过中断通知系统。AM62Px的中断路由系统非常灵活，也略显复杂。

4.1 中断信号与目的地解析

查看Table 4-325. Hardware Requests for DCC，我们可以看到每个DCC实例产生的中断信号去向：

Module InstanceModule Interrupt SignalDestinationDescription
DCC0DCC0_intr_done_level_0GICSS0_spi_128完成中断
DCC0DCC0_intr_done_level_0WKUP_R5FSS0_CORE0_intr_109完成中断
DCC0DCC0_intr_done_level_0MCU_R5FSS0_CORE0_cpu0_intr_109完成中断
DCC0DCC0_intr_err_level_0ESM0_esm_lvl_event_112错误中断

关键发现：

  1. 多目的地广播：同一个中断信号（如DCC0_intr_done_level_0）可以同时路由到多个目的地。例如，DCC0的完成中断可以同时送到通用中断控制器（GICSS0）、唤醒域R5F核心（WKUP_R5FSS0）和MCU域R5F核心（MCU_R5FSS0）。这提供了冗余和灵活性：你可以让一个核心处理常规完成事件，同时让另一个核心或ESM处理致命错误。
  2. 中断类型：_level表示电平触发中断，_pulse表示脉冲触发（在其他模块如TIMER中常见）。DCC主要使用电平触发。
  3. 错误信令管理器（ESM）：错误中断（_err_level_0）被路由到了ESM0。ESM是TI处理器中用于功能安全的关键模块，它可以对不同安全等级的错误进行分类、聚合，并触发最高级别的安全响应（如复位、报警输出）。将DCC错误连接到ESM，是实现功能安全架构的关键一步。

4.2 中断配置实战步骤

配置DCC中断，不仅仅是配置DCC模块本身，还需要在中断控制器（如GIC）和处理器核心侧进行设置。

步骤1：确定中断处理主体

  • 完成中断：通常由运行在A53或R5F上的应用程序或操作系统处理。用于周期性任务触发或状态查询。
  • 错误中断：强烈建议路由到ESM，并配置ESM在收到该错误时触发预定义的安全动作（如产生一个错误引脚输出、触发系统复位）。同时，也可以路由到一个R5F核心，用于记录��误日志。

步骤2：软件配置流程（以DCC0错误中断送ESM和R5F为例）

  1. 配置DCC模块中断使能：在DCC的寄存器中，使能错误中断输出。
    // 使能 DCC0 错误中断 HW_WR_REG32(DCC0_BASE + DCC_INT_ENABLE_REG, DCC_ERR_INT_EN_MASK);
  2. 配置系统中断路由器（如INTRTR）：AM62Px有一个复杂的中断路由网络。你需要确认DCC0_intr_err_level_0到ESM0_esm_lvl_event_112和MCU_R5FSS0_CORE0_cpu0_intr_109的路由在硬件上是固定的，还是需要通过某个路由器的寄存器来映射。根据手册，这些映射通常是固定的，但需要查阅“Interrupt Router”章节确认。
  3. 配置ESM模块：
    // 假设 ESM0 基地址 // 1. 使能对应的事件（event 112）为错误输入 HW_WR_REG32(ESM0_BASE + ESM_IEPSR4_REG, (1 << (112-96))); // 假设112号事件在EPSR4寄存器 // 2. 配置该错误事件的严重性等级（例如，配置为高错误，触发错误引脚） HW_WR_REG32(ESM0_BASE + ESM_SSR2_REG, (ESM_ERROR_LEVEL_HIGH << (2*(112-96)))); // 3. 使能ESM HW_WR_REG32(ESM0_BASE + ESM_CTRL_REG, ESM_CTRL_ENABLE_MASK);
  4. 配置R5F核心中断控制器（如VIM或GIC）：
    // 在 MCU R5F 侧，配置中断109 // 1. 在GIC（或VIM）中使能中断109 enable_irq(109); // 2. 设置中断109的优先级 set_irq_priority(109, 5); // 3. 注册中断服务函数 register_interrupt_handler(109, dcc0_error_isr);

步骤3：编写中断服务程序（ISR）

void dcc0_error_isr(void) { // 1. 读取DCC0状态寄存器，确认是错误中断 uint32_t status = HW_RD_REG32(DCC0_BASE + DCC_STATUS_REG); if (status & DCC_ERR_STATUS_MASK) { // 2. 记录错误信息（时间、计数器值等） log_error("DCC0 Error detected! CNT0=0x%x, CNT1=0x%x", HW_RD_REG32(DCC0_BASE + DCC_CNT0_VAL_REG), HW_RD_REG32(DCC0_BASE + DCC_CNT1_VAL_REG)); // 3. 清除DCC0错误标志（写1清除） HW_WR_REG32(DCC0_BASE + DCC_STATUS_REG, DCC_ERR_STATUS_MASK); // 4. 执行恢复操作，例如：切换备份时钟源、重启外围设备、上报等 take_safety_measures(); } // 5. 清除中断控制器中的中断挂起位 clear_irq_pending(109); }

> 实操心得：中断风暴防范DCC错误中断是电平触发。如果时钟完全失效，错误状态会一直持续，导致中断不断触发。在ISR中，必须在处理错误后及时清除DCC模块内部的错误状态标志，否则会形成“中断风暴”，导致系统瘫痪。同时，在ESM侧，也需要根据配置决定是锁存错误还是自动清除。

5. 常见问题排查与调试技巧实录

即使按照手册配置，在实际硬件调试中也可能遇到各种问题。以下是我在多个项目中总结的常见坑点和排查方法。

5.1 DCC模块无法启动或始终无中断

  • 症状：配置完成后，使能DCC，但状态寄存器无变化，永远不产生完成或错误中断。
  • 排查清单：
    1. 时钟源是否有效？这是最常见的问题。用示波器或逻辑分析仪确认你选择的CLKSRC0和CLKSRC1信号是否真的存在且频率符合预期。特别是PLL输出的时钟，需要确认PLL已经锁定并输出。
    2. DCC模块是否已解复位？检查DCC的复位状态。根据Table 4-324，所有DCC的复位源都是PSC0或WKUP_PSC0。你需要确保在配置DCC前，已通过Power Sleep Controller (PSC) 模块解除了对应DCC实例的复位（PD状态为ON）。对于Always-On域的模块，上电后可能默认就是解复位状态，但最好在代码中显式确认。
    3. FICLK功能时钟是否提供？DCC模块自身的寄存器访问需要FICLK。虽然它通常自动连接，但需要确认其源时钟（如MAIN_SYSCLK0/4）是存在的。如果连配置寄存器都写不进去或读出来不对，首先怀疑FICLK。
    4. 计数器种子值是否合理？如果种子值SEED0设置得太小，计数器很快减到0，你可能错过了观察窗口。尝试设置一个较大的值（如0xFFFFFFFF）。同时，确保有效窗口VALID_LOW和VALID_HIGH的设置与你的时钟频率比匹配。
    5. 软件使能步骤是否正确？确保配置顺序是：先禁用DCC -> 配置所有参数（时钟源、种子、窗口）-> 最后使能DCC。如果在使能状态下修改关键配置，行为是未定义的。

5.2 中断无法触发或错误触发

  • 症状：DCC状态显示有错误（ERR位置位），但CPU收不到中断；或者相反，没有错误却产生了中断。
  • 排查清单：
    1. 中断路由路径是否畅通？这是最复杂的部分。你需要画一个中断信号流图：DCC -> Interrupt Router -> GIC/ESM -> CPU。使用芯片的寄存器查看工具，逐级检查：
      • DCC的中断输出是否使能？
      • 中断路由器（如果可配）是否将信号映射到了正确的目的地输入？
      • GIC/ESM中，对应的中断号是否被使能？优先级是否设置？
      • CPU核心的中断总开关（如CPSR的I位）是否打开？
    2. 电平中断的保持与清除：DCC错误中断是电平触发。如果错误条件持续存在（如时钟一直偏差），中断线会一直保持低电平有效。在ISR中，你必须先清除DCC本地的错误状态，中断信号才会撤销。如果清除后中断依然持续，检查是否有其他模块驱动了同一中断线。
    3. ESM配置是否正确？如果使用ESM，检查ESM对应的事件输入是否使能，错误级别配置是否正确。ESM可能有自己的错误状态寄存器和清除机制。
    4. 共享中断问题：注意DCC0_intr_done_level_0同时送给了GIC、WKUP_R5F和MCU_R5F。如果三个地方都使能了中断，任何一个处理器核心清除了中断源，其他核心的中断也可能被清除。需要协调好多个核心对同一中断源的处理逻辑。

5.3 性能考量与计算精度

  • 问题：DCC的监控精度和响应速度如何权衡？
  • 分析与技巧：
    • 精度：DCC的精度取决于基准时钟的稳定性和计数器位数（通常是32位）。对于32位计数器，假设基准时钟为32.768kHz，最大可计数时间约为2^32 / 32768 ≈ 36小时。在这个时间尺度上，检测微小频率漂移是可行的。但检测瞬时毛刺能力有限。
    • 响应速度：错误检测的延迟取决于你设置的SEED0和有效窗口。SEED0越大，完成一次计数比较的周期越长，检测到错误的延迟也越长。对于需要快速响应的关键时钟，应设置较小的SEED0，但这会降低频率比的分辨率。
    • 实践建议：分层监控。对于CPU核心时钟这类最关键、且可能快速失效的时钟，使用一个DCC实例配置为小SEED0（快速检测）。对于外部参考时钟这类变化慢但要求绝对稳定的时钟，使用另一个DCC实例配置为大SEED0（高精度监测）。AM62Px提供了11个DCC实例，足够你构建一个分层的时钟监控网络。

5.4 功能安全（FuSa）场景下的特殊配置

  • 需求：在ASIL-D等级系统中，DCC模块本身也需要被监控，防止其自身失效。
  • 解决方案：DCC自检（Self-Test）。许多DCC模块支持软件触发一次自检序列。通常流程是：
    1. 软件设置一个已知的、会触发错误的窗口参数。
    2. 启动一次单次（One-Shot）比较操作。
    3. 预期DCC应产生一个错误中断。
    4. 在中断服务程序中验证错误标志，并清除。
    5. 如果收到了预期的中断，说明DCC的比较逻辑和中断通路基本正常。
    • 注意：自检不能覆盖所有故障模式（如时钟输入断路），但能有效检测核心逻辑的固定型故障���需要定期（如每次上电或每N个运行小时）执行自检。

调试DCC就像给系统安装了一个高精度的“心跳监护仪”。初期配置会有些繁琐，但一旦调通，它将成为系统可靠性的坚实基石。最重要的经验是：充分利用芯片提供的多实例资源，为不同安全等级和性能要求的时钟分配独立的DCC，并务必在硬件设计阶段就规划好关键时钟的测试点，以便后期用示波器进行对比验证。当你看到DCC在时钟发生微小偏差时准确触发中断，那种对系统“了如指掌”的感觉，是软件监控永远无法给予的。

http://www.jsqmd.com/news/1232951/

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