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TM4C129 GPIO寄存器深度解析：从位寻址到中断与复用实战

news 2026/7/23 1:44:25

1. 项目概述与GPIO核心价值

在嵌入式开发的日常里，GPIO（通用输入输出）模块就像是我们与物理世界对话的“嘴巴”和“耳朵”。无论是点亮一个LED，读取一个按键，还是与传感器、显示屏通信，都离不开它。对于使用德州仪器Tiva™ C系列，特别是TM4C129DNCPDT这款基于ARM Cortex-M4内核的微控制器的工程师来说，深入理解其GPIO模块，尤其是其寄存器级的配置逻辑，是摆脱库函数依赖、编写高效稳定底层驱动、乃至进行系统级优化的基本功。很多人刚开始接触时，可能只满足于调用GPIOPinWrite或GPIOPinRead这样的API，但当你遇到时序要求苛刻、中断响应不及时、或者引脚功能冲突的棘手问题时，翻看数据手册，直接操作寄存器往往是唯一的出路。

TM4C129DNCPDT的GPIO模块远不止简单的“高低电平”控制。它提供了高达98个可编程引脚（取决于具体封装和外围设备使用情况），每个引脚都可以在纯数字IO、模拟输入以及多达十几种外设功能（如UART、SPI、I2C、PWM等）之间灵活切换。更关键的是，它内置了精细的引脚控制能力：可编程的2mA到12mA驱动强度、可选的压摆率控制、内部上拉/下拉电阻、开漏输出模式，以及复杂的中断和触发系统，甚至可以直接触发ADC采样或µDMA传输。这一切功能的背后，都是一组组精心设计的寄存器。理解它们，就意味着你拿到了直接与硬件对话的钥匙，能够根据项目需求，精准地调配每一个IO引脚的“性格”和“能力”，从而在资源受限的嵌入式环境中榨取出每一分性能。

2. GPIO模块架构与寄存器全景解析

要驾驭TM4C129DNCPDT的GPIO，首先得在脑海中建立起它的架构图。整个GPIO模块由15个独立的物理端口块（Port A到Port Q）组成，每个端口块对应一组寄存器。这些寄存器大致可以划分为几个功能集群：数据控制、模式控制、中断控制、Pad（焊盘）控制以及识别与提交控制。

2.1 核心寄存器功能分类

  1. 数据与方向寄存器：这是GPIO最基础的部分。

    • GPIODATA：数据寄存器。这是你读取引脚电平或设置输出电平的地方。它的设计非常巧妙，支持位寻址（通过地址线掩码），允许你单独修改某个引脚而不影响同端口其他引脚的状态，避免了传统的“读-修改-写”操作可能带来的竞态风险。
    • GPIODIR：方向寄存器。每一位决定对应引脚是输入（0）还是输出（1）。

  2. 模式与复用控制寄存器：决定引脚扮演什么角色。

    • GPIOAFSEL：复用功能选择寄存器。置位相应位，则引脚由对应外设（如UART、SPI）控制；清零则由软件通过GPIODATA控制。
    • GPIOPCTL：端口控制寄存器。这是引脚复用的“总调度台”。当GPIOAFSEL选择硬件控制后，GPIOPCTL中的PMCx（端口复用控制）字段进一步指定具体是哪一个外设功能。例如，PA0引脚可以复用为UART0_RX、CAN0_RX、Timer0捕获等多种功能，具体选择哪一个，就由GPIOPCTL中对应PA0的4位字段值决定。

  3. 中断控制寄存器组：实现高效的事件响应。

    • GPIOIS：中断触发类型选择（电平触发或边沿触发）。
    • GPIOIBE：双边沿触发使能。
    • GPIOIEV：单边沿触发时，选择上升沿或下降沿；电平触发时，选择高电平或低电平。
    • GPIOIM：中断掩码寄存器。只有在此寄存器中使能的引脚，其中断信号才能传递到NVIC（嵌套向量中断控制器）。
    • GPIORIS：原始中断状态寄存器。只要引脚满足中断条件，无论是否被屏蔽，对应位都会置1。
    • GPIOMIS：已屏蔽中断状态寄存器。仅显示已使能（GPIOIM对应位为1）且实际发生的中断。
    • GPIOICR：中断清除寄存器。向某位写1可清除GPIORIS和GPIOMIS中对应的边沿中断标志。对于电平中断，则需要外部信号消失才能清除。

  4. Pad控制寄存器：定义引脚的电气特性。

    • GPIODR2R/GPIODR4R/GPIODR8R/GPIODR12R：驱动强度选择寄存器。分别对应2mA, 4mA, 8mA, 12mA驱动能力。注意：它们是互斥的，同一时刻只能使能其中一个。更高级的“扩展驱动模式”通过GPIOPC寄存器配置，可以实现2mA为基础，叠加4mA或8mA的混合驱动强度。
    • GPIOSLR：压摆率控制寄存器。当选择8mA及以上驱动时，使能此位可以降低信号边沿的陡峭程度，有助于减少电磁干扰（EMI）。
    • GPIOODR：开漏输出使能寄存器。置位后，引脚配置为开漏模式，通常用于I2C等总线。
    • GPIOPUR/GPIOPDR：内部上拉/下拉电阻使能寄存器。
    • GPIODEN：数字输入使能寄存器。当引脚用作数字输入或输出时，必须使能此位。如果用作模拟功能（如ADC输入），则必须清零此位以关闭数字输入缓冲器，防止漏电。

  5. 提交控制与识别寄存器：用于保护关键引脚和识别外设。

    • GPIOLOCK&GPIOCR：提交控制寄存器。用于解锁和保护JTAG/SWD和NMI等关键引脚。在对这些引脚进行功能重配置前，必须完成“解锁->提交->锁定”的操作序列，防止代码跑飞意外修改导致调试接口失效。
    • GPIOPeriphID0-7&GPIOPCellID0-3：外设识别寄存器。这是一组只读的硬编码寄存器，存储了GPIO模块的制造商、架构、型号和版本信息。软件可以通过读取这些寄存器来确认外设的存在和具体型号，实现驱动程序的自动适配。

2.2 外设识别寄存器（PeriphID & PCellID）的深层含义

你提供的资料中详细列出了DMA模块的DMAPeriphIDn和DMAPCellIDn寄存器，GPIO模块也有完全类似的GPIOPeriphIDn和GPIOPCellIDn寄存器组。这些寄存器是ARM PrimeCell外设标准的一部分，为软件提供了一种标准化的外设识别机制。

  • PeriphID0-3：通常包含外设的Part Number（部件号）。例如，PID2（PeriphID2的[7:0]）可能代表外设的主要类型和版本。
  • PCellID0-3：这4个寄存器合起来是一个32位的值，对于ARM PrimeCell外设，其值固定为0xB105F00D。这是一个“魔数”，软件读取到CID0=0x0D,CID1=0xF0,CID2=0x05,CID3=0xB1时，就能确认这是一个符合ARM标准的PrimeCell外设。这为不同厂商的Cortex-M芯片提供了一致的驱动识别基础。

实操心得：在编写高度可移植的BSP（板级支持包）或HAL（硬件抽象层）时，可以在驱动初始化函数开头加入识别代码。虽然对于已知型号的MCU看似多余，但在开发通用库或进行芯片验证时，这是一个非常严谨的做法。例如，你可以先读取GPIOPCellID0-3，验证是否为0xB105F00D，如果不匹配，则可能芯片型号错误或地址映射有误，可以提前报错，避免后续配置错误导致难以排查的硬件问题。

3. 核心细节解析与实操要点

3.1 GPIODATA寄存器的位寻址机制

这是TM4C系列GPIO设计的一个精髓，理解了它才能高效操作IO。GPIODATA寄存器在内存中映射了256个连续的地址位置，而不是一个。地址总线ADDR[9:2]这8位被用作位掩码（Bit Mask）。

  • 写操作：当你向地址GPIODATA_BASE + mask写入一个8位值时，只有那些在mask中对应位为1的GPIODATA位会被更新，为0的位则保持不变。

    • 例子：假设GPIODATA当前值为0xAA(二进制10101010)，我们想仅将bit 1和bit 3置1（即设置为0x0A），而不影响其他位。
    • 错误���传统方式：data = GPIODATA; data |= 0x0A; GPIODATA = data;这需要读-修改-写三步，且在多线程/中断环境下可能被打断。
    • 正确的高效方式：直接向地址GPIODATA_BASE + 0x0A写入值0x0A。因为mask=0x0A（二进制00001010）的bit1和bit3为1，所以只有GPIODATA的bit1和bit3会被写入新值0x0A的对应位（均为1），其他位不变。最终GPIODATA变为0xAA | 0x0A = 0xAA（实际上bit1和bit3本来就是1？这里举例原值可能不合适，更佳例子是清位）。若要清位，例如清零bit2，则向GPIODATA_BASE + 0x04写入0x00。

  • 读操作：当你从地址GPIODATA_BASE + mask读取时，返回的值是：(GPIODATA & mask)。即，只有mask中为1的位对应的GPIODATA值会被呈现，其余位返回0。

    • 例子：只想读取PA端口的bit0和bit7的状态。mask = (1<<0) | (1<<7) = 0x81。从GPIODATA_BASE + 0x81读取，返回值的bit0和bit7就是实际引脚状态，其他位为0。

代码示例（C语言）：

// 定义GPIO端口A的基址和数据寄存器偏移量 #define GPIO_PORTA_BASE 0x40058000 #define GPIO_DATA_OFFSET 0x000 #define GPIO_DATA_REG(mask) (*(volatile uint32_t *)(GPIO_PORTA_BASE + GPIO_DATA_OFFSET + (mask << 2))) // 设置PA2引脚输出高电平（不影响其他引脚） GPIO_DATA_REG(1 << 2) = 1 << 2; // 等价于 GPIO_DATA_REG(0x04) = 0x04; // 设置PA2和PA5输出高电平 GPIO_DATA_REG((1 << 2) | (1 << 5)) = (1 << 2) | (1 << 5); // mask=0x24, value=0x24 // 读取PA3引脚的状态 uint8_t pin_state = (GPIO_DATA_REG(1 << 3) >> 3) & 0x01;

3.2 中断配置流程与避坑指南

配置一个GPIO引脚的中断，需要遵循一个清晰的流程，顺序错误可能导致中断无法触发或出现伪中断。

  1. 禁用全局中断：作为良好习惯，在配置中断相关寄存器前，先使用__disable_irq()或类似指令禁用CPU总中断。
  2. 配置引脚为输入：在GPIODIR寄存器中，将对应引脚方向设置为输入。
  3. 配置数字使能：如果引脚用作数字中断输入，确保GPIODEN寄存器对应位使能。
  4. 清除中断控制寄存器：这是关键一步！在修改GPIOIS、GPIOIBE、GPIOIEV之前，务必先清除GPIOIM（屏蔽中断），防止在配置过程中产生不可预测的边沿或电平变化触发中断。
  5. 设置中断类型：
    • 通过GPIOIS选择电平敏感（1）或边沿敏感（0）。
    • 如果是边沿触发，通过GPIOIBE选择是单边沿（0，由GPIOIEV指定）还是双边沿（1）。
    • 通过GPIOIEV指定具体边沿或电平：对于边沿，1=上升沿/高电平，0=下降沿/低电平。
  6. 清除可能存在的挂起中断：向GPIOICR寄存器的对应位写1，清除该引脚可能已有的任何旧中断标志。
  7. 使能中断掩码：设置GPIOIM寄存器的对应位，允许该引脚的中断信号传递到NVIC。
  8. 配置NVIC：在NVIC中使能对应GPIO端口的中断（例如GPIO Port A中断），并设置优先级。
  9. 使能全局中断：__enable_irq()。
  10. 编写中断服务函数（ISR）：在ISR中，首先读取GPIOMIS寄存器确定是哪个引脚触发的中断，处理完毕后，必须向GPIOICR寄存器的对应位写1以清除中断标志（对于边沿中断）。对于电平中断，需要确保外部信号已恢复到非触发状态。

常见问题与排查：

  • 中断不触发：检查GPIODIR是否为输入；GPIODEN是否使能；GPIOIM是否使能；NVIC是否使能并优先级正确；GPIOICR是否在ISR中清除（边沿中断）；外部信号是否符合触发条件（如边沿陡峭度、电平持续时间）。
  • 中断连续触发（进入一次后卡死）：最常见原因是忘记在ISR中清除中断标志。对于边沿中断，必须手动写GPIOICR；对于电平中断，必须确保外部信号在ISR返回前已变化，否则会立即再次进入中断。
  • 伪中断：在系统上电、复位或修改中断配置寄存器时，引脚电平可能处于不稳定状态。务必遵循“先屏蔽(GPIOIM清零)->配置(GPIOIS/IBE/IEV)->清除旧标志(GPIOICR)->使能(GPIOIM置位)”的顺序。

3.3 引脚复用（Pin Muxing）配置详解

将一个GPIO引脚用作外设功能，需要两步操作：

  1. 使能硬件控制：在GPIOAFSEL寄存器中，将对应引脚的位置1。此时，该引脚的控制权从GPIODATA寄存器移交给了某个外设模块。
  2. 选择具体外设：在GPIOPCTL寄存器中，找到对应引脚的4位字段（例如PA0对应GPIOPCTL的[3:0]位），填入目标外设的编码值。这个编码表在数据手册的“引脚复用表”（如你提供的Table 10-2）中查找。

示例：将PA0配置为UART0的RX功能

  1. 查表得知，PA0的UART0_RX功能对应的GPIOPCTLPMCx编码是0x1。
  2. 代码实现：
// 1. 使能PA0引脚的时钟（假设系统已初始化时钟） SYSCTL->RCGCGPIO |= SYSCTL_RCGCGPIO_R0; // 使能GPIO Port A时钟 while(!(SYSCTL->PRGPIO & SYSCTL_PRGPIO_R0)); // 等待时钟就绪 // 2. 解锁并提交PA0（如果PA0是默认JTAG引脚之一，需要此步骤。TM4C129的PA0不是JTAG，此步可省） // GPIO_PORTA_AHB_LOCK_R = GPIO_LOCK_KEY; // 解锁 // GPIO_PORTA_AHB_CR_R |= GPIO_PIN_0; // 提交PA0 // GPIO_PORTA_AHB_LOCK_R = 0; // 重新锁定 // 3. 禁用PA0的模拟功能（如果是模拟功能则不清零DEN，但UART是数字功能） GPIO_PORTA_AHB_AMSEL_R &= ~GPIO_PIN_0; // 清零模拟功能选择 GPIO_PORTA_AHB_DEN_R |= GPIO_PIN_0; // 使能数字功能 // 4. 清除PA0在PCTL中的旧配置，然后设置新配置 GPIO_PORTA_AHB_PCTL_R = (GPIO_PORTA_AHB_PCTL_R & ~GPIO_PCTL_PA0_M) | (GPIO_PCTL_PA0_U0RX); // 5. 使能PA0的复用功能 GPIO_PORTA_AHB_AFSEL_R |= GPIO_PIN_0; // 6. 关闭PA0的内部上拉/下拉（根据UART线路需求，通常关闭） GPIO_PORTA_AHB_PUR_R &= ~GPIO_PIN_0; GPIO_PORTA_AHB_PDR_R &= ~GPIO_PIN_0; // 7. 现在可以配置UART0模块本身了

重要提示：对于PC[3:0]（JTAG/SWD）和PD7（NMI）等具有“特殊考虑”的引脚，在修改其GPIOAFSEL、GPIOPUR、GPIOPDR、GPIODEN或GPIOPCTL寄存器前，必须执行提交控制流程，否则配置不会生效。流程是：向GPIOLOCK寄存器写入特定密钥0x4C4F434B-> 设置GPIOCR中对应位 -> 配置目标寄存器 -> 向GPIOLOCK写入0重新锁定。这是为了防止代码异常时误修改调试接口，导致芯片“锁死”无法连接调试器。

4. 实操过程与核心环节实现

4.1 驱动强度与压摆率配置实战

驱动强度和压摆率的配置直接影响信号的完整性和功耗。驱动电流越大，引脚翻转速度越快，驱动能力越强，但功耗和噪声也越大。压摆率控制可以减缓边沿变化率，减少高频噪声辐射，在低速或对EMI敏感的总线（如I2C）上非常有用。

配置步骤：

  1. 确定需求：驱动LED（2-4mA足够），驱动蜂鸣器（可能需要8mA），驱动MOSFET栅极（需要计算栅极电荷所需电流）。对于高速信号线（如SPI CLK > 10MHz），可能需要8mA或12mA驱动并配合压摆率控制。
  2. 选择驱动寄存器：GPIODR2R、GPIODR4R、GPIODR8R、GPIODR12R是互斥的。例如，要配置8mA驱动，就设置GPIODR8R对应位为1，并确保其他GPIODRnR寄存器对应位为0。
  3. 配置压摆率：只有当驱动强度配置��8mA、10mA或12mA时，GPIOSLR寄存器的配置才有效。使能压摆率控制（置1）会减缓边沿。

示例：配置PA1引脚为8mA驱动，并使能压摆率控制

// 假设PA1已配置为输出 // 1. 确保PA1的扩展驱动模式未启用或已正确配置（通常默认关闭��� // 2. 配置驱动强度为8mA GPIO_PORTA_AHB_DR8R_R |= GPIO_PIN_1; // 使能8mA驱动 GPIO_PORTA_AHB_DR4R_R &= ~GPIO_PIN_1; // 禁用4mA（如果之前使能了） GPIO_PORTA_AHB_DR2R_R &= ~GPIO_PIN_1; // 禁用2mA // 3. 使能压摆率控制 GPIO_PORTA_AHB_SLR_R |= GPIO_PIN_1;

扩展驱动模式：通过GPIOPC寄存器可以启用更灵活的驱动组合。例如，EDMn字段设置为0x2，并同时使能GPIODR4R和GPIODR8R，可以得到2mA + 2mA + 4mA = 8mA的驱动。这种模式主要用于需要精细调整驱动能力的特殊场景，一般应用使用基础的GPIODRnR即可。

4.2 使用GPIO触发ADC与µDMA

这是TM4C129GPIO的高级功能，可以实现硬件级的自动触发，极大减轻CPU负担。

  • ADC触发：

    1. 将某个GPIO引脚配置为中断输入（配置GPIOIS、GPIOIEV等，并使能GPIOIM）。
    2. 在GPIOADCCTL寄存器中，将对应位置1，使能该引脚作为ADC外部触发源。
    3. 在ADC模块中，配置采样序列的触发源（ADCEMUX寄存器）为外部触发（例如ADC_EMUX_PROCESSOR）。
    4. 当该GPIO引脚产生中断事件（边沿或电平）时，硬件会自动向ADC发送一个单时钟周期的触发脉冲，启动一次ADC采样序列。

    注意：资料中特别指出，即使选择电平触发，ADC也只会产生单次触发脉冲。因此，推荐使用边沿触发作为ADC触发源，以获得明确、单次的触发事件。

  • µDMA触发：

    1. 同样，先配置GPIO引脚为中断输入并使能GPIOIM。
    2. 在GPIODMACTL寄存器中，将对应位置1，使能该引脚作为µDMA请求源。
    3. 在µDMA通道控制寄存器中，配置传输触发源为该GPIO对应的请求编号。
    4. 当GPIO中断事件发生时，会向µDMA控制器发送dma_req信号，启动预设的DMA传输。传输完成后，µDMA会向GPIO模块回送dma_done信号，该事件会记录在GPIORIS寄存器中（作为一个DMA完成中断），可供查询。

示例：配置PE3引脚下降沿触发ADC采样序列0

// 1. 配置PE3为输入，下降沿中断 GPIO_PORTE_AHB_DIR_R &= ~GPIO_PIN_3; GPIO_PORTE_AHB_DEN_R |= GPIO_PIN_3; GPIO_PORTE_AHB_IS_R &= ~GPIO_PIN_3; // 边沿触发 GPIO_PORTE_AHB_IBE_R &= ~GPIO_PIN_3; // 单边沿 GPIO_PORTE_AHB_IEV_R &= ~GPIO_PIN_3; // 下降沿 GPIO_PORTE_AHB_IM_R |= GPIO_PIN_3; // 使能中断掩码（必须！） GPIO_PORTE_AHB_ICR_R = GPIO_PIN_3; // 清除旧中断标志 // 2. 使能PE3作为ADC外部触发源 GPIO_PORTE_AHB_ADCCTL_R |= GPIO_PIN_3; // 3. 配置ADC0采样序列0（SS0）为外部触发（假设使用ADC0） ADC0->EMUX = (ADC0->EMUX & ~ADC_EMUX_EM0_M) | ADC_EMUX_EM0_PROCESSOR; // 处理器触发，实际应设为外部触发编码 // 注意：此处编码需查表，例如可能是 ADC_EMUX_EM0_EXT // 更完整的ADC配置（时钟、序列、步骤等）此处省略... // 4. 在需要的时候，PE3引脚上的下降沿将自动触发ADC0 SS0采样

5. 常见问题与排查技巧实录

在多年的项目调试中，GPIO相关的问题层出不穷，以下是一些典型问题的排查思路和解决方法。

问题现象可能原因排查步骤与解决方法
引脚输出无反应，始终为高阻或固定电平1. 时钟未使能。
2. 方向寄存器(GPIODIR)未配置为输出。
3. 数字功能未使能(GPIODEN)。
4. 复用功能(GPIOAFSEL)被意外使能，引脚被外设控制。
5. 对于PC0-3( JTAG )，未解锁提交控制(GPIOLOCK/GPIOCR)。		1. 检查SYSCTL->RCGCGPIO对应位是否置1，并用SYSCTL->PRGPIO等待就绪。
2. 确认GPIODIR对应位已置1。
3. 确认GPIODEN对应位已置1。
4. 检查GPIOAFSEL对应位是否为0（GPIO模式）。
5. 如果是JTAG/NMI引脚，检查是否执行了完整的解锁-提交流程。
输入引脚读取值不稳定或错误1. 外部信号浮空，未使用上拉/下拉电阻。
2. 内部上拉/下拉未使能或配置错误。
3. 模拟功能使能(GPIOAMSEL)干扰了数字输入。
4. 引脚配置为开漏输出(GPIOODR)，但未接上拉电阻。
5. 信号频率过高，超过GPIO输入带宽。		1. 为输入引脚增加外部上拉/下拉电阻（通常10kΩ）。
2. 正确配置GPIOPUR或GPIOPDR。
3. 用作数字输入时，确保GPIOAMSEL对应位为0。
4. 检查GPIOODR，若非开漏应用则清零。
5. 检查信号频率，或使用示波器观察波形质量。
中断无法进入或只进入一次1. NVIC未使能或优先级配置错误。
2. 中断标志未清除（边沿中断）。
3. 中断类型配置错误（如期望边沿却配成电平）。
4.GPIOIM中断掩码未使能。
5. 电平中断中，外部信号未在ISR返回前恢复。		1. 确认NVIC中对应GPIO端口中断已使能，优先级合理。
2.在ISR起始处，读取GPIOMIS确定源；在ISR结束前，写GPIOICR清除标志。
3. 仔细检查GPIOIS、GPIOIBE、GPIOIEV配置。
4. 确认GPIOIM对应位为1。
5. 对于电平中断，确保ISR能快速处理并使外部信号变化，或考虑使用边沿中断。
配置了外设功能（如UART），但引脚无信号1. 外设模块时钟未使能。
2.GPIOAFSEL未置1。
3.GPIOPCTL复用编码错误。
4.GPIODEN未使能（数字外设必须使能）。
5. 外设模块本身未正确配置（如UART波特率）。		1. 使能外设时钟（如SYSCTL->RCGCUART）。
2. 确认GPIOAFSEL对应位已置1。
3. 对照数据手册引脚复用表，核对GPIOPCTL中4位字段的值。
4. 确认GPIODEN对应位已置1。
5. 单独调试外设模块配置。
高驱动电流配置后，芯片局部发热或工作不稳定1. 多个引脚同时配置为高驱动（如12mA），总电流超出芯片或电源负载能力。
2. 输出引脚直接短路到地或电源。
3. 驱动感性负载（如电机、继电器）未加保护电路。		1. 计算总峰值电流，确保在芯片规格范围内。减少同时动作的高驱动引脚数量，或降低驱动强度。
2. 检查PCB是否有短路。使用万用表测量。
3. 为感性负载增加续流二极管或缓冲电路。
调试器（JTAG/SWD）无法连接1. 代码初始化时过早将调试引脚（PC0-3）配置为GPIO或其他功能。
2. 提交控制流程错误，导致调试引脚功能被锁定。		1. 在初始化代码中，延迟或有条件地配置调试引脚。例如，通过一个未使用的GPIO状态或延时来决定是否重配置。
2. 如果已锁死，需要使用TI的LM Flash Programmer工具的“Unlock”功能恢复，或执行一次芯片擦除。这是最严重的坑之一，务必谨慎处理JTAG引脚。

最后分享一个调试小技巧：当你怀疑某个GPIO寄存器配置不生效时，不要完全相信你写的代码。在调试器中，直接查看该寄存器的内存地址。对比你“认为”的值和实际读出来的值。很多时候，问题出在位操作逻辑错误、时钟未就绪导致写入被忽略、或者提交控制未完成。直接查看寄存器映像是最可靠的验证手段。

http://www.jsqmd.com/news/1244772/

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