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深入解析Tiva C系列μDMA控制器：乒乓与分散聚集模式实战

news 2026/7/23 18:04:06

1. μDMA控制器：嵌入式系统数据搬运的“隐形引擎”

在嵌入式系统开发中，尤其是面对Tiva™ C系列这类基于ARM Cortex-M的微控制器时，我们常常需要处理大量的数据搬运工作。无论是从ADC读取采样数据填充到内存缓冲区，还是将处理完的图像数据通过SPI发送到显示屏，这些操作如果全部交由CPU通过软件循环来完成，会严重消耗宝贵的CPU周期，导致系统响应变慢，甚至无法满足实时性要求。这时，直接内存访问（DMA）技术就成了我们的“救星”。而德州仪器（TI）在其Tiva™系列MCU中集成的μDMA（微直接内存访问）控制器，更是将DMA的灵活性和效率提升到了一个新的高度。

简单来说，μDMA就像一个高度专业化的“数据搬运工”。CPU只需要告诉它“从哪里搬”（源地址）、“搬到哪里去”（目的地址）、“搬多少”（传输大小）以及“怎么搬”（传输模式），它就能独立完成剩下的所有工作。在此期间，CPU被完全解放出来，可以继续执行其他任务，比如运行复杂的控制算法、处理用户输入或者管理网络协议栈。这种并行处理能力对于提升系统整体性能和实时性至关重要。

本文将以TI的TM4C129x系列微控制器为背景，深入解析其μDMA控制器的核心工作机制。我们将不仅仅停留在“如何配置”的层面，而是会深入探讨几种高级工作模式（如乒乓模式和分散-聚集模式）的设计哲学与应用场景，并逐一拆解关键控制寄存器的每一个比特位所扮演的角色。无论你是正在调试一个高速数据采集项目，还是希望优化现有系统的数据吞吐量，理解这些底层机制都将让你在系统架构和驱动编写时更加得心应手。我们将从基本概念出发，逐步深入到寄存器配置的细节，并提供实际编程中容易遇到的“坑”和解决技巧。

2. μDMA核心架构与工作模式深度解析

在开始配置寄存器之前，我们必须先理解μDMA控制器是如何组织和运作的。与许多简单的DMA控制器不同，TI的μDMA引入了一套非常灵活且强大的“控制结构”和“工作模式”概念，这是其高效性的根源。

2.1 通道与控制结构：数据搬运的“任务清单”

μDMA控制器支持多个独立的通道（在TM4C129上为32个）。每个通道可以分配给一个特定的外设（如UART、ADC、SPI）或用于存储器到存储器的传输。每个通道都关联着两组至关重要的数据结构：主控制结构（Primary Control Structure）和备用控制结构（Alternate Control Structure）。

你可以把每个控制结构想象成一份完整的“搬运任务清单”。这份清单里详细记录了：

  • 源地址指针（SRCENDPTR）：数据从哪里开始搬。
  • 目的地址指针（DSTENDPTR）：数据要搬到哪里去。
  • 控制字（CONTROL）：这是清单的核心，它定义了：
    • XFERSIZE：本次任务要搬运的数据项数量。
    • ARBSIZE：仲裁大小，即每次外设请求时，连续搬运多少数据项（可以理解为“搬运小组”的人数）。
    • XFERMODE：工作模式，决定了这份清单如何被执行（是执行一次就结束，还是在主备清单间切换等）。
    • SRCINC/DSTINC：每次搬运后，源地址和目的地址是否递增、递减或不变。
    • SRCSIZE/DSTSIZE：每次搬运的数据宽度（8位、16位、32位）。

默认情况下，一个通道只使用主控制结构。任务完成后，通道便停止。但μDMA的强大之处在于，它允许我们在任务执行过程中，动态地在主、备两份清单之间切换，从而实现复杂、连续的传输流程，这就是高级工作模式的基石。

2.2 高级工作模式：超越单次传输

2.2.1 乒乓模式（Ping-Pong Mode）

这是最经典的双缓冲模式。在这种模式下，通道的主控和备用控制结构都被启用，并都配置为乒乓模式。

工作流程如下：

  1. 初始化：配置好主控和备用两个控制结构，它们指向不同的内存缓冲区（例如Buffer_A和Buffer_B），但传输大小（XFERSIZE）相同。
  2. 启动：通道从主控制结构（例如指向Buffer_A）开始传输。
  3. 切换：当主控制结构规定的传输数量（XFERSIZE）完成后，μDMA控制器自动切换到备用控制结构（指向Buffer_B）继续传输，同时会产生一个中断。
  4. 乒乓循环：在备用控制结构的传输期间，CPU可以安全地处理主控制结构刚刚填满的Buffer_A中的数据（例如进行滤波、计算）。当备用控制结构的传输完成后，控制器又会切换回主控制结构，并再次产生中断，此时CPU可以去处理Buffer_B。
  5. 停止：这个“乒乓”过程会一直持续，直到软件将其中一个控制结构的模式改为非乒乓模式（如基本模式），传输才会停止。

为什么需要乒乓模式？想象一个实时音频采集场景。ADC持续采样，数据需要被存入内存。如果没有乒乓缓冲，当CPU正在处理缓冲区数据时，新来的ADC数据将无处安放，导致数据丢失（覆盖）。乒乓模式完美解决了这个问题：一个缓冲区用于DMA填充时，另一个缓冲区正被CPU安全地读取处理，两者互不干扰，实现了数据生产与消费的流水线化。

配置要点：

  • 主控和备用结构的XFERMODE字段都必须设置为乒乓模式。
  • 两个结构的SRCENDPTR和DSTENDPTR必须指向不同的物理缓冲区。
  • 通常会在每次传输完成中断中，重新填充已被CPU处理完的缓冲区地址，并为下一次传输做好准备。
2.2.2 内存分散-聚集模式（Memory Scatter-Gather Mode）

这是一种更为高级的模式，用于处理非连续内存块的传输。例如，你需要将多个分散在内存不同位置的数据块，连续地发送到同一个外设（如发送一串由多个字符串组成的报文）。

工作流程如下：

  1. 任务表（Descriptor Table）：在内存中创建一个“任务表”。表中的每一项都是一个完整的μDMA控制结构（包含地址、控制字等），描述了一个子传输任务。
  2. 主控制结构配置：将通道的主控制结构配置为“内存分散-聚集模式”。其源地址指针（SRCENDPTR）指向刚才创建的任务表的起始地址。目的地址等字段在此模式下可能被忽略或用作其他用途。
  3. 备用控制结构角色：备用控制结构的XFERMODE必须设置为“备用内存分散-聚集模式”。
  4. 执行过程：
    • μDMA控制器首先读取主控制结构。
    • 然后，它从主结构指定的源地址（即任务表）中，取出第一个任务描述符，加载到备用控制结构中。
    • 接着，控制器切换到备用控制结构，并执行这个子任务。
    • 该子任务完成后，控制器切换回主控制结构，主结构会（自动或通过配置）更新其源地址指针，指向任务表中的下一个描述符。
    • 重复上述过程，直到任务表中最后一个描述符被执行。注意：最后一个描述符的XFERMODE不能是“备用分散-聚集模式”，以此作为任务链的结束标志。

配置要点：

  • 主结构XFERMODE= 内存分散-聚集，备用结构XFERMODE= 备用内存分散-聚集。
  • 任务表在内存中需要连续存放，每个描述符就是一个控制数据结构。
  • 此模式极大地减轻了CPU负担，CPU只需一次性设置好任务表并启动DMA，后续所有不连续的数据搬运均由DMA自动完成��
2.2.3 外设分散-聚集模式（Peripheral Scatter-Gather Mode）

此模式与内存分散-聚集模式原理类似，但设计用于外设触发的场景。典型应用是，一个外设（如ADC）需要以不规则的时间间隔或根据不同配置产生数据，并将这些数据存放到内存中不同的、非连续的缓冲区中。

关键区别在于传输粒度：

  • 在内存分散-聚集模式中，备用结构定义的XFERSIZE会作为一个整体被连续传输。
  • 而在外设分散-聚集模式中，备用结构定义的XFERSIZE是总传输量，但实际传输会以ARBSIZE（仲裁大小）为单位，每收到一次外设请求，才传输ARBSIZE个数据项。这更适合与那些以“突发”或“数据包”形式产生数据的外设配合工作。

配置要点：

  • 主结构XFERMODE= 外设分散-聚集。
  • 备用结构XFERMODE= 备用外设分散-聚集。
  • 需要正确配置ARBSIZE以匹配外设的请求特性。

2.3 请求类型：单次请求与突发请求

理解请求类型对优化性能至关重要。μDMA通道可以响应两种外设请求：

  • 单次请求（Single Request）：外设每准备好一个数据项（或一对源-目的），就产生一次请求。DMA响应后传输一个数据项（或根据数据宽度传输相应字节）。这种方式效率较低，因为每次传输都有握手开销。
  • 突发请求（Burst Request）：外设一次性通知DMA“我有一批数据（ARBSIZE个）准备好了”。DMA响应后，会在内部仲裁控制下，连续、无中断地传输完这ARBSIZE个数据项。这大大减少了总线访问的开销，提升了数据传输效率。

通过配置DMAUSEBURSTSET寄存器，可以强制某个通道只响应突发请求。这对于支持突发传输的外设（如某些DMA优化的ADC或SPI）是重要的优化手段。如果剩余待传输数据量小于ARBSIZE，控制器会自动切换回单次请求模式来完成最后一点数据。

3. 关键寄存器详解与配置实战

了解了核心概念后，我们进入实操环节。TI的μDMA寄存器设计非常规整，主要分为全局控制寄存器和通道控制寄存器两大类。所有寄存器基地址为0x400F.F000。

3.1 全局控制与状态寄存器

这些寄存器管理整个μDMA控制器的行为。

3.1.1 DMA状态寄存器（DMASTAT, Offset 0x000）

这是一个只读寄存器，用于获取控制器的全局状态。

#define DMASTAT (*((volatile uint32_t *)(0x400FF000)))
  • 位[20:16] DMACHANS：只读。该字段值 = （控制器支持的μDMA通道总数 - 1）。例如，读回0x1F（十进制31），表示有32个通道。这是一个非常重要的信息，在编写通用驱动时，应读取此值而非硬编码通道数，以保证代码在不同型号MCU间的可移植性。
  • 位[7:4] STATE：只读。指示控制状态机（CSM）的当前状态。调试时极其有用！例如：
    • 0x0：空闲（Idle）
    • 0x1：正在读取通道控制数据（即从通道控制表中加载描述符）
    • 0x4/0x5：正在读取源数据/写入目的数据（正在进行数据传输）
    • 0x8：停滞（Stalled），通常是因为错误（如总线错误）或等待请求超时。
    • 0x9：完成（Done）
  • 位[0] MASTEN：只读。主使能状态。1表示控制器已使能。

实操技巧：在系统初始化时，可以读取DMACHANS来动态分配通道控制表的大小。在调试DMA传输卡住的问题时，首先查看STATE字段，如果停留在0x8（停滞），就需要去检查DMAERRCLR寄存器是否有总线错误。

3.1.2 DMA配置寄存器（DMACFG, Offset 0x004）

这是一个只写寄存器，只有一个有效位。

#define DMACFG (*((volatile uint32_t *)(0x400FF004)))
  • 位[0] MASTEN：只写。向该位写1，使能整个μDMA控制器；写0则禁用。这是启动μDMA传输前必须完成的第一步！控制器禁用时，对大多数寄存器的读取将返回未定义值。

配置示例：

// 使能 μDMA 控制器 DMACFG = 0x00000001; // 注意：这是一个只写寄存器，无法通过读取来确认是否写入成功，后续操作正常即表示使能成功。
3.1.3 DMA通道控制基址指针寄存器（DMACTLBASE, Offset 0x008）

这是整个μDMA配置的核心之一，可读可写。

#define DMACTLBASE (*((volatile uint32_t *)(0x400FF008)))
  • 位[31:10] ADDR：通道控制表的基地址。此地址必须1024字节对齐（即低10位为0）！这是硬件要求，如果地址未对齐，会导致不可预知的行为。

通道控制表需要我们在系统内存（通常是SRAM）中预先分配。每个通道需要占用32字节（如果使用备用控制结构，则再增加32字节）。对于32通道的MCU，如果全部使用主备结构，则需要32通道 * 64字节/通道 = 2048字节。因此，我们需要在链接脚本或代码中定义一个1024字节对齐的数组。

配置示例：

// 在内存中（通常是全局变量区）分配对齐的控制表 // 使用编译器扩展属性确保1024字节对齐 __attribute__((aligned(1024))) static uint32_t g_ui32DMAControlTable[2048 / sizeof(uint32_t)]; // 在初始化函数中设置基址指针 DMACTLBASE = (uint32_t)g_ui32DMAControlTable;

避坑指南：

  1. 对齐失败：这是最常见的错误。务必使用aligned属性或动态内存对齐分配函数（如memalign）。
  2. 地址计算：DMACTLBASE存储的是物理地址。在启用MMU的复杂系统中，需要确保写入的是控制表所在物理内存的物理地址，或者正确映射的地址。
  3. 表大小不足：如果只启用了部分通道，可以只分配所需大小的内存，但基地址仍需对齐。计算大小时要预留足够空间。
3.1.4 DMA备用通道控制基址指针寄存器（DMAALTBASE, Offset 0x00C）

这是一个只读寄存器。

  • 位[31:0] ADDR：只读。返回备用通道控制数据结构的基地址。这个地址是控制器根据DMACTLBASE自动计算出来的（通常是DMACTLBASE + 0x200）。软件可以直接使用这个值来定位每个通道的备用控制结构，无需手动计算偏移，非常方便。

3.2 通道控制寄存器组

这类寄存器通常以“位域”形式操作，每个位对应一个通道（位0对应通道0，依此类推）。它们通常成对出现：xxxSET和xxxCLR。

3.2.1 通道使能设置/清除（DMAENASET / DMAENACLR）

这是控制通道开关的寄存器。

  • DMAENASET(Offset 0x028)：可读可写。读操作返回所有通道的当前使能状态。向某位写1，使能对应通道。
  • DMAENACLR(Offset 0x02C)：只写。向某位写1，清除DMAENASET中对应位，即禁用该通道。

重要特性：当一个通道的传输任务全部完成后，控制器会自动清除该通道在DMAENASET中的使能位。因此，在配置一次性的传输时，我们无需手动禁用通道。

配置示例：使能通道5。

// 方法1：直接设置SET寄存器（推荐，清晰） DMAENASET = (1 << 5); // 方法2：通过读取-修改-写入（如果同时要操作多个位且不想影响其他位） // uint32_t ui32Reg = DMAENASET; // ui32Reg |= (1 << 5); // DMAENASET = ui32Reg; // 禁用通道5 DMAENACLR = (1 << 5);
3.2.2 通道请求掩码设置/清除（DMAREQMASKSET / DMAREQMASKCLR）

这个寄存器用于控制外设能否向DMA通道发出请求。

  • DMAREQMASKSET(Offset 0x020)：可读可写。向某位写1，将屏蔽对应通道的外设请求。此时，该通道只能通过软件触发（DMASWREQ寄存器）。
  • DMAREQMASKCLR(Offset 0x024)：只写。向某位写1，清除屏蔽，允许外设请求。

应用场景：

  1. 软件触发传输：当你需要手动启动一次存储器到存储器的DMA拷贝时，可以先设置DMAREQMASKSET屏蔽该通道的外设请求，然后配置控制结构，最后通过DMASWREQ发起软件请求。
  2. 临时暂停外设DMA：在不完全禁用通道的情况下，临时阻止外设触发新的DMA传输。
3.2.3 通道主/备用控制结构选择设置/清除（DMAALTSET / DMAALTCLR）

该寄存器指示或控制通道当前使用的是主控制结构还是备用控制结构。

  • DMAALTSET(Offset 0x030)：可读可写。读操作返回状态（1=使用备用结构，0=使用主结构）。写1可强制通道切换到备用结构。
  • DMAALTCLR(Offset 0x034)：只写。写1强制通道切换回主结构。

关键点：在乒乓模式和分散-聚集模式下，控制器会在主备结构之间自动切换，并相应地更新此寄存器的状态位。软件可以通过读取此寄存器来了解当前正在使用哪个缓冲区（在乒乓模式下），或者了解分散-聚集任务链的执行进度。

调试技巧：如果你的乒乓模式DMA中断服务程序（ISR）中，发现DMAALTSET的位状态不符合预期（例如，你认为该处理Buffer_A了，但发现DMA还在用Buffer_A传输），很可能是因为ISR处理速度太慢，DMA已经完成了另一轮切换。这时你需要检查ISR的执行时间，或者考虑使用双中断（主备结构完成各产生一个中断）来更精确地跟踪状态。

3.2.4 通道优先级设置/清除（DMAPRIOSET / DMAPRIOCLR）

μDMA支持两个优先级：默认优先级和高优先级。

  • DMAPRIOSET(Offset 0x038)：可读可写。向某位写1，将对应通道设置为高优先级。
  • DMAPRIOSET(Offset 0x03C)：只写。向某位写1，将对应通道恢复为默认优先级。

仲裁机制：当多个通道同时请求DMA服务时，仲裁器首先服务所有高优先级通道，然后才是默认优先级通道。在高优先级通道内部或默认优先级通道内部，则采用固定优先级或轮询调度（取决于具体型号，需查数据手册）。注意：滥用高优先级可能导致低优先级通道“饿死”，需谨慎分配。

3.2.5 使用突发请求设置/清除（DMAUSEBURSTSET / DMAUSEBURSTCLR）

如前所述，此寄存器用于配置通道只响应突发请求。

  • DMAUSEBURSTSET(Offset 0x018)：可读可写。向某位写1，对应通道将只响应突发请求。
  • DMAUSEBURSTCLR(Offset 0x01C)：只写。向某位写1，允许通道响应单次和突发请求。

自动清除特性：这是一个非常智能的设计。当通道的剩余传输量（XFERSIZE）小于仲裁大小（ARBSIZE）时，控制器会自动清除该通道的DMAUSEBURSTSET位，使其能够通过单次请求完成最后一点数据的传输。传输完成后，该位保持为0。如果希望下次传输仍以突发模式开始，需要在启动传输前重新置位。

3.2.6 DMA软件请求寄存器（DMASWREQ, Offset 0x014）

这是一个只写寄存器。向某位写1，会为对应通道产生一个软件DMA请求。该请求与硬件外设请求具有同等效力。该位会在请求被接受后自动清除。

使用流程（用于存储器到存储器传输）：

  1. 配置通道控制结构（源地址、目的地址、传输大小等）。
  2. 可选：通过DMAREQMASKSET屏蔽该通道的硬件请求。
  3. 向DMASWREQ寄存器的对应位写1，启动传输。
  4. 等待传输完成（可通过查询状态或中断）。
3.2.7 DMA总线错误清除寄存器（DMAERRCLR, Offset 0x04C）

这是一个写1清除（RW1C）的寄存器。

  • 位[0] ERRCLR：读操作返回是否有未处理的DMA总线错误（1=有错误）。向该位写1可以清除错误标志。

错误处理流程：

  1. 当DMA传输过程中发生总线错误（例如，访问了非法地址或受保护的内存区域）时，该位会被置1。
  2. 发生错误的通道会被控制器自动禁用（其DMAENASET位被清除）。
  3. 软件应定期或在DMA完成中断中检查此位。如果发现错误，必须： a. 读取DMAERRCLR（该操作会返回1）。 b.向DMAERRCLR写1，以清除错误标志。这一步至关重要，否则错误状态会一直保持。 c. 排查错误原因（错误的地址指针、未对齐的访问、内存权限问题等）。 d. 重新配置并启用该通道。

严重性：忽略总线错误是系统不稳定的常见根源。一个通道因错误挂起，可能会导致依赖该通道数据的外设或任务完全失效。

3.3 通道映射寄存器（DMACHMAP0-3）

这些寄存器（偏移0x510,0x514,0x518,0x51C）用于将物理DMA通道映射到不同的外设请求源。每个通道由一个4位字段（CHxSEL）控制，其值对应数据手册“DMA Channel Assignments”表格中的选择码。

为什么需要映射？在某些MCU上，一个外设（如UART0的TX）可能固定连接到DMA通道4，但也可能提供选项将其重新映射到通道8，以避免与其他高优先级通道冲突。DMACHMAP寄存器提供了这种灵活性。

新旧接口：

  • DMACHASGN寄存器（Offset 0x500）是旧式接口，每个通道1个比特，只能选择主/次两种映射（通常0=主，1=次）。
  • DMACHMAP0-3是新式接口，每个通道4个比特，支持最多16种映射源选择，更灵活。新软件应使用DMACHMAP。

配置示例：将通道5映射到备用请求源（假设备用源编码为0x1）。

// DMACHMAP0 控制通道 0-7 // CH5SEL 位于 bits[23:20] volatile uint32_t *pui32Reg = (volatile uint32_t *)(0x400FF510); // DMACHMAP0 uint32_t ui32Temp = *pui32Reg; ui32Temp &= ~(0xF << 20); // 清零 CH5SEL 字段 ui32Temp |= (0x1 << 20); // 设置 CH5SEL = 0x1 *pui32Reg = ui32Temp;

注意：具体的映射关系（哪个编码对应哪个外设）必须严格参照你所使用的具体MCU型号的数据手册中的表格，不同型号、不同外设的映射可能完全不同。

4. 从零开始：一个完整的μDMA配置与使用流程

理论说了这么多，我们通过一个具体的例子来串联所有知识：使用乒乓模式通过ADC采集数据。

4.1 步骤一：系统与控制器初始化

  1. 启用系统时钟：确保μDMA控制器所在的总线时钟（如AHB）已经启用。在Tiva系列中，通常通过SysCtlPeripheralEnable(SYSCTL_PERIPH_UDMA)来完成。
  2. 分配并对齐控制表：
    // 假设我们使用通道10，并启用乒乓模式（需要主备两个结构） #define DMA_CHANNEL_10 10 #define DMA_CHANNEL_COUNT 32 #define DMA_CTL_STRUCT_SIZE 32 // 每个控制结构32字节 #define DMA_ALT_OFFSET (DMA_CHANNEL_COUNT * DMA_CTL_STRUCT_SIZE) // 备用表偏移 __attribute__((aligned(1024))) static uint8_t g_pui8DMAControlTable[2 * DMA_CHANNEL_COUNT * DMA_CTL_STRUCT_SIZE];
  3. 设置控制表基址并启用控制器：
    DMACTLBASE = (uint32_t)g_pui8DMAControlTable; DMACFG = 0x01; // 主使能 MASTEN = 1

4.2 步骤二：配置通道控制结构

我们需要为通道10设置主控和备用两个控制结构。控制结构是一个8字（32字节）的数据块，定义如下（具体位域定义请参考数据手册）：

typedef struct { volatile void *srcEndPtr; // 源地址结束指针 (实际上配置的是起始地址) volatile void *dstEndPtr; // 目的地址结束指针 volatile uint32_t control; // 控制字 volatile uint32_t unused; // 保留字 } tDMAControlTable;

我们需要计算出通道10在主控表和备用表中的位置。

// 计算通道10主控结构的指针 tDMAControlTable *pPrimary = (tDMAControlTable *)&g_pui8DMAControlTable[DMA_CHANNEL_10 * DMA_CTL_STRUCT_SIZE]; // 计算通道10备用结构的指针 tDMAControlTable *pAlternate = (tDMAControlTable *)&g_pui8DMAControlTable[DMA_ALT_OFFSET + (DMA_CHANNEL_10 * DMA_CTL_STRUCT_SIZE)]; // 定义两个ADC数据缓冲区 #define ADC_BUFFER_SIZE 256 uint16_t g_ui16ADCBufferA[ADC_BUFFER_SIZE]; uint16_t g_ui16ADCBufferB[ADC_BUFFER_SIZE];

配置主控制结构（指向Buffer A）：

// 假设ADC结果寄存器地址是 0x40038000 + 某个偏移，这里用宏代替 #define ADC_RESULT_ADDR ((volatile void *)(0x4003800C)) // 假设ADC数据是16位，内存缓冲区地址是16位对齐的 pPrimary->srcEndPtr = ADC_RESULT_ADDR; // 源：ADC结果寄存器 pPrimary->dstEndPtr = (volatile void *)(g_ui16ADCBufferA + ADC_BUFFER_SIZE - 1); // 目的：Buffer A末尾地址 // 配置控制字 CONTROL // XFERSIZE = 256-1 = 255 (传输项数-1) // ARBSIZE = 4 (仲裁大小，根据ADC和总线性能设定，例如4个数据项为一次突发) // XFERMODE = 乒乓模式 (假设编码为0x3，需查手册确认) // SRCINC = 0 (外设寄存器地址固定) // DSTINC = 2 (16位数据，地址递增2字节) // SRCSIZE = 1 (源数据大小16位) // DSTSIZE = 1 (目的数据大小16位) uint32_t ui32ControlWord = 0; ui32ControlWord |= ((ADC_BUFFER_SIZE - 1) << 4); // XFERSIZE @ bit[15:4] ui32ControlWord |= (3 << 2); // ARBSIZE=4 @ bit[5:2] (值N代表2^(N+1)？需查手册，此处为示例) ui32ControlWord |= (0x3 << 0); // XFERMODE=Ping-Pong @ bit[1:0] // 假设 SRCINC=0, DSTINC=2, SRCSIZE=1, DSTSIZE=1 的配置在更高位，这里简化 ui32ControlWord |= (0 << 26) | (2 << 30); // 示例位，具体需按手册位域组合 pPrimary->control = ui32ControlWord;

配置备用控制结构（指向Buffer B）： 配置与主结构类似，但目的地址指向g_ui16ADCBufferB，控制字中的XFERMODE同样设置为乒乓模式。

pAlternate->srcEndPtr = ADC_RESULT_ADDR; pAlternate->dstEndPtr = (volatile void *)(g_ui16ADCBufferB + ADC_BUFFER_SIZE - 1); pAlternate->control = ui32ControlWord; // 使用相同的控制字

4.3 步骤三：配置通道寄存器并启动

  1. 配置通道映射（如果需要）：查看数据手册，找到ADC采样序列发生器对应的DMA请求源，并配置DMACHMAP寄存器将通道10映射到该源。
  2. 设置通道优先级（可选）：
    DMAPRIOSET = (1 << DMA_CHANNEL_10); // 设置为高优先级
  3. 配置请求类型（如果ADC支持突发请求）：
    DMAUSEBURSTSET = (1 << DMA_CHANNEL_10); // 只使用突发请求
  4. 清除请求掩码（允许ADC硬件触发）：
    DMAREQMASKCLR = (1 << DMA_CHANNEL_10);
  5. 使能通道：
    DMAENASET = (1 << DMA_CHANNEL_10);
  6. 配置并启动ADC的DMA请求：根据ADC模块的寄存器手册，启用其DMA功能，并启动采样序列。

4.4 步骤四：中断服务程序处理

在乒乓模式下，每次主备结构完成一次传输（即填满一个缓冲区）都会产生中断。我们需要在中断服务程序（ISR）中：

  1. 判断中断源：读取DMA中断状态寄存器（通常是一个独立的寄存器，如DMAIntStatus），确认是通道10的中断。
  2. 清除中断标志：向相应的中断清除寄存器写1。
  3. 处理数据：根据DMAALTSET寄存器的通道10位，判断当前是哪个缓冲区（A或B）刚刚被填满。然后处理该缓冲区中的数据（例如，进行滤波、拷贝或上传）。
  4. （可选）重新武装缓冲区：在某些情况下，如果处理速度跟不上DMA填充速度，为了防止溢出，可以在处理完数据后，检查并确保控制结构中的地址和大小是正确的。对于简单的乒乓模式，只要缓冲区大小固定，DMA会自动循环，无需在ISR中修改控制结构。
  5. 注意事项：ISR应尽可能短小高效。如果数据处理耗时较长，应设置标志位，在ISR外的主循环或低优先级任务中处理。

5. 常见问题排查与调试心得

即使按照手册配置，在实际项目中依然会遇到各种问题。以下是我在多年开发中总结的一些常见“坑”和解决思路。

5.1 DMA传输根本没有启动

  • 检查1：控制器主使能：确认DMACFG的MASTEN位已设置为1。这是最容易被忽略的第一步。
  • 检查2：控制表基址对齐：使用调试器查看DMACTLBASE寄存器的值，确认其低10位是否为0。如果不是，一定是控制表数组没有正确对齐。
  • 检查3：通道使能：读取DMAENASET寄存器，确认对应通道的位是否为1。
  • 检查4：请求掩码：读取DMAREQMASKSET寄存器，确认对应通道的位是否为0（即未屏蔽）。如果被屏蔽，只有软件请求能触发。
  • 检查5：外设端配置：DMA是受外设触发的。确保ADC/UART/SPI等外设本身的DMA功能已启用，并且其触发条件已满足（例如，ADC转换完成、UART发送缓冲区空）。
  • 检查6：软件请求：如果是软件启动的存储器到存储器传输，确认已向DMASWREQ寄存器写了1。

5.2 DMA传输启动但数据错误或传输量不对

  • 检查1：控制结构内容：在初始化后，通过调试器内存窗口，直接查看你为通道分配的控制表内存区域。核对srcEndPtr、dstEndPtr和control字段的值是否符合预期。特别注意XFERSIZE是“传输项数-1”。
  • 检查2：地址递增和数据类型：确认SRCINC和DSTINC设置正确。如果从外设固定寄存器读数，SRCINC应为0。如果目的地址是内存数组，DSTINC应根据数组元素类型设置（8位=1，16位=2，32位=4）。SRCSIZE和DSTSIZE也必须匹配。
  • 检查3：仲裁大小（ARBSIZE）：ARBSIZE必须小于等于XFERSIZE+1。如果ARBSIZE设置过大，可能导致单次突发请求无法完成，传输停滞。
  • 检查4：总线错误：读取DMAERRCLR寄存器。如果位0为1，说明发生了总线错误。必须写1清除此位，并检查地址指针是否指向了无效内存区域（例如，访问了未初始化的指针或只读区域）。

5.3 乒乓模式或分散-聚集模式工作异常

  • 检查1：模式配置：确认主控和备用控制结构的XFERMODE字段都正确设置为目标模式（例如，乒乓模式是0x3）。一个常见的错误是只设置了一个结构。
  • 检查2：中断处理：在乒乓模式下，两个控制结构完成传输都会产生中断。你的ISR是否能够正确处理来自两个结构的中断？是否清除了正确的中断标志？ISR执行时间是否过长，导致错过了下一个缓冲区满的中断？
  • 检查3：缓冲区指针：在分散-聚集模式下，主结构的srcEndPtr必须指向一个有效的任务描述符表。每个描述符本身必须是一个格式正确的控制结构。确保任务表的最后一个描述符的XFERMODE不是“备用分散-聚集模式”，否则DMA会无限循环。
  • 检查4：状态跟踪：在调试时，可以定期读取DMAALTSET寄存器，查看通道当前使用的是主结构还是备结构，这有助于判断DMA是否在按预期切换。

5.4 性能未达预期

  • 优化仲裁大小（ARBSIZE）：增大ARBSIZE可以让DMA每次响应请求时传输更多数据，减少总线仲裁开销。但前提是你的外设支持突发请求，并且源/目的内存能跟上这个节奏（例如，不是访问低速Flash）。可以尝试设置为4、8或16进行测试。
  • 使用突发请求：如果外设支持，务必通过DMAUSEBURSTSET寄存器将通道配置为只使用突发请求模式。
  • 调整优先级：为关键的数据流通道（如显示刷新、高速ADC）设置高优先级（DMAPRIOSET），确保其及时响应。
  • 内存对齐：确保源和目的地址都按照数据宽度对齐（16位数据按2字节对齐，32位数据���4字节对齐）。非对齐访问在某些架构上会导致额外的时钟周期。
  • 审视总线竞争：DMA与CPU共享系统总线。如果CPU也在频繁访问内存（尤其是执行位于同一内存的代码），会产生竞争，降低DMA效率。考虑将CPU的关键代码或数据放到TCM（紧耦合内存）中，或者优化CPU访问模式，减少与DMA目标区域的总线冲突。

调试μDMA是一个需要耐心和细致的过程。最强大的工具就是调试器：设置内存观察点来监控缓冲区变化，单步跟踪寄存器配置流程，以及善用DMASTAT寄存器中的STATE字段来观察控制器内部状态。把这些寄存器的工作原理和高级模式的设计意图吃透，你就能让这个“隐形引擎”真正为你的嵌入式系统带来质的性能提升。

http://www.jsqmd.com/news/1249234/

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