JFET共源放大电路稳定性建模：相位裕度评估示例

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当JFET开始“唱歌”：共源放大器振荡背后的相位真相与止振实战手记

去年调试一款压电式振动传感器前端时，我遇到一个典型却令人抓狂的现象：
输入一个干净的100 Hz方波，示波器上却跳出持续数微秒的1.2 MHz高频振铃，像电路在“哼歌”。信号链后级ADC采样完全失真，信噪比骤降20 dB。排查电源噪声、接地环路、运放选型……耗时三天无果。最终发现，罪魁祸首不是芯片，而是那只安静躺在PCB角落的2N4416 JFET——它在共源配置下，正悄然滑向相位崩溃的临界点。

这不是个例。在高阻抗传感器接口（光电二极管、MEMS麦克风、pH电极）、音频前置、射频检波等场景中，JFET因其零栅极漏电、低1/f噪声、平缓温度漂移，仍是不可替代的第一级放大器件。但它的稳定性，远比数据手册里那张静态转移曲线脆弱得多。一旦负载变重、走线变长、增益调高，它就可能从“静音放大器”变成“自激振荡器”。

而真正决定它会不会唱歌的，不是某个电阻值，而是相位裕度（Phase Margin, PM）——那个藏在波特图拐点之后、决定系统是否能安静工作的隐藏判据。

为什么JFET共源结构特别容易“失控”？

先抛开教科书式的定义。我们用一个更本质的视角看：
JFET共源放大，本质上是一个跨导器件 + 输出阻抗 + 寄生电容构成的反馈系统。它的“不稳定”，从来不是突然发生的，而是极点悄悄堆积、相位一寸寸滑向−180°深渊的过程。

关键不在JFET本身多“好”，而在它身上那几个看不见却致命的小电容：

• $C_{gs}$（栅源电容）：约5 pF，是输入端的“惯性”，决定低频响应；
• $C_{ds}$（漏源电容）：约0.8 pF，影响输出端高频阻抗；
• $C_{gd}$（栅漏电容）：仅1.8 pF，却是整个系统的“阿喀琉斯之踵”。

为什么？因为JFET共源是反相放大器——$v_{out}$ 和 $v_{gs}$ 相位相反。而 $C_{gd}$ 正好跨接在这两个反相节点之间。根据密勒定理，它在输入端等效成一个被放大了 $(1+|A_v|)$ 倍的电容。

假设你用 $R_D = 10\,\text{k}\Omega$，$g_m = 4.2\,\text{mS}$，则低频增益 $|A_v| \appr