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STM32内核精讲 | 第四章指令集基础 —— Thumb® 与 Thumb‑2

news 2026/5/3 18:41:13

💡 本文是《STM32内核精讲》栏目的第四篇。前三篇我们学习了 Cortex-M 家族、编程模型和存储器模型。从本篇开始，我们将进入指令的世界——理解 Cortex-M 到底能执行哪些指令，以及这些指令如何影响性能、代码密度和调试。

📌 一、引言：为什么需要了解指令集？

你可能写过这样的代码：

__disable_irq();__DSB();__ISB();

或者调试时看到 PC 指向一些奇怪的地址，反汇编窗口里满是LDR、STR、B、BL等助记符。

这些函数和指令背后，隐藏着 Cortex-M 执行代码的底层规则。了解指令集，能帮你：

读懂启动文件和 RTOS 任务切换中的汇编代码
理解__disable_irq()到底关了哪些中断（CPSID 指令）
分析 HardFault 时 PC 指向的异常指令
写出更高效、更安全的 C 代码（比如知道何时用 volatile，何时用内存屏障）

本篇不要求你成为汇编高手，但会帮你建立必要的指令集认知，为后续的异常处理、上下文切换、启动文件分析打下基础。

📌 二、Thumb 与 Thumb‑2：16/32 位混合指令

2.1 历史背景：从 ARM 到 Thumb

早期的 ARM 处理器（如 ARM7、ARM9）使用32 位固定长度指令（称为 ARM 指令集）。优点是功能强大，缺点是代码密度低——嵌入式系统 Flash 有限，32 位指令浪费空间。

为了提升代码密度，ARM 推出了Thumb 指令集：将指令压缩为 16 位。大多数指令只保留最常用的功能，执行时由处理器内部解码为等价的 32 位操作。这样代码体积减少约 30%，性能略有下降。

Cortex-M 处理器只支持 Thumb 指令，不支持原始 32 位 ARM 指令。但 Thumb 本身也在演进：

Thumb（原始）：16 位指令，功能有限，无法直接访问某些寄存器（如 R8~R12 受限）。
Thumb‑2：混合 16/32 位指令，没有 16 位和 32 位的模式切换，处理器自动识别。它补全了 Thumb 缺失的功能（如条件执行、大量寄存器操作），性能接近 ARM 指令集，同时保持高代码密度。

Cortex-M3 及以上内核都支持完整的 Thumb‑2 技术。Cortex-M0/M0+ 仅支持 Thumb 指令（16 位，加上少数 32 位指令如BL）。

2.2 如何区分 16 位和 32 位指令？

处理器通过指令编码的最高位来区分：如果低半字的 bits [15:11] 在0b11101到0b11111范围内，则是一条 32 位指令；否则是 16 位指令。

在反汇编窗口中，32 位指令通常显示为两个 16 位半字，例如：

0x08000100 F04F 0000 MOV.W R0, #0

MOV.W中的.W表示这是一条 32 位宽指令。

2.3 为什么 Cortex-M 不支持 ARM 指令集？

硬件上只需要实现 Thumb 解码器，节省芯片面积和功耗。
Thumb‑2 的性能已经足够，且代码密度更高。
简化了软件模型：无需切换状态（以前 ARM 处理器通过BX指令切换 ARM/Thumb 状态）。

如果你看到某些资料提到BX或BLX指令会改变状态位，在 Cortex-M 上可以忽略——Thumb 位永远为 1。

📌 三、常用指令分类

以下按功能分类介绍最常见的指令（以 Cortex-M4 为基准，M0/M0+ 可能缺少部分指令）。

3.1 数据搬运指令

MOV/MOVS：寄存器之间或立即数传送。MOVS会更新 APSR 标志（N、Z）。
LDR：从内存加载到寄存器。
- LDR R0, [R1]：从 R1 指向的地址读取一个字（4 字节）到 R0。
- LDRB：读取字节。
- LDRH：读取半字。
- LDRD：读取双字（64 位），需要 Cortex-M3+。
STR：将寄存器存储到内存，类似LDR有STRB、STRH、STRD。
PUSH/POP：压栈和出栈。可同时操作多个寄存器，例如PUSH {R0-R3, LR}。

示例：

LDR R0, =0x20000000 ; 将地址加载到 R0（伪指令） LDR R1, [R0] ; R1 = *R0 ADD R1, #1 STR R1, [R0] ; *R0 = R1

3.2 算术与逻辑指令

ADD/SUB：加/减。
MUL：乘法（32 位结果）。
AND/ORR/EOR/BIC：按位与、或、异或、位清除。
LSL/LSR/ASR/ROR：逻辑左移、逻辑右移、算术右移、循环右移。
CMP：比较（相当于SUBS但不保存结果，只改标志位）。
TST：测试（相当于ANDS但不保存结果）。

注意：在 M0/M0+ 上，乘法指令只支持MULS（32 位乘，低 32 位结果），不支持 64 位结果。

3.3 分支与跳转指令

B：无条件跳转。
BX：跳转到寄存器中的地址，并可能切换状态（Cortex-M 中状态位固定，BX等同于MOV PC, LR效果）。
BL：带链接的分支（调用子程序），返回地址存入 LR。
BLX：带链接和状态切换（Cortex-M 中几乎不用）。
CBZ/CBNZ：比较并为零/非零时跳转（仅 Thumb‑2，16 位指令）。

示例：

BL func ; 调用函数，LR = 返回地址 ... func: ; 函数体 BX LR ; 返回

3.4 内存访问与屏障

DMB：数据内存屏障，确保所有内存访问在 DMB 之前完成，之后才开始后续访问。
DSB：数据同步屏障，等待所有内存访问完成。
ISB：指令同步屏障，刷新流水线，确保上下文改变生效（如修改 CONTROL 寄存器后）。

这些屏障指令在 C 语言中对应__DMB()、__DSB()、__ISB()宏，在 CMSIS‑CORE 中定义。

📌 四、条件执行与 IT 块

4.1 条件标志位

前面提到的 APSR 中的 N、Z、C、V 标志，大多数算术指令会更新它们。条件跳转指令（如BEQ、BNE、BGT等）根据这些标志决定是否跳转。

4.2 IT 块（If‑Then）

Thumb‑2 引入的IT（If‑Then）指令允许最多 4 条指令条件执行，无需分支。语法：

IT cond ; 如果 cond 为真，执行下一条指令 ITE cond ; 如果 cond 为真，执行下一条；否则执行再下一条

后跟T（Then）或E（Else）。例如：

CMP R0, #0 ITE EQ ; 如果相等 MOVEQ R1, #1 ; then: R1 = 1 MOVNE R1, #0 ; else: R1 = 0

这比用B跳转更高效，因为避免了流水线冲刷。编译器经常生成 IT 块来优化小的 if‑else。

注意：Cortex-M0/M0+ 不支持 IT 块（它们只支持 Thumb 指令集，没有 Thumb‑2 的这些扩展）。

4.3 条件助记符后缀

常见条件后缀（与 ARM 相同）：

后缀	含义	标志条件
EQ	等于	Z=1
NE	不等于	Z=0
CS/HS	进位/无符号大于等于	C=1
CC/LO	无进位/无符号小于	C=0
MI	负数	N=1
PL	非负数	N=0
VS	溢出	V=1
VC	无溢出	V=0
HI	无符号大于	C=1 且 Z=0
LS	无符号小于等于	C=0 或 Z=1
GE	有符号大于等于	N=V
LT	有符号小于	N≠V
GT	有符号大于	Z=0 且 N=V
LE	有符号小于等于	Z=1 或 N≠V

📌 五、单周期 I/O 与位带别名访问的本质

5.1 单周期 I/O

某些 Cortex-M 芯片（如 STM32F4 系列）具有单周期 I/O特性：对某些外设寄存器（尤其是 GPIO 的 ODR、IDR 等）的读写，可以在单个总线周期内完成，无需等待。这得益于芯片内部的总线矩阵设计。

在指令层面，这意味着LDR/STR访问这些地址时不会插入等待状态，从而允许快速位翻转。例如，使用位带别名访问 GPIO 输出比特，实际上也是通过单周期 I/O 实现的。

5.2 位带别名访问的指令本质

回顾第三篇的位带公式，读写别名地址时，处理器执行的是普通的LDR/STR指令。例如：

*(uint32_t*)0x42210184=1;

汇编后可能变成：

MOV R0, #1 LDR R1, =0x42210184 STR R0, [R1]

处理器内部硬件将别名地址转换为原始比特的原子操作。因此从指令集角度看，位带操作没有特殊指令，只是普通的内存访问——是硬件地址解码实现了原子性。

📌 六、内联汇编与裸函数

6.1 内联汇编

在 C 代码中嵌入汇编指令，通常用于：

直接执行某些内核指令（如CPSID关中断、DSB等）
优化关键代码段（如 RTOS 上下文切换）

GCC 内联汇编示例：

voiddisable_irq(void){__asmvolatile("cpsid i":::"memory");}

volatile防止重排，"memory"告诉编译器内存可能被修改。

ARMCC（Keil）内联汇编：

__asmvoiddisable_irq(void){CPSID I BX LR}

6.2 裸函数

裸函数（__attribute__((naked))）告诉编译器不要生成函数序言和尾声（即不压栈/弹栈 LR、不保存寄存器）。这用于必须完全手工控制堆栈和寄存器的场景，例如中断入口或任务切换函数。

__attribute__((naked))voidPendSV_Handler(void){__asmvolatile("MRS R0, PSP\n""STMDB R0!, {R4-R11}\n"// ... 更多汇编"BX LR\n");}

裸函数中不能有局部变量，也不能调用其他 C 函数（因为栈帧未建立）。

在 RTOS 移植中，PendSV 处理函数必须是裸函数，以确保上下文切换时完全由手工代码管理寄存器。

📌 七、总结与下篇预告

7.1 本篇核心要点

Thumb 与 Thumb‑2：16/32 位混合指令，高代码密度，Cortex-M 只支持 Thumb（M0+ 仅 16 位为主，M3+ 支持完整 Thumb‑2）。
常用指令分类：数据搬运（MOV、LDR、STR）、算术逻辑（ADD、AND）、分支（B、BL）、屏障（DMB、DSB、ISB）。
条件执行：通过 APSR 标志和 IT 块实现无分支条件执行（仅 M3+）。
单周期 I/O：某些外设访问无等待，位带别名本质是普通内存访问加硬件解码。
内联汇编与裸函数：在 C 中嵌入汇编的两种方式，以及裸函数在上下文切换中的关键作用。