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Fomu FPGA工作坊：从LED闪烁到RISC-V软核的微型硬件开发指南

news 2026/5/13 2:05:53

1. 项目概述：当FPGA遇见指尖，一场硬件的微型革命

如果你对嵌入式开发、硬件编程感兴趣，但又觉得传统的FPGA开发板笨重、昂贵且入门门槛高，那么im-tomu/fomu-workshop这个项目可能会让你眼前一亮。这不仅仅是一个代码仓库，更是一个通往“指尖上的FPGA”世界的完整工作坊指南。它的核心围绕着一款名为Fomu的硬件展开——一块可以像U盘一样插入电脑USB接口的微型FPGA开发板。这个工作坊项目，就是教你如何从零开始，让这块小小的硬件“活”起来，实现从LED闪烁到自定义USB设备等一系列有趣的功能。

简单来说，fomu-workshop是一个开源的教学资源集合，它系统化地引导开发者，特别是初学者，去探索和掌握在Fomu这块超小型FPGA开发板上进行编程和开发的完整流程。它解决了传统FPGA学习路径中环境搭建复杂、硬件成本高、项目不连贯的痛点，将复杂的FPGA开发、RTL设计、嵌入式软核（如RISC-V）编程，甚至USB协议栈开发，都浓缩到了一个可以放在口袋里的设备上。无论你是想了解FPGA的并行计算思想，还是想亲手打造一个属于自己的USB硬件，这个工作坊都提供了一个绝佳的、低成本的实践平台。

2. 核心硬件与工具链深度解析

2.1 Fomu硬件：麻雀虽小，五脏俱全

Fomu（FPGA on Module USB）的设计理念极具颠覆性。它本质上是一块集成了FPGA芯片、Flash存储、USB PHY（物理层接口）和RGB LED的微型系统，其尺寸与一个USB Type-A接口的U盘相当。这种极致的集成度带来了几个核心优势：

  1. 极低的入门门槛：无需额外的JTAG下载器、电源适配器或杜邦线。只需一根USB线，即可完成供电、编程和调试，实现了真正的“即插即用”开发体验。
  2. 完整的开发生态：硬件设计完全开源，这意味着你可以从电路图到PCB布局，彻底理解其工作原理。这对于学习硬件设计的学生和爱好者来说是无价之宝。
  3. 丰富的可编程资源：以Fomu PVT版本为例，其核心是一颗Lattice iCE40UP5K FPGA。这颗芯片虽然逻辑规模不大（约5280个LUT），但包含了嵌入式RAM、硬件乘法器和PLL，足以运行一个精简的RISC-V软核处理器（如VexRiscv）并处理复杂的USB通信协议。

注意：Fomu有多个版本（如PVT、EVT），不同版本在FPGA型号、Flash容量和LED数量上可能有细微差别。开始工作坊前，务必确认你手中硬件的具体版本，并查阅对应的硬件手册，这能避免很多因硬件差异导致的诡异问题。

2.2 工具链搭建：从云端到本地的选择

fomu-workshop项目的一个巨大贡献是极大地简化了工具链的搭建过程。FPGA开发通常需要安装庞大的IDE（如Vivado、Quartus），配置过程繁琐。Fomu工作坊主要推荐并围绕以下工具链展开：

  1. Yosys + nextpnr + icestorm (OSS CAD Suite)：这是一套完全开源、免费的FPGA综合、布局布线与烧录工具链。fomu-workshop的教程默认引导你使用这套工具。

    • Yosys：负责将你的硬件描述语言（如Verilog）综合成门级网表。
    • nextpnr：一个跨架构的布局布线工具，针对iCE40系列FPGA进行了深度优化。
    • icestorm：提供将布局布线后的结果转换成FPGA可识别的比特流文件（.bin）的工具，以及通过USB直接烧录到Fomu Flash中的工具iceprog。
    • 优势：开源、免费、命令行驱动，易于脚本化和集成到CI/CD流程中，是学习FPGA底层流程的绝佳选择。

  2. Lattice Radiant：这是Lattice官方的商业IDE（有免费版本）。对于习惯图形化界面、依赖官方IP核或进行更复杂设计的开发者，Radiant是一个不错的选择。工作坊可能也会提供相关的参考配置。

  3. RISC-V工具链：当你的设计需要在FPGA内部运行一个软核处理器（CPU）时，你需要一套交叉编译工具链，用于将C语言程序编译成该处理器能执行的机器码。工作坊通常会引导你安装riscv64-unknown-elf-gcc这套工具。

实操心得：对于初学者，强烈建议严格按照工作坊的指引，先使用预配置好的Docker环境或虚拟机镜像。这能绕过90%的环境依赖问题，让你快速进入核心的学习环节。等你熟悉了整个流程后，再尝试在本地主机上搭建原生工具链，以深入了解各个组件的依赖关系。

3. 工作坊核心实验流程详解

fomu-workshop的内容通常是循序渐进的，下面我将以一个典型的实验路径为例，拆解其中的关键步骤和技术要点。

3.1 实验一：点亮RGB LED——“Hello, World!”的硬件版本

这是你的第一个硬件实验，目标是让Fomu上的RGB LED按照预设模式闪烁。

  1. 环境准备：克隆工作坊仓库，并进入提供的Docker容器或配置好的开发环境。这一步确保了所有人起点一致。

  2. 编写Verilog代码：你会接触到第一个Verilog模块。核心是编写一个计数器（counter），利用FPGA内部的时钟信号进行累加，然后根据计数器的高位比特来控制RGB LED三个通道的亮灭，从而混合出不同的颜色。

    module blink ( input clk, // 来自FPGA的12MHz时钟输入 output rgb0, // RGB LED的红色通道 output rgb1, // 绿色通道 output rgb2 // 蓝色通道 ); reg [23:0] counter = 0; // 定义一个24位寄存器作为计数器 always @(posedge clk) begin counter <= counter + 1; // 每个时钟上升沿，计数器加1 end // 将计数器的高位分别赋值给RGB引脚，产生缓慢的闪烁效果 assign rgb0 = counter[23]; assign rgb1 = counter[22]; assign rgb2 = counter[21]; endmodule

  3. 综合与实现：使用yosys对blink.v进行综合，生成网表文件。然后使用nextpnr-ice40进行布局布线，这里需要指定Fomu的具体FPGA型号（如--up5k）和封装（如--package sg48）。最后用icepack生成比特流文件。

  4. 烧录与验证：通过iceprog工具，将生成的.bin文件通过USB接口烧录到Fomu的Flash中。烧录成功后，Fomu会自动复位运行，你就能看到RGB LED开始循环变换色彩了。

关键点：这个实验虽然简单，但它完整地走通了FPGA开发的核心流程：设计（编写RTL） -> 综合 -> 布局布线 -> 生成比特流 -> 烧录。理解这个闭环是后续所有复杂项目的基础。

3.2 实验二：实现USB通信——让电脑识别Fomu

让Fomu不仅仅是一个闪灯的小玩意，而是能被主机识别为一个USB设备，这是质变的一步。工作坊会引导你实现一个基础的USB接口，例如模拟一个USB串口（CDC ACM）或一个HID设备。

  1. 理解USB基础：你需要对USB协议有个基本概念，包括设备描述符、配置描述符、端点（Endpoint）通信等。Fomu内部有一个硬核的USB PHY，但上层的协议处理需要你用FPGA逻辑来实现。

  2. 集成USB协议栈：通常，工作坊会提供一个已经验证过的、用Verilog编写的轻量级USB设备协议栈（例如用于CDC ACM的）。你的任务可能是将其实例化到你的顶层设计中，并根据工作坊的指导配置正确的描述符。

    module top ( inout usb_dp, // USB D+ 信号 inout usb_dn, // USB D- 信号 // ... 其他端口 ); // 实例化PLL模块，将12MHz时钟倍频到48MHz，供USB模块使用 pll my_pll (.clock_in(clk_12mhz), .clock_out(clk_48mhz)); // 实例化USB设备核心模块 usb_cdc_acm my_usb ( .clk_48mhz(clk_48mhz), .usb_dp(usb_dp), .usb_dn(usb_dn), .rx_data(rx_byte), .tx_data(tx_byte), // ... 其他连接 ); // ... 其他用户逻辑 endmodule

  3. 与主机交互：成功烧录后，将Fomu插入电脑，你会在设备管理器中看到一个新的串行端口（如COM3或/dev/ttyACM0）。此时，你就可以使用串口终端工具（如PuTTY、screen、minicom）打开这个端口，实现FPGA与电脑之间的双向字符数据传输。

实操心得：USB描述符的配置是这一步最容易出错的地方。一个字节的错误就可能导致设备无法被识别或识别为未知设备。务必仔细对照工作坊提供的描述符示例，并理解每个字段的含义。使用lsusb -v（Linux）或设备管理器查看详细信息（Windows）是调试USB设备问题的必备技能。

3.3 实验三：运行RISC-V软核——在FPGA里造一个“电脑”

这是工作坊的高潮部分：在Fomu这块小小的FPGA里，实例化一个RISC-V CPU软核，并让它运行你编写的C程序。

  1. 软核选择与集成：工作坊通常会采用VexRiscv这款高度可配置、性能优异的开源RISC-V软核。你需要将软核的Verilog源码集成到你的项目中，并为其配置好总线、内存（使用FPGA的Block RAM）和外围设备（如之前实现的USB串口）。

  2. 构建内存映射：定义好软核可以访问的地址空间。例如，0x00000000 开始是程序内存（RAM），0x10000000 可能是GPIO（用于控制LED），0x20000000 可能是UART（映射到USB串口）的寄存器地址。这需要在硬件设计（Verilog）中通过总线互联逻辑来实现。

  3. 编写、编译与链接C程序：编写一个简单的C程序，比如通过串口打印 “Hello from RISC-V on Fomu!”。使用RISC-V工具链进行编译和链接。关键的一步是编写链接脚本（.ld文件），它告诉链接器将代码（.text）、数据（.data）等段放置到你在第2步中定义的内存地址上。

    // hello.c #include “uart.h” // 假设有封装好的串口驱动头文件 void main() { uart_init(); // 初始化串口 uart_puts(“Hello from RISC-V on Fomu!\n”); while(1); }

    编译命令类似：riscv64-unknown-elf-gcc -march=rv32im -mabi=ilp32 -Wl,-Tlink.ld -o firmware.elf hello.c

  4. 生成内存初始化文件：将编译好的ELF文件中的程序代码提取出来，转换成Verilog能够识别的内存初始化文件（通常是.hex或.bin格式）。在综合时，这个文件的内容会被预加载到FPGA的Block RAM中，当FPGA上电配置后，CPU就可以从RAM中读取并执行这些指令了。

  5. 全系统集成与测试：将包含软核、内存、外设和固化程序的完整设计，重新进行综合、布局布线和烧录。上电后，打开串口终端，你就能看到来自FPGA内部RISC-V CPU的问候信息了。

4. 进阶探索与项目构思

完成工作坊的基础实验后，Fomu的潜力才刚刚开始被挖掘。你可以基于此进行无数有趣的扩展：

  1. 自定义USB设备：利用你学到的USB知识，将Fomu打造成一个特定的USB设备。例如：

    • USB键盘/鼠标（HID）：制作一个宏按键键盘或空气鼠标。
    • USB MIDI设备：制作一个简单的MIDI控制器。
    • 自定义USB设备：与电脑上的自定义驱动程序通信，传输特定数据。

  2. 传感器集成：虽然Fomu本身IO有限，但你可以通过飞线或制作一个简单的转接板，连接I2C或SPI传感器（如温湿度传感器、加速度计），让RISC-V软核读取数据并通过USB上报。

  3. 数字电路实验平台：将其作为纯数字逻辑实验板，实现诸如PWM调光、音频发生器、简单的状态机控制器等。

  4. 软核优化与探索：尝试配置VexRiscv的不同特性，如增加乘法器支持、调试模块，甚至尝试集成其他开源软核（如PicoRV32），比较其资源占用和性能差异。

5. 开发中的常见陷阱与调试技巧

在Fomu上开发，你会遇到一些独特的问题。以下是一些实录的排查经验：

  1. 设备无法识别或烧录失败

    • 检查驱动：在Windows上，首次使用iceprog可能需要安装WinUSB或libusb驱动，可以使用Zadig工具为Fomu重新安装驱动。
    • 进入DFU模式：Fomu有一个隐藏的DFU（设备固件升级）模式。通常可以通过在插入USB时短接PCB上的两个特定测试点，或快速上下电多次来触发。进入DFU模式后，设备会被识别为不同的USB PID/VID，这时可以用dfu-util工具进行底层恢复。
    • 电源问题：某些USB端口供电不足。尝试更换端口或使用带外部供电的USB集线器。

  2. 时序违例导致功能异常

    • 现象：设计在仿真中正常，但烧录后行为错乱或不稳定。
    • 排查：nextpnr在布局布线后会给出时序报告。重点关注“Max Delay”和“Setup/Hold”违例。对于Fomu的12MHz时钟，时序通常很宽松，但如果你用PLL生成了更高频率的时钟（如48MHz给USB），就需要仔细检查相关路径的约束是否正确，逻辑层级是否过深。
    • 解决：添加合理的时钟约束（.sdc文件），优化关键路径代码（如使用流水线、寄存器打拍）。

  3. 资源溢出

    • 现象：nextpnr报告逻辑资源（LUTs、BRAM）或IO资源不足。
    • 排查：使用yosys的stat命令查看综合后的资源使用报告。集成RISC-V软核和USB协议栈后，iCE40UP5K的资源会相当紧张。
    • 解决：优化代码，移除未使用的模块；选择更精简的软核配置（如禁用乘法器、减少缓存）；如果使用BRAM做内存，酌情减小内存大小。

  4. 软件工具链问题

    • 版本冲突：OSS CAD Suite工具链更新较快，确保你使用的工具版本与工作坊文档要求一致。使用项目推荐的Docker镜像是最稳妥的。
    • 路径与权限：确保项目路径没有中文或特殊字符。在Linux/macOS下，确保你对USB设备有读写权限（通常需要将用户加入dialout或plugdev组）。

我个人在多次带领工作坊和自行开发中的体会是，耐心和系统性是成功的关键。FPGA开发调试不像软件，可以单步跟踪。它更像是在做一个物理实验，需要你假设问题点（是代码逻辑？时序约束？还是硬件连接？），然后设计“实验”（修改代码、添加调试信号、调整约束）去验证。每次成功点亮LED、成功收到串口数据、成功让CPU跑起来，那种从物理层面掌控计算的成就感，是纯软件开发无法比拟的。Fomu以其极低的成本和便捷性，极大地降低了体验这种成就感的门槛。从这个小项目出发，你获得的不仅是FPGA和硬件设计的知识，更是一种软硬件协同的系统级思维方式。

http://www.jsqmd.com/news/805872/

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